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EDA365直播课--《高速刚挠板叠层设计与阻抗计算》
查看: 453|回复: 16

等长问题

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三级会员(30)

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发表于 2019-4-15 07:32 | 显示全部楼层 |阅读模式

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设置了XNET,做完等长才发现PCB上面两端加起来和等长表格里面的长度不一样,有遇到同样问题的朋友帮忙解答一下,谢谢,有图片,急......
8 y% p. ?9 Y+ h, v/ n$ E4 s. D& L  Q2 e- E
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二级会员(20)

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发表于 2019-4-15 16:31 | 显示全部楼层
目测Z Axis Delay补偿了不同层走线过孔长度,请注意叠层里面各层厚度设置正确。另外,Xnet我都不用CLINE来看长度,直接看net长度就好了。

三级会员(30)

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 楼主| 发表于 2019-4-15 19:24 | 显示全部楼层
dzkcool 发表于 2019-4-15 08:31
" M$ f$ o+ ^0 ?% O' ]看下是不是打开了Z Axis Delay,导致过孔长度也算进去了
$ a! c% k& ]) Q# m9 n; c7 }
就是这个问题,去掉就好了,谢谢
5 g% ?! C$ w% L8 T9 d/ {" B4 F

三级会员(30)

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 楼主| 发表于 2019-4-15 19:26 | 显示全部楼层
dengjh520 发表于 2019-4-15 09:06
4 S3 H' U$ o, n是VIA 孔也算进去了,如果有PIN delay 差距更大,没问题的
5 T, Q. K7 t) q. E3 e, ^
不算过孔长度就对上了,谢谢( d0 b! }. G0 Z( V+ w( v1 [! e

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发表于 2019-4-15 08:31 | 显示全部楼层
看下是不是打开了Z Axis Delay,导致过孔长度也算进去了

点评

就是这个问题,去掉就好了,谢谢  详情 回复 发表于 2019-4-15 19:24
过孔的长度需要加吗  详情 回复 发表于 2019-4-15 11:57

三级会员(30)

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发表于 2019-4-15 08:35 | 显示全部楼层
CM里面是PIN到PIN的长度,你看看图上除了pin到pin的线是不是还有其他有多余的线。

三级会员(30)

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发表于 2019-4-15 09:06 | 显示全部楼层
是VIA 孔也算进去了,如果有PIN delay 差距更大,没问题的
ll.png

点评

不算过孔长度就对上了,谢谢  详情 回复 发表于 2019-4-15 19:26

三级会员(30)

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发表于 2019-4-15 09:47 | 显示全部楼层
你看下是不是板的叠层没设置正确,这种在板上设置长度的要先设置好叠层

三级会员(30)

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发表于 2019-4-15 11:43 | 显示全部楼层
看你的截图,你找个DDR没有封装PIN 长度吗,很多DDR都有PIN长,别绕半天白做了

四级会员(40)

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发表于 2019-4-15 11:57 | 显示全部楼层
dzkcool 发表于 2019-4-15 08:31! ]7 N! \. @9 f$ t$ [' v
看下是不是打开了Z Axis Delay,导致过孔长度也算进去了
* `, G: O- O5 \0 B  q) u
过孔的长度需要加吗* ^0 R8 d! X8 q" P$ ^

点评

就是这个问题,去掉就好了  详情 回复 发表于 2019-4-15 19:23
发表于 2019-4-15 13:19 | 显示全部楼层
低于5G的不需要考虑
专业服务(价格面议):
养鱼
钓鱼
烤鱼
吃鱼

五级会员(50)

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发表于 2019-4-15 17:03 | 显示全部楼层
学习了

三级会员(30)

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 楼主| 发表于 2019-4-15 19:23 | 显示全部楼层
杰1111 发表于 2019-4-15 11:57
+ ]: `* \/ u6 o8 k过孔的长度需要加吗

* J7 h8 @) q5 ^- z8 R就是这个问题,去掉就好了
" a- v& a, S, U4 w$ x

四级会员(40)

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发表于 2019-4-15 22:00 | 显示全部楼层

四级会员(40)

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发表于 2019-4-16 09:04 | 显示全部楼层
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