找回密码
 注册

扫一扫,访问微社区

6月30日-EDA365射频、EMC公益课深圳站
查看: 58488|回复: 155

新书《ic封装基础与工程设计实例》已在亚马逊,京东,当当等卖场开卖

    [复制链接]
发表于 2014-7-18 11:56 | 显示全部楼层 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
本书涉及的三个小程序工具已放在 www.eda365.com --《ic封装基础与工程设计实例》版块置顶位置,欢迎下载。
( g+ P2 a3 q* \" v/ ~任何技术问题,欢迎在本版发帖讨论。
6 t7 l& s' A  c8 Q) F$ \  {. x, e本书卖点:6 u; K% s8 V- J" _
        基于工程实践的四类典型封装例子$ Q. u2 |' e5 R
        开创读者与作者实时互动的论坛交流模式
0 z* [0 g% ?7 R' v        图文并茂详细解说封装设计与加工步骤
) [7 d9 L, p  |5 u; n5 I  ^        免费提供高效设计辅助工具! N1 l1 t, n" Q- b3 ^
        PCB/SI/热设计/封装设计工程师进阶必选
2 l& X, p! u" J7 l" c
; g0 n  O* V$ ?% t1        内容简介
4 w7 L! v1 m% Y' x本书通过四种最有代表性的封装类设计实例(QFP---PBGA---FCPBGA---SIP),详细介绍了封装设计过程及基板,封装加工,生产方面的知识。
# l1 @$ }+ }, w本书还涵盖封装技术的概念,常用封装材料介绍及封装工艺流程,金属线框QFP的设计,WireBond介绍,PBGA设计,基板工艺,封装工艺,8个DIE堆叠的SIP设计与制作过程,高速SERDES的FC-PBGA设计关键点,FLIPCHIP设计过程中DIE与PACKAGE的局部CO-DESIGNDIE。本书还免费提供作者在日常封装设计过程中自开发的多个高效率封装辅助软件小工具,并不定期到www.eda365.com网站<<IC封装设计与仿真>>版块更新及增加。
9 C) F$ X7 u8 E( H8 J1 n9 b$ x$ h本书适用于SI工程师,PCB设计工程师,热设计,机械设计,封装设计工程师,基板制造及封装工程师,也可以作为高校电子封装专业学生学习资料及专业教材,促进学生快速的从理论学习阶段转变到实际的项目设计。
0 X4 n, F( x* T
- W2 V  H9 G* I# _有机会通过本书分享PCB/封装设计方面的知识,首先要感谢陈兰兵,胡庆虎,姜向忠三位前同事让我有机会进入这个行业及提供发挥的空间。他们是国内大企业中引进PCB的仿真概念,仿真平台建立,实施及与外国PCB领域合作方面的开拓者,对国内PCB仿真设计行业有很大的贡献。他们15年前的行为对国内PCB设计及仿真的影响在今天看来是很有远见的。9 k# }) D4 A  K% L) u& B

! p5 D/ J- a4 H* w! x/ _ book.jpg 5 R3 b- L5 N$ ]& v/ w
, w0 W) i6 U3 G% n; Z* F5 `

1 D! w! _: B1 f! ]
 楼主| 发表于 2014-7-22 10:32 | 显示全部楼层
weihuaping118 发表于 2014-7-22 09:07/ v/ ~9 _7 v  f$ [8 ?
毛大师:请问您的封装宝典是基于什么LAY软件做的,每个EDA软件都是不一样的做法啊,我是没整明白,还是通用 ...

% i6 X; E# @) k) x" o简单的使用什么软件都行,请关注后面的三个复杂的都是使用APD. 2 J7 q" G$ d( K1 m4 G  M
最关键是对过程明白了使用什么软件都一样。
 楼主| 发表于 2015-2-2 10:32 | 显示全部楼层
1        第1章 常用封装简介        66 P' V1 c& Q, |2 x) @
1.1        封装        6
" B7 v3 _" o( N; c1.2        封装级别的定义        6
% s/ `) h0 h, `% ^- U1 s1.3        封装的发展趋势简介        6( n& ]' ?5 s$ e$ `# Q
1.4        常见封装类型介绍        91 B  s1 }7 b! n) B' \, ]9 F5 I
1.4.1        TO (Transistor Outline)        9
+ v1 T" a( f& ~% \4 }( e* ~1.4.2        DIP (Dual In line Package)        9. [* w' N9 j1 y( l6 y: v1 I
1.4.3        SOP(Small Out-Line Package)/ SOJ( Small Out-Line J-Lead Package)        10: H, H% c# i+ g8 v
1.4.4        PLCC (Plastic Leaded Chip Carrier)        11  r. |. M* k' ]5 A4 u5 I" z- o' L! r
1.4.5        QFP(Quad Flat Package)        11
* q" D* c; Q: o0 S% w2 K( F# L1.4.6        QFN(Quad Flat No-lead)/LCCC(Leadless Ceramic Chip Carrier)        16! Y% T) p" i. A7 C+ ^0 D9 H
1.4.7        Lead Frame进化图        17) D+ {* p( v$ P# n$ ]; E
1.4.8        PGA(Pin Grid Array Package)        17
( O# M1 i! g. b2 S  l3 b1.4.9        LGA (LAND GRID ARRAY)        18
: \( y/ L7 h8 G' [$ M  ]) q/ C1.4.10        BGA(Ball Grid Array Package)        188 n! n7 q; a) n
1.4.11        T BGA (Tape Ball Grid Array Package)        195 z3 F6 T1 j7 C
1.4.12        PBGA (Plastic Ball Grid Array Package)        200 W$ {  }8 H* k7 c9 M
1.4.13        CSP Chip Scale/Size Package)/ FBGA (Fine Pitch BGA)        21
6 g) |& f: \1 P$ d1.4.14        FC-PBGA(Flip-Chip Plastic Ball Grid Array)        221 t7 C- K7 ]! @
1.4.15        WLCSP(Wafer-Level Chip Scale Packaging Technology)        233 \7 v1 }  Q0 d+ J4 S  z; Y
1.4.16        MCM(Multi-Chip Module)        255 B# f2 N" W; ^7 v. [
1.4.17        SIP(System In Package)        26
$ X/ ]$ j. A% O. u; e" T5 Y1.4.18        SOC        27: |$ M8 ]) _  r; N$ g6 P
1.4.19        PIP(Package In Package)        30; A8 W. H+ k' m. U
1.4.20        POP(Package On Package)        30" c- V  W0 S! D0 }# y4 c. R6 D
1.4.21        TSV (Through Silicon Via)        32
2 W" s0 d9 v- J: o( U0 I' u1.5        封装介绍总结:        34
+ ]! A6 s3 F# j1 j& u1        第2章Wirebond介绍        5
0 e) y' m$ {  H4 u/ r0 @1.1        Wire bond 特点(成熟,工艺,价格)        5
: G8 Y$ ]* n8 A6 Q( Q5 H! H% }- r2 x1.2        Wribond的操作过程(每步骤有图)        8/ x, O2 ^0 Z: p) O7 [
1.3        哪些封装适合于使用Wire bonding工艺        12
9 _# R( y) ~# N7 G3 J/ r- V1.4        Wire bonder机器介绍        148 n, k3 y, D: R9 e0 s' T' ]
1        第3章 LEAD FRAME QFP封装设计        6+ S! b- m( J# z: l
1.1        QFP Lead Frame介绍        6
4 K6 F9 v, Z$ O1.2        Lead frame 材料介绍        8. h# u5 G4 Q/ b/ L0 n$ f
1.3        Lead frame design rule        8
( {, F4 L( M0 T5 ~5 n  U1.4        QFP Lead Frame 设计方法        10
% o5 R$ j- @. C1 S1.5        Wire Bonding设计过程(以autocad为例)        17; B" n* o- w3 \
1.6        Lead frame Molding过程        22
2 X+ X: t- X3 p1.7        QFP Punch成型  (整块没Punch lead frame的图)        244 V* I9 S( e* t; C" D
1.8        常用Molding材料的一些介绍        26# x" k& L0 g( n. ]' ?+ p
1.9        QFP lead frame生产加工流程        28
4 a: h$ r5 Y4 C. h- C0 A' e8 Z: V% g: e6 Q
第4章 PBGA封装设计        7
% G, g+ B5 p& t# R& g; c1        WB_PBGA 设计过程        7( g1 R4 s0 T. ^9 I- ?: b
1.1        新建.mcm设计文件        7
9 o* O" G- b' Y* n6 [: D" r1.2        导入芯片文件        8
( O  p+ \2 L$ i1.3        生成BGA的footprint        13
4 }+ _9 q$ p$ U+ h3 \; _* I1.4        编辑BGA的footprint        17
. [& m8 t* d+ `6 u- r1.5        设置叠层Cross-Section        20
0 r; ?% V0 M! t1.6        设置nets颜色        216 @6 b' F) w3 V; J- ^. @
1.7        定义差分对        22
' u' d" ?% O+ p6 ~' g  j3 ^) j; x: ^1.8        标识电源网络        23' x' v+ p* R- l" Q4 R8 c1 k% h
1.9        定义电源/地环        24
7 C. S8 j8 E) ]% _1.10        设置wire bond导向线WB_GUIDE_LINE        27& z' X  f" E9 @9 z; w& U' B+ U3 v
1.11        设置wire bond 参数        30
4 {; }( A8 u) F8 g: c  o1 E& W7 b& Z( b1.12        添加金线 wirebond add        34
$ e8 k' @: U: v9 F+ b0 ]: _1.13        编辑bonding wire        36
6 y% J  c+ O( E/ H3 L1 e( A1.14        BGA附网络assign nets        388 F5 _0 M( T9 n# `+ W, L
1.15        网络交换Pin swap        421 p, b8 R2 L% e3 E* `- ?& ?: f
1.16        创建过孔        44
& g" @3 v0 ]) o, _' K1.17        定义设计规则        461 }* e" }5 J/ G) M9 ~  |
1.18        基板布线layout        49$ W6 L2 S' ~# P
1.19        铺电源\地平面power/ground plane        51
7 W" l2 [; M- K" V& p1.20        调整关键信号布线diff        53$ v( x' f1 A: F6 ]
1.21        添加Molding gate和DA fiducial mark        56
7 E) `: j0 v# }( }7 r6 C1 y. `1.22        添加电镀线plating bar        58
. E1 [/ o( i9 d3 W+ k1.23        添加放气孔degas void        62
5 w, J& K- q, W- R& V' E1.24        创建阻焊开窗creating solder mask        64
8 \" w& _, x2 I/ Y1.25        最终检查check        67
* T' _  t. ]; ^' C! l6 S6 r1.26        出制造文件gerber        68
5 l! K; V1 {6 K8 {" [' L4 d1.27        制造文件检查gerber check        72( P6 d1 h5 @- c' {7 s% Y
1.28        基板加工文件        74
( {7 ?: B7 Z" |5 t1 {" P1.29        封装加工文件        75# J  i, F. M5 Y9 `

. W6 v3 e* o7 y: {1        第7章 pbga assembly process        7
4 P) x1 \7 L1 c1.1        Wafer Grinding(晶圆研磨)        7
* m+ S1 B4 v' Q3 A1.2        Wafer Sawing(晶圆切割)        96 _" ^( d6 d; U/ F
1.2.1        Wafer Mounting(晶圆贴片)        105 A. g$ h9 s6 _
1.2.2        Wafer Sawing(晶圆切割)        10
, |0 ]8 Z  I3 c% l0 Y3 D1.2.3        UV Illumination(紫外光照射)        11
! p' q! H% x/ U9 f) U1.3        Substrate Pre-bake(基板预烘烤)        11: ?% e  x, z; J- c
1.4        Die Attach(芯片贴装)        12
5 s* X# ~6 n, T, Z5 n' B1.5        Epoxy Cure(银胶烘烤)        14
; Y0 F2 w8 n3 d1 e: ]' N1.6        Plasma Clean (电浆清洗Before WB)        14
! T3 p3 D7 S2 x* K+ R" n$ a* a1.7        Wire Bond(金丝球焊)        150 n! g0 v* _4 ^- E; A
1.8        Plasma Clean (电浆清洗Before Molding)        17
) P& M9 {% \4 z1 [) S- K1.9        Molding(塑封)        18
) V, O' I, A- s1.10        Post Mold Cure (塑封后烘烤)        19# B. V6 a  g5 L
1.11        Marking(打印)        20$ u2 u" q4 d* J, O& v
1.12        Ball Mount(置球)        22' [4 g- @( K5 f' l) B1 X' Q& D( Q
1.13        Singulation(切单)        22
# v, |3 i, q( K1 K& @& L  H6 d7 M1.14        Inspection(检查)        238 L8 g' [, s, ~0 l" K% S* a
1.15        Testing(测试)        24
" S# S) \3 v. q2 O1.16        Packaging & Shipping(包装出货)        258 x9 \8 J- K9 f
# @9 S, p* G3 E9 E6 l/ H
1        第6章 SIP封装设计        8( w" D/ O; x" ]4 H
1.1        SIP Design 流程        9, @1 {5 Y% H6 O& ^( s' p3 }
1.2        Substrate Design Rule        11; z; Y: }6 @8 A! ~, J
1.3        Assembly rule        14! ]* d! ]6 u( K. S' j
1.4        多die导入及操作        16) Y) j. c) R# M& d% J# c2 _. w
1.4.1        创建芯片        16
- ^3 J0 {0 m' S' j9 x- w3 ~1.4.2        创建原理图        34: o- r; B0 O, B, a! C5 X
1.4.3        设置SIP环境,封装叠层        36/ Z# b; @1 {" e
1.4.4        导入原理图数据        42% }- q4 y# B6 r3 \7 [! `0 G' n
1.4.5        分配芯片层别及封装结构        46% y% }" }  R/ e4 K
1.4.6        放置各芯片具体位置        49  f6 e9 O- h* W
1.5        power/gnd ring        45  [8 O1 P  `# D( w3 J- o' X
1.6        Wire bond Create and edit        59
- `% S5 S1 C, p1.7        Design a Differential Pair        685 f4 y7 o3 S- C& d, @
1.8        Power Split        73
0 Y( a) d3 e, ?& S% s- d5 {$ X1.9        Plating Bar        783 u1 s: j( y5 J9 b
1.10        八层芯片叠层        83
# [9 Z2 G4 n, u, f1.11        Gerber file/option        831 w$ k4 x$ F. k' b; m. i
1.12        封装加工文件输出        91; q! y( @, D- ^+ C7 t5 O
1.13        SIP加工流程及每步说明        1005 ?% \# Z3 K0 Q. F! j& }
1        第7章 FC-PBGA联合设计        7
" d( X$ Z5 D/ r% C1.1        高PIN数FC-PBGA封装基础知识        75 ?+ Y7 m7 U# N
1.1.1        高PIN数FC-PBGA封装外形        7/ o' p7 R* {2 a$ Y$ h' B7 E
1.1.2        高PIN数FC-PBGA封装截面图        7
- v+ U; q  b9 @# p1.1.3        Wafer        8
  u  L) O) U" N: P  p$ r! D6 C1.1.4        Die/Scribe Lines        8
1 e4 ?( X! G! F, F) W4 R1.1.5        MPW(Multi Project Wafer)        8
; B3 H4 `! g# [; ]5 F1.1.6        BUMP(芯片上的焊球)        9
  S- o# `$ U8 ]/ {  l0 ^. o+ X1.1.7        Ball(封装上的焊球)        9
2 k1 T7 P$ }4 X1.1.8        RDL        10
4 M6 `$ d* X# ]% M& g1.1.9        SMD VS NSMD        11. f$ F( v3 P) L0 L1 b
1.1.10        FlipChip到PCB的链路        12
& C! D! s# W& [" d1 a) @/ a1.2        封装选型        12
& W* V$ p  |1 H" ^: E& z2 x1.2.1        封装选型涉及因素        12
+ r. e3 k& d( a6 t# L1.3        CO-Design        148 ]: ?' C. r$ b/ Z, ^0 W9 }
1.4        Vendor推荐co-design的流程        143 Z6 V+ I+ H, u5 l
1.4.1        Cadence的CO-design示意图        15! H" m  W# ^; a; K! R
1.5        实际工程设计中的Co-Design流程        16
1 r2 z% |; V7 m. h; p. m3 \1.5.1        Floorplan阶段        18$ {7 y0 ^' ?& j3 p6 y
1.6        FLIPCHIP设计例子        29
5 h$ t# k5 x0 e$ ~! @1.6.1        材料设置        29* ?2 ?! H. r: E& K! J
1.6.2        Pad_Via定义:        32+ k$ \8 H/ Q3 v% Q# ?4 ~+ j
1.6.3        Die 输入文件介绍        34
; r; {6 q8 B2 g$ r+ I$ y1.7        Die与BGA的生成处理        34& `8 w7 @/ X# _# r& M5 N
1.7.1        Die的导入与生成        34! W& d1 R" P* U+ C2 G9 \+ y
1.7.2        BGA生成及修改        389 c. d/ U  v  @, o& ]& a  a6 w- s
1.7.3        BGA焊球网络分配        44
) R; Z; l! |0 L2 A' Z. \) u1.7.4        通过EXCEL表格进行的PINMAP        47
( I+ Z: ], R% L# Y- ~1.7.5        BGA中部分PIN网络整体右移四列例子        488 J6 n) q/ T+ E2 S' T
1.7.6        规则定义        51
: `9 X3 V- `) y1.7.7        差分线自动生成方法2        582 y, r% b9 h# {4 Y) t  S
1.7.8        基板Layout        58; v- f& e7 `) \
1.8        光绘输出        64
4 ^6 H# `" B4 K9 \/ _1        第8章 封装链路无源测试        5( o( D& ~# J5 W
1.1        基板链路测试        52 I0 {4 y& f8 j8 T3 D" {6 H
1.2        测量仪器        5
  v) `: d# Q8 @! _1.3        测量例子        5
) _! w* F+ r: G6 z' Q4 m! n4 C) j7 e1.4        没有SMA头的测试        7
. ?9 W3 i; }- U9 @0 L* E1        第9章  封装设计自开发辅助工具        5! U1 f, t3 E+ C4 G
1.1        软件免责声明        54 v0 j! L% X1 \' C! z; x
1.2        Excel 表格PINMAP转入APD        6
1 q+ D( s: Q8 ]( ?/ D1.2.1        程序说明        6% p! w( t/ j* }# b
1.2.2        软件操作        7$ t' l. [  N5 ]
1.2.3        问题与解决        13
9 \; @' p. G4 s1.3        Excel PINMAP任意角度翻转及生成PIN NET格式        14
# i/ W) i% Q6 ]7 w/ d7 }! M1.3.1        程序说明        14
4 A. D! I5 c9 Q# X4 [1.3.2        软件操作        14
8 C1 [6 R  I! Y- a0 e1.3.3        问题与解决        18
* {+ S/ I7 _+ s$ c$ m1.4        把PIN NET格式的文件转为的Excel PINMAP形式        18- g9 D+ G8 S. Z1 @
1.4.1        程序说明        18
2 @0 I$ b/ P# p3 f2 K2 \1.4.2        软件操作        19
2 z+ ^' B, E7 e  S( ]1.4.3        问题与解决        20
- t( W2 U7 n3 p
 楼主| 发表于 2014-7-18 12:18 | 显示全部楼层
大家对书中的内容有疑问的话请在 IC封装设计与仿真版块 留言即可
# Q0 w. O) |6 p8 z

五级会员(50)

Rank: 5

发表于 2014-7-18 15:04 | 显示全部楼层
支持阿毛!感觉转行一路漫长!
发表于 2014-7-18 16:14 | 显示全部楼层
支持!自己也要多涨些知识。明天入手一本

七级会员(70)

CAD工程师

Rank: 7Rank: 7Rank: 7

发表于 2014-7-18 16:24 | 显示全部楼层
恭喜出版新书
专业服务:(价格面议)
代写作业
拉等长
调丝印
喂猪
欺负同学
打老师

三级会员(30)

Rank: 3Rank: 3Rank: 3

发表于 2014-7-19 08:18 | 显示全部楼层
谢谢把经验分享出来

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

发表于 2014-7-19 13:13 | 显示全部楼层
恭喜,要学习,入手一本~

三级会员(30)

Rank: 3Rank: 3Rank: 3

发表于 2014-7-22 08:42 | 显示全部楼层
毛总:新书已收到,感谢辛苦奉献  自我查漏补缺中......

五级会员(50)

Rank: 5

发表于 2014-7-22 09:07 | 显示全部楼层
毛大师:请问您的封装宝典是基于什么LAY软件做的,每个EDA软件都是不一样的做法啊,我是没整明白,还是通用的,或是仅仅是封装的介绍?您解释扫盲一下好吗?谢谢!

二级会员(20)

Rank: 2Rank: 2

发表于 2014-7-24 17:01 | 显示全部楼层
本帖最后由 总统2 于 2014-7-25 08:42 编辑 & C6 y! h" v- s# n1 p/ z' U3 l3 F

( \' d1 C8 ~  j# n, l- N7 |( C支持大神!!!想问一下,这本书适合才工作的小白吗?怕太高深看不懂!!!

三级会员(30)

Rank: 3Rank: 3Rank: 3

发表于 2014-7-25 11:20 | 显示全部楼层
出新书,恭喜了
, }/ Q5 Z/ [  t支持。

四级会员(40)

Rank: 4Rank: 4Rank: 4Rank: 4

发表于 2014-7-25 11:46 | 显示全部楼层
书里面有没有光盘,盘子里有没有做的标准库,要是整个中国都只用一种库标准就好了,就没那么多麻烦事,要是能放些SI的库进去就最好了?
 楼主| 发表于 2014-7-25 16:08 | 显示全部楼层
总统2 发表于 2014-7-24 17:017 x5 w: C! r8 j" ~* i: E: ]5 X3 K
支持大神!!!想问一下,这本书适合才工作的小白吗?怕太高深看不懂!!!
& H; a* M* G- Z% }2 ]. L- {
至少目前在市面上不会有比这本更适合的了

三级会员(30)

Rank: 3Rank: 3Rank: 3

发表于 2014-8-1 16:58 | 显示全部楼层
好东西,到时入手一本看看
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号 )

GMT+8, 2019-6-24 21:20 , Processed in 0.093750 second(s), 29 queries , Gzip On.

深圳市电巢科技有限公司

地址:深圳市南山区科技生态园1区2栋A座805 电话:19925233282

快速回复 返回顶部 返回列表