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Cadence Allegro论坛今日: 0|主题: 34045|排名: 7

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负片覆铜不能自动避让 1人参与	dds0201 2012-10-5 21:45	1 950	dds0201 2012-10-5 22:43
原理图上出现两个GND 6人参与	kaichen 2012-10-5 12:39	6 1143	wwddss_1976 2012-10-5 21:58
谁有DS96F174的IBIS模型呀	twffwt 2012-10-5 10:34	0 610	twffwt 2012-10-5 10:34
请教一个特殊封转的焊盘制作中的问题 2人参与	kaichen 2012-9-26 23:21	2 756	kaichen 2012-10-4 17:06
请教：BGA封装在top层，封装内能不能走线啊，会不会造成短路之类的？ 2人参与	wzwang2000 2012-10-2 18:38	6 1076	wzwang2000 2012-10-4 11:18
allgero brd文件如何解除锁定 2人参与	liuzcvictor 2012-9-29 18:04	2 1352	_new 2012-10-4 09:29
Cadence16.5设计焊盘时无法改变页面尺寸 4人参与	devil143 2012-9-20 10:21	4 1078	jsks 2012-10-3 22:08
BGA芯片滤波电容放置问题 9人参与	dgwq 2012-9-22 09:30	9 1693	twffwt 2012-10-3 15:18
大家讨论下如何确定走线的宽度 4人参与	twffwt 2012-10-1 21:54	4 975	twffwt 2012-10-3 12:33
cadence画原理图芯片引脚可以名称相同吗 7人参与	yu7622 2012-9-13 08:55	7 4059	freebean 2012-10-3 03:34
allegro中没有任何操作，鼠标默认route命令，怎么改设置 2人参与	Annliar 2012-7-1 13:09	3 1060	匿名 2012-10-2 23:03
制作标准封装的 LP viewer 10.3 全新升级 20人参与	joejoerex 2011-5-19 15:17	6 3295	chainwell 2012-10-2 09:57
Allegro PCB Designer 16.6 19人参与 ...2	penny190 2012-9-26 13:56	19 2376	suiwinder 2012-10-1 02:15
allergo製作封裝操作問題	bgod1986414 2012-9-30 00:17	0 954	bgod1986414 2012-9-30 00:17
求救！总版主！ 2人参与 - [阅读权限 50]	lf526 2012-9-29 18:02	2 21	lf526 2012-9-29 23:26
评审总结	李秀芳 2012-9-29 15:59	0 934	李秀芳 2012-9-29 15:59
差分线的间距在哪里设置啊 5人参与	hjjyyp123 2012-9-25 10:17	6 1406	香雪海 2012-9-29 15:20
Allegro导入器件时遇到的怪问题 6人参与	nishiyufrank 2012-9-19 14:30	9 1375	hejiabei77 2012-9-29 14:50
启动程序时勾选了“use as defalt",复选框没有，怎么恢复？ 2人参与	ricky_ren 2012-9-29 09:26	2 720	ricky_ren 2012-9-29 14:20
求助铜皮操作出错的解决办法 8人参与 - [悬赏 4 金币]	dgwq 2012-9-28 10:36	13 3241	ruiquan765 2012-9-29 13:35
求救，版主！！！ - [阅读权限 200]	lf526 2012-9-29 11:23	0 6	lf526 2012-9-29 11:23
ALLEGRO16.5 PCB ROUTOR的问题 5人参与	feiyue08 2012-8-2 11:10	5 1445	爱我的人 2012-9-29 09:32
Allegro16.5出gerber的问题 3人参与	xidgli 2012-9-28 09:46	3 1085	hejiabei77 2012-9-29 09:00
非常急，求助。 1人参与	86232648 2012-9-29 07:56	1 770	hejiabei77 2012-9-29 08:54
没有勾选框，求助 3人参与	NMDNBA 2012-9-26 08:52	5 1152	NMDNBA 2012-9-29 08:21