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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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1#
发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准& W0 Z4 z- T* N
哪位大师可以给参考资料
5 a) \2 H8 u, Q2 D- O

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推荐
发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:024 B+ g- b2 i. O
我公司的某PCBA 发到 I....公司做测试。
5 ^# r) H, Z2 o( O0 H2 U他们反馈的信息是.
" m! ?- Q8 U8 d8 G* I: `# N! [--Find a problem during return loss tes ...
* I: B  C5 u9 w+ a0 T3 A& H: ^
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?5 h% N1 H" N6 m; x" H
Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
# M) w) Y' Q% }" A- b; P8 Z$ M* F
- J, c1 [. B4 s: {* L$ g# {4 @+ X2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!8 r+ X; ], g0 y- R- f1 R4 s4 @
RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。5 n! A! R" S3 a  M& @4 I

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4#
发表于 2014-11-22 09:36 | 只看该作者
先参考协议
; V' n  @# a5 ^4 Z4 N2 x再根据走线长度来定,关键还是接收端可接受level

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5#
 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36! k6 F( T3 E4 z/ h, {
先参考协议5 a( u# I3 }5 c1 Q1 }
再根据走线长度来定,关键还是接收端可接受level
# F% n8 Z6 i( J6 Y" D
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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6#
发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08, ~" z! D+ \3 z/ q) f' Y; B
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...

: S0 F& S/ n: V/ q2 Y6 u因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。/ r. H$ [% q1 c; b

点评

那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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7#
 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
5 f( H2 ]7 @( p0 ?) Y" M因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
' h9 O* N8 }1 k6 \% V* z
我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况) R: o) v( B8 L* ~4 L

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8#
发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
; X2 [2 K6 N5 w8 l0 _9 H+ [: u& e因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

- \- O& x" t: j那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
8 b7 g* S) R- i& X6 P# {

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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9#
发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:36
: G& f) J4 N8 [1 |  ]$ X1 j那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
' K2 V  h. x9 ~3 f2 Q" I
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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10#
发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:326 _% z5 i8 N) ^! d1 D. M; _
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

# n) A6 `: }( O% }" R" f# B% D, w/ x我公司的某PCBA 发到 I....公司做测试。: Q6 ]5 B+ b5 ]$ Y6 w
他们反馈的信息是.
0 O% t4 t+ Z8 }& e; _--Find a problem during return loss test on T..3 connectors. ' _! r$ M; p0 f2 e9 D
此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。
6 F( q7 h8 X; G9 O我的问题是:2 d( o2 N7 t" j
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?/ n& ?4 z( W3 p8 J, |- P4 I3 r4 M4 M
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
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! V8 r5 ?8 K; a+ n& r" ?" S' D
& x' A" J5 P) D2 c# \; r
( D: D# P* P# x0 b* k) H

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10

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12#
发表于 2021-9-17 11:18 | 只看该作者
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