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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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1#
发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准+ w' U( l" P* O* [0 {3 J
哪位大师可以给参考资料# s( \' R; z: |, o) r6 X, d

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推荐
发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02
8 X6 i$ N# ]9 t4 e我公司的某PCBA 发到 I....公司做测试。; \$ u6 i" s% s* `5 [+ {  C- d
他们反馈的信息是. 1 Z+ p4 q# ~5 G" I" M$ r5 ]
--Find a problem during return loss tes ...

% `8 b. \! R  \* O9 x( O4 k! y3 n1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
* |# I* h4 X! ?4 u# T0 S+ P, HReturn Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。3 r7 i3 O0 t6 G  C, X! l

1 X6 j# S6 W  d# e/ Q! ~6 `1 `2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!* N9 b! X0 O6 c
RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。
, d2 I) u  w; b9 K4 Y6 A

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4#
发表于 2014-11-22 09:36 | 只看该作者
先参考协议% _, m6 M" _# k) u9 n- N  V
再根据走线长度来定,关键还是接收端可接受level

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5#
 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36
, Y* e/ r- Y& x/ N- v1 t; G, q先参考协议
! C' D; k9 Y( W- D, E$ f4 Q再根据走线长度来定,关键还是接收端可接受level

$ g/ l$ `' P. _  ?# J- D虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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6#
发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08
. \+ s+ u$ l3 M% W8 Q* P虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
' L- {6 h" }6 N6 N5 Q* K9 p& }
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。( X. m+ U) V3 P: D) F! i0 A

点评

那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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7#
 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:030 n% r  B# P4 Y9 q% |3 I& X
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

# S5 g" x, e/ a$ F  U8 Q9 c. I我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况5 ~0 W& W, R: ?, T0 _; G1 e( {

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8#
发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03  I4 K( N9 k, f' f
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
# Q  T# j: ^8 ]: Y9 G
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?+ a+ T, A7 [$ p2 d5 A

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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9#
发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:36! ?' {$ m+ M2 `! @* |( n8 c' C3 E" D' E
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?

$ N1 V7 \0 c( A% H; t建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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10#
发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:327 B3 ]3 D  C* \6 C
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

2 p& C+ J" B( z9 i" E8 d) |7 c% V我公司的某PCBA 发到 I....公司做测试。- X# O* P, Y0 I- D
他们反馈的信息是. / l# L; f) q/ E5 N6 Z# O% b2 {
--Find a problem during return loss test on T..3 connectors.
) U: ^" y( s3 F$ q* w此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。
9 }( M) K2 K2 B, Y2 M. n9 n) N7 X我的问题是:
" Q9 }- p+ g& k7 f/ t9 s1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?9 s% X# V0 J. b
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!8 F% v. P5 n$ F: L( d8 \
* C( w1 \1 I% @0 R; w* d

0 @0 Y# T: B' a% r$ H& z9 j7 ?+ y: W3 x8 e$ ~1 Z: p5 T' t5 ^

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10

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12#
发表于 2021-9-17 11:18 | 只看该作者
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