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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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1#
发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准
! x. T# Y) ]$ M" O; _+ @哪位大师可以给参考资料
: ^; T2 R: a, M( a$ C/ R- P& F

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推荐
发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02  b6 t2 Q+ L! v" G  o) w- t
我公司的某PCBA 发到 I....公司做测试。
+ B. j% i/ c9 }  m" w: b7 W他们反馈的信息是.
  H5 [! S5 y* F! `--Find a problem during return loss tes ...
0 k- V, s( w7 x" w+ W& E$ F
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?) {( d5 g* ~: j9 B8 `
Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
8 p; c5 a1 e8 S+ A% l5 X& v5 R' p
' A5 O! d; o. _+ u- T! A& P$ D2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!8 O# I4 V' D4 s8 L3 B6 G
RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。7 v" F. h8 N" f

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4#
发表于 2014-11-22 09:36 | 只看该作者
先参考协议* E. b+ k2 i% k9 G% Q
再根据走线长度来定,关键还是接收端可接受level

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5#
 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36& U0 g4 Z, L! H/ J2 |* I
先参考协议: M  h' e5 X. n
再根据走线长度来定,关键还是接收端可接受level
9 V. S" C8 v% f/ F# `( f9 q7 m
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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6#
发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08  V5 Y3 Q9 V+ U+ @! l6 Y. g
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...

: ]" e; I- q1 z& k# K因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。
$ p$ e9 Z2 t/ R7 H

点评

那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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7#
 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03) [9 o4 s5 X1 j4 I8 O9 E' x2 w0 s
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
: S' ]8 L- [" V+ E9 H' Q
我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况6 [  f, ^- t* S4 p4 a' A. D4 O' H

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8#
发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03% Z0 x- W, y1 B" H3 Y
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

. w' r: D2 Q/ D3 C6 X  j. _% g6 h那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?; l" X0 d7 E  j  g

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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9#
发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:366 m0 p" J' k2 C7 L. q6 G: @6 J
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?

3 _3 T9 z/ w" t" E! _4 W建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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10#
发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:325 w: b- E. p3 J2 z" ~
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

  {1 [; z8 A' S- P4 O0 d" Y9 T8 _我公司的某PCBA 发到 I....公司做测试。) A  J: @3 j+ x" m% @  W/ D
他们反馈的信息是.
  s3 j+ U( m& [0 ]1 w1 b: ^% Z! T--Find a problem during return loss test on T..3 connectors.
5 W/ ^( C3 L( z此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。
6 F. K$ X9 m3 v  e0 q0 y5 A我的问题是:
7 j4 {/ }* A6 B  H1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?% S- ~; Z. D/ `! x
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
; z( R. v- N, a, @; m# q5 C* _! O$ v
& P/ Q# o8 y# O9 G1 w
+ W9 @+ m* J5 U
. Z, |: s( Q) G8 M) Y. G! a

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10

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12#
发表于 2021-9-17 11:18 | 只看该作者
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