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[仿真讨论] 求教! 关于信号时序仿真方法

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1#
发表于 2015-4-14 21:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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时序仿真这块本人还没有找到可靠的方法,有没有大神可以指导下 谢谢" F% v" D/ h; Y% W

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2#
发表于 2015-4-15 08:46 | 只看该作者
https://www.eda365.com/thread-106576-1-1.html
1 c' {- k+ {, j
& m" ]% F1 ?; A- b; V你是仿真什么的时序,上面的链接里有个timing的report。你先看看。

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3#
发表于 2015-4-15 08:48 | 只看该作者
最早的QSI
; j/ m9 V2 J! i# o现在还有sigrity的SystemSI,hyperlynx的DDRx wizard,ansys designer的DDR template,ADS的DDR design kit。/ i: C. ^* U& S8 v$ J% w
可靠性主要取决于主动器件模型,被动参数目前来讲已经比较成熟了。  o) P& [8 b3 x( b5 I0 w
目前来讲保留5%的设计裕量即可满足测试匹配度。
. `7 W- u& d$ _8 ^6 T& Y

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4#
 楼主| 发表于 2015-4-15 09:49 | 只看该作者
目前主要仿真DDR的时序

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5#
发表于 2015-4-15 09:52 | 只看该作者
DDR还分SDRAM 1,2,3,4 呢。

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6#
 楼主| 发表于 2015-4-15 10:27 | 只看该作者
先把方法掌握 后面的可以慢慢摸索
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