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铺铜问题~求助

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1#
发表于 2015-6-10 11:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
2 W) i2 n8 f9 r6 m
为什么会有这样的错误(是动态铜了)?下面是drc
! F2 t7 j: ~; h( Z4 S& {1 o& xhttps://www.eda365.com/forum.php? ... mp;extra=#pid911826& }/ e' S$ [6 ^2 k8 ]

) w" ?5 M0 Z5 c/ N: J
9 H" X3 F* V, _/ f4 f5 d5 e. r! C' {. q- j* @' I) a
' v  p* ~( L/ Q9 @: O; |2 e% h
LISTING: 1 element(s), {# @4 U" j/ _$ y2 L

) s; G; b1 F1 E. H4 m- _           < DRC ERROR >1 Z+ W9 J1 K& s5 _4 M
5 Q" {* B$ A. B) @9 d# O1 y
  Class:           DRC ERROR CLASS
0 j) Z: N0 K9 |- ]6 N& C/ [7 j  Subclass:        TOP
9 w7 @' \0 k" o8 }  Origin xy:       (2096.00 2275.00)
  s& Y/ j6 q; m/ [* f! j5 l  Constraint:      Line to Shape Spacing& ], V: V! y+ e
  Constraint Set:  DEFAULT9 m1 D; H$ M) x/ I
  Constraint Type: NET SPACING CONSTRAINTS+ m& s5 u, C; n0 e! _5 }9 G

! [+ E! X8 N+ w, o* c5 j  Constraint value: 10 MIL
- y# a8 X3 ^( I& v  Actual value:     0 MIL
' \3 x: b5 C; h. H/ L
# n( H9 u9 p+ H& E2 k! s, V, P  - - - - - - - - - - - - - - - - - - - -6 t; c  p/ `3 ]. U. M
  Element type:    SHAPE4 c7 z. Y! d! ~
  Class:           ETCH
; i0 s) H  [# Q% o, o, S- t4 P  Subclass:        TOP
! l% w8 j& k2 M: Q7 T3 G4 s0 u; }2 g' G8 ?6 D8 M8 c
  On a Dummy Net& u0 _! P6 o# X
* x& X8 b) {' e* t* M. d  J- a) S$ _
  - - - - - - - - - - - - - - - - - - - -
2 V$ N, j8 J1 Z& Q( A  Element type:    HORIZONTAL LINE SEGMENT5 ?/ Q7 K0 X4 A# E7 ]# ?" w
  Class:           ETCH
9 R$ ^: ~. e3 V+ k1 {7 i0 X  Subclass:        TOP
7 n6 y1 A" S8 _/ b- m6 \; |% P! r0 R% j: |% p
  part of a connect line% [; y5 o( J% m3 w; c( q. B
  Part of net name: TXD- ?7 e$ }0 a; h* P1 z/ A6 e
( ]) x; @: A* @
segment:xy (2096.00 2275.00) xy (2203.00 2275.00) width (10.00)
$ ^  @( K6 ?* C' s
. R& o, E. w+ J$ l0 w

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发表于 2015-6-17 09:24 | 只看该作者
dzkcool 发表于 2015-6-16 13:201 p; C1 A9 y# k8 c; ^# i2 `( b
你这跟楼主不是同一回事啊,确定走线的网络跟管脚是同一个吗?

! ~# R" W2 [4 X1 O; P5 e谢谢杜老师提示,网络跟管脚不是同一个。我走线的时候,忘记勾选find内的pin选项了。) Z7 ~5 M- j* L2 ?5 q8 q6 c
应该是在top层走了一段连接线,所以报错。
1 O  A: ]9 O" H1 g, y勾选上pin选项,就没有错了,问题解决。
9 z- j& D9 u# f
9 }$ ^6 t  y) {  {) O5 h

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解决了就好  详情 回复 发表于 2015-6-18 14:36

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发表于 2015-6-16 13:15 | 只看该作者
Aiby2015 发表于 2015-6-16 10:38( X1 e5 d1 G0 f9 F  n+ v: Y
可以了吗?
% `, `3 U& {7 [& Y& s
没有解决。
- b. a' N. a9 Y/ U我的是在top 层出现的Line to SMD Pin Spacing 的DRC error1 N* }) D1 K$ A5 ?( v
应该是我哪里弄错了。) B+ n7 a$ ~7 K3 W! G% j0 N
6 }9 s0 v: D/ ^3 x. U
4 y/ H" P2 K; k3 [+ i7 n  K

: t, s' |" F# f( j4 h9 u1 R/ i( p
  • TA的每日心情

    2020-7-21 15:38
  • 签到天数: 21 天

    [LV.4]偶尔看看III

    推荐
    发表于 2015-6-10 11:19 | 只看该作者
    本帖最后由 kinglangji 于 2015-6-10 11:21 编辑 ) @4 U7 j" {, x" d) y5 W/ ^6 e
    Aiby2015 发表于 2015-6-10 11:06
    7 C' s! E4 H9 D. C& [+ jallegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    3 N1 J! P9 V) e2 H7 E  \3 N。。。。。。。貌似这样好像不出drc。。2 Y, |2 Q8 A& j7 Z2 F

    捕获.JPG (60.37 KB, 下载次数: 6)

    捕获.JPG

    点评

    [attachimg]98046[/attachimg] 然而并没有什么*用~~~  详情 回复 发表于 2015-6-10 12:20

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    2#
     楼主| 发表于 2015-6-10 11:06 | 只看该作者
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    点评

    。。。。。。。  详情 回复 发表于 2015-6-10 11:19

    该用户从未签到

    4#
     楼主| 发表于 2015-6-10 11:49 来自手机 | 只看该作者
    好 我试试看

    该用户从未签到

    5#
     楼主| 发表于 2015-6-10 12:20 | 只看该作者
    kinglangji 发表于 2015-6-10 11:198 @' z% v% j2 r, L7 R
    。。。。。。。貌似这样好像不出drc。。
    1 \$ R# G+ S* p3 Z. q9 t
    : m8 z- E8 O2 Y, @; z( [8 G
    然而并没有什么*用~~~
    ; R+ B0 e4 p( A2 X

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    7#
    发表于 2015-6-15 09:51 | 只看该作者
    我遇到了类似的问题,查看的约束管理器,觉得里面设置是对的。5 U& e) K& ?. W# E# a3 s! F
    同求答案。

    点评

    我的解决了 不知道您的是不是?  详情 回复 发表于 2015-6-15 20:06
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    8#
    发表于 2015-6-15 13:23 | 只看该作者
    不行就上传文件

    点评

    感谢杜老师私下热心 指导  详情 回复 发表于 2015-6-15 20:07
    好了  详情 回复 发表于 2015-6-15 20:02

    该用户从未签到

    9#
     楼主| 发表于 2015-6-15 20:02 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23. [. D$ u) W6 F8 @; O( i8 [' n) r& {* T
    不行就上传文件

    ' c% x0 [- @' r4 Q$ B好了 % [1 {/ s7 {8 Y& A
    3 ], E5 B9 M' w: ]" Q

    该用户从未签到

    10#
     楼主| 发表于 2015-6-15 20:05 | 只看该作者
    % {4 o6 @2 C; _* E. B0 I. W. T
    我犯了低级错误,负片敷铜!, D& @; \% X* Y6 M7 l2 S* D: _) L

    该用户从未签到

    11#
     楼主| 发表于 2015-6-15 20:06 | 只看该作者
    3dworld 发表于 2015-6-15 09:51% F2 E' R5 f; W9 U5 z8 d
    我遇到了类似的问题,查看的约束管理器,觉得里面设置是对的。: i$ l- l& ?' C
    同求答案。
    ' N4 w$ U# c& e. b$ O! r
    我的解决了 不知道您的是不是?
    3 _) e% B& B6 j! w) g& r

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    我去试试看, 负片不能普通吗? 在创建铜皮的时候,不是通常给负片Power层指定网络吗?  详情 回复 发表于 2015-6-16 09:37

    该用户从未签到

    12#
     楼主| 发表于 2015-6-15 20:07 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23+ j3 P/ q1 [$ I: h' J$ P  n  v4 |
    不行就上传文件
    9 [$ N, v8 x6 J5 h
    感谢杜老师私下热心 指导
    ; x3 j+ R% B% l9 D+ o

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    14#
    发表于 2015-6-16 09:37 | 只看该作者
    Aiby2015 发表于 2015-6-15 20:06
    # [. R/ V9 [# c( c+ J我的解决了 不知道您的是不是?
    / l$ a( Q7 \3 S; z/ _# }
    我去试试看,: e, r* O2 r1 u) E, I  u
    负片不能普通吗?
    3 z3 H- @2 I# E! E在创建铜皮的时候,不是通常给负片Power层指定网络吗?% G  `" v& k+ @( R6 p" v( @0 T+ e

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    可以了吗?  详情 回复 发表于 2015-6-16 10:38
    楼主是把表底层设置成了负片。  详情 回复 发表于 2015-6-16 10:32
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    15#
    发表于 2015-6-16 10:32 | 只看该作者
    3dworld 发表于 2015-6-16 09:37/ j$ o0 W# @* V; n- i
    我去试试看,
    $ V; v& A" G# P* A% ^  R' z负片不能普通吗?
    8 {2 p" h/ c3 B8 m/ _在创建铜皮的时候,不是通常给负片Power层指定网络吗?
    + D* y* n; y) e$ m6 n7 T
    楼主是把表底层设置成了负片。7 ?1 D3 I% g! q
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