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铺铜问题~求助

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1#
发表于 2015-6-10 11:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

/ i! z/ I+ B2 m) X' b' m+ Y为什么会有这样的错误(是动态铜了)?下面是drc  ?1 I: r* g: p) v- `
https://www.eda365.com/forum.php? ... mp;extra=#pid911826: z* m- j1 v- C, p0 S# s

. f7 r5 M* l9 i& t5 d1 y& T8 \4 C8 g$ M

) B/ s; K4 j  A) p$ x7 J
5 @9 \2 Z* W7 ALISTING: 1 element(s)
. }9 H2 K: H  {
" ^  S3 q1 a: l2 H! r, n' G           < DRC ERROR >0 X" r5 I% N, v7 I
7 F. o5 M) M* |8 L4 r* z
  Class:           DRC ERROR CLASS. c' Z: k* d& V' P2 _
  Subclass:        TOP
+ W+ @% ~  t- T4 l' N1 E  Origin xy:       (2096.00 2275.00)
, O9 z9 g+ I" V3 P" [2 ]& L  Constraint:      Line to Shape Spacing  q& b' i* a# Z6 D: }! Z4 E& w
  Constraint Set:  DEFAULT7 K. D5 d( C& O" p
  Constraint Type: NET SPACING CONSTRAINTS& u9 i" F) D; B) h6 x9 o/ M
; K9 ]$ M" K* l0 W$ ~0 K; Y
  Constraint value: 10 MIL# M' n4 Z" x4 w7 A3 C3 r
  Actual value:     0 MIL: [! j; D' N! u" N* `& ^( O. y
6 W0 Z7 V. ^: c# y5 e  [; s
  - - - - - - - - - - - - - - - - - - - -
, I3 C9 x. T: [2 ]% N, b2 Z  Element type:    SHAPE
$ t# X$ @& d( Y; c9 e  Class:           ETCH3 J  G2 ?3 V! |7 m& g. z9 L& T# o
  Subclass:        TOP( P, e; G) s; y2 R% X/ m
, x2 ^% i* q) r8 o7 B4 t9 P
  On a Dummy Net
4 a& h, B: S' c6 e- G0 Z# h" T1 Y) D( D3 u) T, v
  - - - - - - - - - - - - - - - - - - - -6 ]# c6 }' T: G; y5 L7 X
  Element type:    HORIZONTAL LINE SEGMENT, b( L( b8 }. |4 K5 n% j9 c8 p
  Class:           ETCH
- F" `: g6 }& s, h" d: ~- g  Subclass:        TOP
) u0 k+ y' e- L% X, S( b1 Y5 M# L: \" E9 S
  part of a connect line) H4 k* V5 j2 d
  Part of net name: TXD
# L8 d+ A" B( n4 T- H  I7 i
2 [/ V( l- H5 a/ Jsegment:xy (2096.00 2275.00) xy (2203.00 2275.00) width (10.00)
, ?! |$ @  {1 d. q/ j" ^* f/ l+ f- V8 r  t

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发表于 2015-6-17 09:24 | 只看该作者
dzkcool 发表于 2015-6-16 13:20+ w, e; E( j$ f9 w. Z* S8 K+ ?1 Z1 D6 a
你这跟楼主不是同一回事啊,确定走线的网络跟管脚是同一个吗?
7 B3 O3 R6 E8 R$ F/ C  n
谢谢杜老师提示,网络跟管脚不是同一个。我走线的时候,忘记勾选find内的pin选项了。
3 M/ f- |) ~; @3 L* m% d0 K) I; }1 |2 n应该是在top层走了一段连接线,所以报错。
' [6 z+ N- n$ S: y, W勾选上pin选项,就没有错了,问题解决。
9 m& x0 |0 ]/ X0 k9 _ 0 V, K2 N0 V! P/ X, x0 h+ a) O, x1 J

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解决了就好  详情 回复 发表于 2015-6-18 14:36

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发表于 2015-6-16 13:15 | 只看该作者
Aiby2015 发表于 2015-6-16 10:38
4 V/ Y) U# C) H6 }7 B可以了吗?

7 w' `% ?9 v. j1 t没有解决。" v; m% `' h2 w4 J/ W) y
我的是在top 层出现的Line to SMD Pin Spacing 的DRC error
* K5 h. j& E; Z, `5 c应该是我哪里弄错了。
! h6 ?$ u8 I. s# }/ V: t/ X/ i
, t- D, R3 Q4 T# p. C+ g+ y
5 x+ E) v/ n9 y/ C2 h7 j7 |1 Q ) _0 ~( D/ @8 p
  • TA的每日心情

    2020-7-21 15:38
  • 签到天数: 21 天

    [LV.4]偶尔看看III

    推荐
    发表于 2015-6-10 11:19 | 只看该作者
    本帖最后由 kinglangji 于 2015-6-10 11:21 编辑 4 \6 y! y. v5 G; g6 [
    Aiby2015 发表于 2015-6-10 11:06! m, i% }1 z- i' |+ M
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    - y' Z$ G$ W) E! U7 Z+ k4 c。。。。。。。貌似这样好像不出drc。。
    6 Y- ~! U; l# Y# v$ O" h; t. d

    捕获.JPG (60.37 KB, 下载次数: 3)

    捕获.JPG

    点评

    [attachimg]98046[/attachimg] 然而并没有什么*用~~~  详情 回复 发表于 2015-6-10 12:20

    该用户从未签到

    2#
     楼主| 发表于 2015-6-10 11:06 | 只看该作者
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    点评

    。。。。。。。  详情 回复 发表于 2015-6-10 11:19

    该用户从未签到

    4#
     楼主| 发表于 2015-6-10 11:49 来自手机 | 只看该作者
    好 我试试看

    该用户从未签到

    5#
     楼主| 发表于 2015-6-10 12:20 | 只看该作者
    kinglangji 发表于 2015-6-10 11:19
    5 s, M2 b# V/ ~+ n4 v# w0 j$ F。。。。。。。貌似这样好像不出drc。。

    + T7 \* i, c1 \6 U: A* T, V% X: h & f- p, k5 g6 W9 H! q! l
    然而并没有什么*用~~~
    3 @2 A- K8 _7 s6 P  A/ U

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    7#
    发表于 2015-6-15 09:51 | 只看该作者
    我遇到了类似的问题,查看的约束管理器,觉得里面设置是对的。) r3 Q  X" l1 [
    同求答案。

    点评

    我的解决了 不知道您的是不是?  详情 回复 发表于 2015-6-15 20:06
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    8#
    发表于 2015-6-15 13:23 | 只看该作者
    不行就上传文件

    点评

    感谢杜老师私下热心 指导  详情 回复 发表于 2015-6-15 20:07
    好了  详情 回复 发表于 2015-6-15 20:02

    该用户从未签到

    9#
     楼主| 发表于 2015-6-15 20:02 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23
    2 o- j- g2 r2 |" |5 T# q4 d不行就上传文件
    5 I$ |+ ^6 i0 e1 ^$ t) W; T6 K
    好了
    & A, U0 I' h2 H/ A! o- O
    ; A9 s6 O+ L, V. V5 t8 n1 k" j

    该用户从未签到

    10#
     楼主| 发表于 2015-6-15 20:05 | 只看该作者
    " ], d" h) x7 d1 `) [9 k/ Z
    我犯了低级错误,负片敷铜!
    8 p0 s$ s# E5 R: z4 X* N6 O

    该用户从未签到

    11#
     楼主| 发表于 2015-6-15 20:06 | 只看该作者
    3dworld 发表于 2015-6-15 09:51  I; ^, @3 @8 P( k) z+ y9 {
    我遇到了类似的问题,查看的约束管理器,觉得里面设置是对的。. g3 m* M% ~- s) u1 y/ z8 F
    同求答案。
    0 M! K% k* u3 C( _- R, a
    我的解决了 不知道您的是不是?6 \) ?  U/ @5 R# W. j

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    我去试试看, 负片不能普通吗? 在创建铜皮的时候,不是通常给负片Power层指定网络吗?  详情 回复 发表于 2015-6-16 09:37

    该用户从未签到

    12#
     楼主| 发表于 2015-6-15 20:07 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23- Z. u2 E& t0 y5 m  h8 w" {
    不行就上传文件

    + q9 B: U( H7 m2 e  D- W  m" A感谢杜老师私下热心 指导2 n0 @( ^4 ]& E* D* k$ x7 `: h9 w

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    14#
    发表于 2015-6-16 09:37 | 只看该作者
    Aiby2015 发表于 2015-6-15 20:06( h' W1 M. r8 [# D
    我的解决了 不知道您的是不是?
    ( o! l' V, ]- e5 D# Q5 u/ F
    我去试试看,
    " E+ w8 {" \, S' [8 o. `" X负片不能普通吗?- l. x( f' t. |7 H5 ^
    在创建铜皮的时候,不是通常给负片Power层指定网络吗?
    3 q1 ]9 k4 X& _' n4 a4 A

    点评

    可以了吗?  详情 回复 发表于 2015-6-16 10:38
    楼主是把表底层设置成了负片。  详情 回复 发表于 2015-6-16 10:32
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    15#
    发表于 2015-6-16 10:32 | 只看该作者
    3dworld 发表于 2015-6-16 09:37
    4 J  ~  ?) b) j我去试试看,
      V/ [+ N6 }# {+ Z, [/ e; a8 ]  q负片不能普通吗?
    4 C: v7 y# |( P$ N3 P在创建铜皮的时候,不是通常给负片Power层指定网络吗?
    , `% ]* s- y6 T( F( Q  V- u* k# ]
    楼主是把表底层设置成了负片。& J- T- s; }. W; J3 L- y! `
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