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楼主: haigangzaixian
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PCIE 2.0&3.0远距离传输,参考时钟怎么处理

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16#
发表于 2015-6-16 08:25 | 只看该作者
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17#
发表于 2015-6-16 11:25 | 只看该作者
haigangzaixian 发表于 2015-6-16 07:53
9 W% n8 l4 g7 @# N) z; q$ a4 I10米的线缆,SAMTEC的

( ~1 n- M7 u8 R; ?+ k8 Y其实有个很需要考虑的问题,一般PCIE3.0 2.0在INTEL的设计上会说明让其走线长度不得超过多少多少MIL,大概就在10000mil的样子。如果是PCIE3.0用10米线长传输  我表示有点堪忧啊~~~+ c4 N3 I) v/ K8 ~
* n6 Q- t. s& o. O* @) F% F/ R4 s8 N
举个例子吧,miniSAS(SAS3.0,6Gb)线缆有0.7米和3米的。使用3米线缆就发现SAS信号比较差了,眼图很差,这个我以前做企业级存储设备时候测量过的。高频分量在远距离传输损耗太大。所以你要用10m线传输PCIE的话,我觉得不靠谱,感觉这个方案本身可能就有问题。
7 j, O$ Y+ O# F0 E+ y8 z% |2 o  q* \" u! C0 K8 I1 v1 {
我觉得楼主还是先调查下,有没有人像你这么干过,如果有,那么有没有加过说明措施% _5 {; x  c; J

点评

10米就不要试了,建议3米以内。我有这个问题专门找人咨询过,3米基本可用,5米已经无法接受。如果10米,可以考虑走光。  详情 回复 发表于 2015-6-16 12:49

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18#
发表于 2015-6-16 12:49 | 只看该作者
zlpkcnm 发表于 2015-6-16 11:25; b0 S* D  P8 v* J  {8 i1 o+ V
其实有个很需要考虑的问题,一般PCIE3.0 2.0在INTEL的设计上会说明让其走线长度不得超过多少多少MIL,大 ...
9 A$ @, T! x" c. F
10米就不要试了,建议3米以内。我有这个问题专门找人咨询过,3米基本可用,5米已经无法接受。如果10米,可以考虑走光。3 j3 m. Y( N' n  g9 _5 @

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19#
发表于 2015-6-17 19:03 | 只看该作者
时钟应该是需要传输的。

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21#
发表于 2015-7-7 22:13 | 只看该作者
PCIE时钟必须基于同步时钟源,我原来做过的方案是采用FPGA XC5VLX110T调用ROCKET I/O中的PCIE核与计算机进行PCIE通讯,必须采用计算机主板发过来的时钟,如果在板上FPGA使用时钟IC产生100M异步时钟,则整个PCIE链路无法初始化。还有在VPX系统中,设备板与主系统板之间的PCIE通讯也是同样的情况,必须采用系统板发送过来的时钟才能完成链路的初始化。

点评

你好,我们公司现在有一个项目,目前有一个问题就是,板子得FPGA设备和arm设备无法相互通信,这两个设备是利用得PCIE总线进行相连的,想请教一下,可能是什么问题  详情 回复 发表于 2019-12-30 15:13
我打算投板试一下呢。PC传过来的时钟你加BUFFER了吗?  详情 回复 发表于 2015-7-8 09:40

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22#
 楼主| 发表于 2015-7-8 09:40 | 只看该作者
寒冰箭影 发表于 2015-7-7 22:13
4 O; t- g' d9 O% x+ O* u0 fPCIE时钟必须基于同步时钟源,我原来做过的方案是采用FPGA XC5VLX110T调用ROCKET I/O中的PCIE核与计算机进 ...

, b( L" v# N5 B3 s) C' a我打算投板试一下呢。PC传过来的时钟你加BUFFER了吗?

点评

你说的长距离传输的情况我没有实际项目经验,个人觉得可以加BUFFER。  详情 回复 发表于 2015-7-8 22:39

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23#
发表于 2015-7-8 22:39 | 只看该作者
haigangzaixian 发表于 2015-7-8 09:40
9 E" t' a* w; \. P. {. h我打算投板试一下呢。PC传过来的时钟你加BUFFER了吗?

; T8 f( y# D- m! L5 B  T$ D( U你说的长距离传输的情况我没有实际项目经验,个人觉得可以加BUFFER。1 e; O, q  k8 n+ X  u

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25#
发表于 2016-1-15 10:42 | 只看该作者
楼主,半年过去啦,你这个项目做完啦吗?10米的线缆传输验证啦吗?给个答案啊,坐等楼主回复。

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26#
发表于 2016-4-10 22:41 | 只看该作者
mark一下,公司的也是长距离线缆出问题了。参考参考

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27#
发表于 2019-11-8 15:18 | 只看该作者
一直没有搞清楚参考时钟的作用

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28#
发表于 2019-11-8 16:52 | 只看该作者
本帖最后由 超級狗 于 2019-11-8 16:56 编辑 ! g: o$ t4 N, ^4 Z0 F) g# @' D/ h
/ m; Q# t2 `! U5 Z, k1 p
IDT PCIe 2.0 Repeater + PCIe 3.0 Retimer: A9 K& |3 d" ^4 v0 t9 @8 d

9 Y7 A) n* E7 v$ ghttps://www.idt.com/us/en/products/interface-connectivity/signal-integrity-products/
7 d6 K* G+ K) N- K( T* s: i8 h( b3 f, [* Q# |  H+ T( `
這東西有幫助嗎?
! A) V# M9 B( p8 f: y6 n5 \+ c( x( w! |, B

2 p8 F% s. D  w0 p

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29#
发表于 2019-12-30 15:13 | 只看该作者
寒冰箭影 发表于 2015-7-7 22:13
4 M  S4 I3 [+ \' lPCIE时钟必须基于同步时钟源,我原来做过的方案是采用FPGA XC5VLX110T调用ROCKET I/O中的PCIE核与计算机进 ...
% T! y/ n4 Y4 M( _! {) o
你好,我们公司现在有一个项目,目前有一个问题就是,板子得FPGA设备和arm设备无法相互通信,这两个设备是利用得PCIE总线进行相连的,想请教一下,可能是什么问题
/ ~2 \2 U' F5 Z% q- t! c4 m

点评

clk buffer是否有加上,另外方案也必须跟得上,pcie3.0的?  详情 回复 发表于 2020-1-7 14:46
  • TA的每日心情
    难过
    2020-1-14 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    30#
    发表于 2020-1-7 14:46 | 只看该作者
    kevinyuanic 发表于 2019-12-30 15:13
    4 M4 i, i2 o. Q. P# }你好,我们公司现在有一个项目,目前有一个问题就是,板子得FPGA设备和arm设备无法相互通信,这两个设备 ...
    : |$ h) Q7 V  g' d  |
    clk buffer是否有加上,另外方案也必须跟得上,pcie3.0的?
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