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发表于 2015-9-13 16:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 zgyzgy 于 2015-9-13 21:16 编辑 ' s! P' [7 V0 A. ^6 y1 C

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# Y' ?' U7 B5 J3 k: d( U( j0 r4 U6 m1249604 PCB_LIBRARIAN  LIBUTIL          Libexp  verify runs both con2con and  hlibftb9 n1 l: p! f% f, P0 y" I/ O
1417327 concept_HDL    PDF              Omit mechanical page while printing PDF
' W5 C9 G, j; M$ X" Y( W! ~* [! L1440484 CONSTRAINT_MGR CONCEPT_HDL      existing pcb diff pair name is changed by netrev
1 F3 W/ O3 c. y; _% E7 V* `+ \4 P1441086 PCB_LIBRARIAN  OTHER            Cannot delete pin & added pins change after save
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9 t: H& g4 ^& Z' u* I9 {. k. z1452431 CONCEPT_HDL    CORE             Obsolete $PNN is remained in a dcf file and Attributes dialog
: j9 G; Y1 f# \0 S1 U  L* n1452640 allegro_EDITOR OTHER            Updating PCB Board file concern
+ y+ o# Y9 ^, S% J- v$ @- f. m1454730 CONCEPT_HDL    CORE             Zoom/Pan Disrupts move and copy
1 V1 [" G; G+ y% x1 d1457713 ASI_SI         GUI              Setting Sigrity_EDA_DIR for Sigrity 2015 /orcad ERC% [. U# O5 b- Q  v6 n8 I' F
1458439 F2B            PACKAGERXL       The Packager pstprop.dat file reports false conflicts in net properties6 v9 n5 Y" [! u& A' W9 b- h6 o
1458461 F2B            PACKAGERXL       The pstprop.date file "Conflicts on Net Synonyms" are NOT reported as errors
( y5 n. g1 e" {3 w0 C7 v% i1459153 SIP_LAYOUT     OTHER            Mirrored components with pads on diestack layers (above top/below bottom) display on right layer but aren't selectable.% g2 ~/ ^1 M' g6 L2 x' V% [. s2 M( M
1461553 CONCEPT_HDL    EDIF300          edif300ui writer crashes on ADW design3 B( z6 H' V/ ]! w% b
1462254 ASI_SI         SPDIF            Ball properties are not translated to XtractIM using SPDIF
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1463333 ALLEGRO_EDITOR INTERFACES       PDF created using Export > PDF shold not zoom to Page fit when selecting another layer$ L% V" Z% W" _) K# b/ U% L
1463358 ALLEGRO_EDITOR INTERFACES       Color assigned to pin not passed to PDF
0 P5 O+ J( ]1 \: t: I+ p# q1463648 CONCEPT_HDL    CORE             Need ability to block the uprev of a design+ T  c' P9 f2 V$ a; S
1463839 APD            OTHER            Changing DIE property to another layer does not change its masking layer
7 T( t" l, I% g9 `2 i# X7 o1464380 APD            OTHER            Why pad at wrong layer when we place SIP 16.6 but 16.5 is correct.
. J( r1 i6 i* \2 o4 S1464660 CONCEPT_HDL    CORE             Problems with "save hiarachy"& e- K: _  k% E! f; E$ Y
1464771 SIG_INTEGRITY  OTHER            PCB SI crashes when extracting differential pair topology from Constraint Manager
- S+ v3 Q) W" U1 O" L7 m1464909 APD            WIREBOND         Bondfinger drifting off of the WB guideline0 O2 P! o# M% {+ b
1465273 SIP_LAYOUT     STREAM_IF        Streamout with mirror makes die symbols not located at where they should be in gds8 z9 J/ R+ b, Y' b: _
1465457 CONSTRAINT_MGR CONCEPT_HDL      Layer characteristics from a lower-level block are merged with the higher-level) P6 j0 \5 w7 Z* G  R+ p+ {
1465541 CONCEPT_HDL    CORE             CM_VALIDATION_ON_SAVE is crashing DEHDL on startup( h9 [" G2 I8 M, C  F1 C
1465543 F2B            PACKAGERXL       USE_PACKAGED_NAMES is crashing Export Physical
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1465916 F2B            DESIGNVARI       Issues with variant management in ISR 055 #1 - Must save variant in Variant Editor to add info to CPM$ Q7 A! t' |# V/ n
1466230 CONSTRAINT_MGR UI_FORMS         The Clear option is missing from the Reference Electrical CSet field in all workbooks- y% `- R6 S; I
1466404 CONSTRAINT_MGR ECS_APPLY        ECSet mapping using tags not working* I. i5 R+ V5 b  }# {1 n' P8 Y
1466492 ALLEGRO_EDITOR EDIT_ETCH        PCB Editor crashes when using the Add Connect command
% L0 c; E+ w- j  O8 G1467156 F2B            DESIGNVARI       Out of sync endless loop) h( }# I/ p5 }
1469062 ALLEGRO_EDITOR EDIT_ETCH        Crash while performing neck mode for Diffpair
5 k0 w( o% m/ z* L; L+ ~1469081 ALLEGRO_EDITOR ARTWORK          Short in Gerber Data due to wrong cut out around via6 H5 {: d+ \! p& {1 Z. f6 l
1469713 TDA            CORE             Updating project with non-existing variant crashes TDO1 l5 S* s  ~7 [) j% F

0 y  F' @) M$ h7 c正在上传文件中,分享链接稍后。。。。。。
; K" R& s9 d& B2 a* P8 D/ i

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http://pan.baidu.com/s/1qW3jhoC3 t2 l, x8 v, c7 s5 M' ^( l

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参与人数 1威望 +2 收起 理由
yueyuan2003 + 2

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2#
发表于 2015-9-13 19:47 | 只看该作者
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3#
发表于 2015-9-13 20:42 | 只看该作者
还没上传好

点评

久等了,网速慢呀!  详情 回复 发表于 2015-9-13 21:16

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4#
 楼主| 发表于 2015-9-13 21:16 | 只看该作者
xfire 发表于 2015-9-13 20:42* H, a1 Q, y/ y' j
还没上传好

6 [% T4 `* J% M& D* o( l3 W久等了,网速慢呀!
! @; l/ O) t& m' d- q6 d. L

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5#
发表于 2015-9-13 21:43 | 只看该作者
又有更新啦
+ q! O6 p5 D8 r  [) I: U

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6#
发表于 2015-9-13 22:37 | 只看该作者
这更新真快呀,不过都没真没大变化

该用户从未签到

8#
发表于 2015-9-14 07:51 | 只看该作者
谢谢分享!   

该用户从未签到

9#
发表于 2015-9-14 08:12 | 只看该作者
谢谢分享!   
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    发表于 2015-9-15 08:53 | 只看该作者
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    每次才更新補丁不久,& [% D2 [( P8 \6 g- ^5 x8 C
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    11#
    发表于 2015-9-15 15:34 | 只看该作者
    楼主速度很快呀!

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    12#
    发表于 2015-9-15 19:19 | 只看该作者
    基本上2周一更新,北京时间周六早上发布

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    13#
    发表于 2015-9-18 10:35 | 只看该作者
    安装更新也是一种乐趣……
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    15#
    发表于 2015-9-18 23:39 | 只看该作者
    多谢楼主分享~~
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