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FPGA IO引脚电压问题

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1#
发表于 2015-10-30 15:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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用的赛灵思spartan3芯片,IO口标准电压是3.3V的。但是发现有一个io口误接了5V的信号,现在暂时还能使用,不知道这样会不会有问题。另外问下大神,哪里能看到io口电压的标准

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2#
发表于 2015-10-31 11:39 | 只看该作者
长期使用是会出问题的,就像你接触静电一样,偶尔一下没有任何问题,要是你一直都生活在高压下,你不出问题就怪啦。至于IO电压,在电气说明里面都会写明。

点评

就是没找到IO的电气说明才捉急啊  详情 回复 发表于 2015-11-2 09:54

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3#
 楼主| 发表于 2015-11-2 09:54 | 只看该作者
菩提老树 发表于 2015-10-31 11:395 r7 a9 H; {1 I& z5 L! {* X1 I3 M
长期使用是会出问题的,就像你接触静电一样,偶尔一下没有任何问题,要是你一直都生活在高压下,你不出问题 ...

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4#
发表于 2015-11-2 10:57 | 只看该作者
一定会有的,可能是你找的datasheet不对,因为FPGA的资料比较多,每一款IC都很多文件,所以你要找到对应的,如果没有是不可能的,那样就乱套了

点评

找到了,最高4.6V。看样子我要再改了  详情 回复 发表于 2015-11-3 13:55

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5#
 楼主| 发表于 2015-11-3 13:55 | 只看该作者
菩提老树 发表于 2015-11-2 10:57; l# [8 x! W, @& U7 X! z
一定会有的,可能是你找的datasheet不对,因为FPGA的资料比较多,每一款IC都很多文件,所以你要找到对应的 ...
8 A. [- V) n' A3 Q4 K% L
找到了,最高4.6V。看样子我要再改了% M, }8 t3 T) U" u& [8 p/ P

点评

所以,还是找资料的问题  详情 回复 发表于 2015-11-3 14:30

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6#
发表于 2015-11-3 14:30 | 只看该作者
xd365 发表于 2015-11-3 13:55' ^% B, e& s: Q4 J: T; w9 H
找到了,最高4.6V。看样子我要再改了

% ~2 R# h$ g8 O+ J% t; a所以,还是找资料的问题

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7#
发表于 2015-12-13 22:34 | 只看该作者
挂电阻分压应该可以吧?

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8#
发表于 2015-12-13 22:36 | 只看该作者
挂电阻分压应该可以吧?

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9#
发表于 2015-12-17 22:40 | 只看该作者
你咋挂?留地了?

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10#
发表于 2015-12-24 08:58 | 只看该作者
Xilinx 5V I/O Tolerant FPGA0 e: D; g7 p2 r
The Virtex™ product family can interface directly with 5V systems without the need for translation circuitry.- k. `9 }. a3 T4 I
( j, z( c* h: \' k
有標示 5V I/O Tolerant 的 FPGA 產品,5V 訊號可以直接灌到 I/O 引腳上;但輸出就只有 3V,必須確認可以推得動周邊的芯片,且 Noise Margin 會變小。沒有標示的最好就用 Level Translator 或 Level Shifter 隔開。 8 D+ b  I" {$ {

+ ^/ t, n0 [4 d& N$ |1 t# C
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