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Allegro更改网表,Capture采用back annotate出现问题,求大神指导

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发表于 2016-7-4 08:04 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 shipaopao 于 2016-7-4 08:09 编辑
' F/ z6 X8 R0 i& G# `; N" f+ _! _; t- k$ m4 p; `) X8 u: X: `, g
allegro中采用Net Logic将一组pin互换net,导出网表,然后capture中采用back annotate。结果capture中的操作是,将封装中的pin位置互换。如何保证原理图中pin位置不换,仅更改pin连接的net呢?
* S$ u8 Y$ k, p  }& x+ p. ^. G9 p; ~0 b: b

2.jpg (51.72 KB, 下载次数: 2)

采用back annotate之后原理图封装中pin的顺序互换

采用back annotate之后原理图封装中pin的顺序互换

3.png (22.37 KB, 下载次数: 1)

如何保证封装不变,仅更改net定义呢

如何保证封装不变,仅更改net定义呢

1.jpg (52.16 KB, 下载次数: 1)

最初的封装以及网络定义

最初的封装以及网络定义
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    2#
    发表于 2016-7-4 09:07 | 只看该作者
    capture不能反标回去到原理图,这样会把part改掉,只能自己对照交换前后的网标去调
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