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2017年6月28日公益PCB评审报告节选

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1#
发表于 2017-6-30 13:36 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1、二极管没有极性5 Y" x# _% S3 i+ }3 V6 ]6 U8 V

二极管没有极性.jpg (22.51 KB, 下载次数: 0)

二极管没有极性.jpg

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2#
 楼主| 发表于 2017-6-30 13:36 | 只看该作者
2、USB走电源加粗些,这个有0.5A的电流

USB走电源加粗些,这个有0.5A的电流.jpg (23.03 KB, 下载次数: 0)

USB走电源加粗些,这个有0.5A的电流.jpg

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3#
 楼主| 发表于 2017-6-30 13:36 | 只看该作者
3、隔离盘异常的避让导致高速差分没有参考层面

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4#
 楼主| 发表于 2017-6-30 13:36 | 只看该作者
4、晶振的输入电源加粗

晶振的输入电源加粗.jpg (23.28 KB, 下载次数: 1)

晶振的输入电源加粗.jpg

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5#
 楼主| 发表于 2017-6-30 13:37 | 只看该作者
5、连接器电源走线没有加粗,目前按照普通50欧阻抗线走的。

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6#
 楼主| 发表于 2017-6-30 13:37 | 只看该作者
6、网络名有误,下接电阻没有与地相连

网络名有误,下接电阻没有与地相连.JPG (44.71 KB, 下载次数: 0)

网络名有误,下接电阻没有与地相连.JPG

点评

检查好仔细!  详情 回复 发表于 2017-7-4 17:55
pcb
这种是原理图没接好.  发表于 2017-6-30 13:50

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7#
 楼主| 发表于 2017-6-30 13:37 | 只看该作者
7、音频模拟电路,需要和数字区域的信号完全隔离分开布局

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8#
 楼主| 发表于 2017-6-30 13:38 | 只看该作者
8、走线在高速电容挖空区域导致参考平面不完整

该用户从未签到

9#
 楼主| 发表于 2017-6-30 13:38 | 只看该作者
9、注意电感的位置摆放,请按参考设计调整

注意电感的位置摆放,请按参考设计调整.JPG (37.68 KB, 下载次数: 1)

注意电感的位置摆放,请按参考设计调整.JPG

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10#
 楼主| 发表于 2017-6-30 13:38 | 只看该作者
10、运放类走线加粗处理

运放类走线加粗处理.jpg (24.03 KB, 下载次数: 0)

运放类走线加粗处理.jpg

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11#
 楼主| 发表于 2017-6-30 13:39 | 只看该作者
11、原理问题。参照手册

原理问题.jpg (23.82 KB, 下载次数: 0)

原理问题.jpg

点评

pcb
原理图与PCB封装PIN脚不对应,很多硬件没有注意到  发表于 2017-6-30 13:56

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12#
发表于 2017-7-4 17:55 | 只看该作者
EDA365QA 发表于 2017-6-30 13:37
% c3 ^% G& X' b! \/ p6、网络名有误,下接电阻没有与地相连

) g# a! f, Z2 P8 H检查好仔细!

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15#
发表于 2017-7-6 20:20 | 只看该作者
进来学习,差分线还不会设置
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