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2017年7月6日公益PCB评审报告节选(一)

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1#
发表于 2017-7-7 08:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-7-7 09:17 编辑 9 _9 A' s! N: i' W7 e  u0 q

/ C, \6 S. h4 {  C+ x1.  隔层参考没对应布线.
6 B9 e( H: j; X; h' `8 M$ t6 Q . J* C6 A! P  c/ x0 N) ?4 |

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发表于 2017-7-27 17:09 | 只看该作者
junieya 发表于 2017-7-27 16:22& T$ {& u2 _9 z; {$ x* {4 B4 y- K
隔离处理就是画出来的地方的电路元件要离电感远一点嘛?

5 L! d6 H" _* H/ }. l; v隔离这类名词要多学习多看一些资料,下面是EMC方面的说法.
7 g% k4 T; b& B) ~5 O# d; C0 w( D% @
( P! F1 O% |8 a: Q, U

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发表于 2017-7-27 16:22 | 只看该作者
EDA365QA 发表于 2017-7-7 08:52
' `5 r+ W: E4 Q) u2 N, A4.  共模电感前后做隔离处理.

8 b6 D5 Q, q5 W1 P9 d2 z9 ^隔离处理就是画出来的地方的电路元件要离电感远一点嘛?
& g$ |7 X/ |; z( R' k4 V

点评

pcb
隔离这类名词要多学习多看一些资料,下面是EMC方面的说法. [attachimg]129100[/attachimg]  详情 回复 发表于 2017-7-27 17:09

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 楼主| 发表于 2017-7-7 08:56 | 只看该作者
6.  隔离的电源地分割要一致,不能有跨分割布线.
, z  f1 R# t4 F1 g& J0 J
& |' J, a" u: Q

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2#
 楼主| 发表于 2017-7-7 08:49 | 只看该作者
2.  有多余线段.
* H3 ~* }) P/ G; x8 i" g5 T% ]0 q
  x) k2 v3 G+ ^1 |  d/ M

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3#
 楼主| 发表于 2017-7-7 08:51 | 只看该作者
3.  加热部分为大电流,布线应铺铜加宽.
# o' n5 o" X% n5 _" ^
7 y1 S$ Q9 R7 p$ p

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4#
 楼主| 发表于 2017-7-7 08:52 | 只看该作者
4.  共模电感前后做隔离处理.4 r8 N  p- C% U# F
, I: R% E# U( h

点评

隔离处理就是画出来的地方的电路元件要离电感远一点嘛?  详情 回复 发表于 2017-7-27 16:22

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5#
 楼主| 发表于 2017-7-7 08:54 | 只看该作者
5.  共模电感所有层前后做隔离.
7 Y( y# P) G9 h8 g1 Q( _6 n
! ^0 C* r& P7 F, \1 W5 o

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7#
 楼主| 发表于 2017-7-7 08:57 | 只看该作者
7.  光耦前后做隔离.
. u% |: K+ ^8 H4 \! u6 f, i/ U* b 6 G7 q( Q" W# S  `0 Q0 X

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8#
 楼主| 发表于 2017-7-7 08:58 | 只看该作者
8.  DDR的DQS没走差分.) [, x7 @5 w* O1 r; @1 J
6 [# s( f( H, |

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9#
 楼主| 发表于 2017-7-7 08:59 | 只看该作者
9.  差分走线不耦合太长了.7 `% U4 T4 e* a$ W% T
1 ?2 r. @0 v. e

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10#
 楼主| 发表于 2017-7-7 09:00 | 只看该作者
10.  电源电感两端走线要加宽.
: C, P- A' x$ c1 I
( T* F, @! u% Y. M# y

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11#
发表于 2017-7-7 09:02 | 只看该作者
细节上能见真功夫呀。

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14#
发表于 2017-7-7 12:25 | 只看该作者
可以学习,还可以加分,幸福

该用户从未签到

15#
发表于 2017-7-7 14:22 | 只看该作者
以后我画好板子也要发给EDA365的各位版主帮忙评审。
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