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2017年7月19日公益PCB评审报告节选

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1#
发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.  音频模拟线加粗走类差分.0 [0 R3 i& i3 w

$ X, Y+ O1 g6 b4 D

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推荐
发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:320 V7 d) @4 e5 e$ N# T. a
请问这条如何理解? pcb小白求教
# `1 A  D. L, I' A# j
1.平面铜只有一个VIA,肯定的说这块铜没有作用., d# [; O2 r6 s, ^; [- q' R
2.电源被VIA隔小了,电源通路太细.

* R% v9 y  a0 _, B5 ?

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:589 ^" x* j7 z8 b  z, d
10.  平面铜只有一个VIA,电源被VIA隔小了.
7 J  @% C  a; F, e* F  F& M
请问这条如何理解? pcb小白求教: X- F% p( t8 j$ D

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.
% g8 g5 A/ w  q0 h
: e/ k2 l+ K% m: e

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2#
 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.$ @; U9 p  C+ N: G* F8 h/ J) {  s, g
. a! ]5 }. b" g6 i

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3#
 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.
; \5 y1 C/ D2 n: g8 r" Q: O
/ y! W' F# K) L+ ?# c; Q

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4#
 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.: t) y5 ^- ]. u9 \

$ ]2 I" R. c$ {* [9 C

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5#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.& K/ X; S% N7 O1 a$ u7 {; T
4 X* ^) x7 l6 C% S5 ~0 q

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6#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.$ ?! |) U( c+ Z, c

# L  f9 N2 f9 i1 J% _

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啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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8#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.
- C' w9 N; ?0 E2 S5 f' N6 N
. O! ?, ?' d, r) F# f# _

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9#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.# B: \7 K9 i7 U! ^+ L& R( G5 e

$ Q+ ?" {9 t: z' O4 m! t

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10#
 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了., ^: W* T2 s0 ]7 k1 B2 A0 u

4 o& U1 F& Z2 F. \" [. S1 P

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请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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13#
发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
( E( V% d3 j5 v% W# x3 C; r8 B5 O
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