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allegro 17.2 怎么建立Xnet

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1#
发表于 2017-8-5 15:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
15金币
本帖最后由 tiny丨Y 于 2017-8-12 10:28 编辑
0 K$ x# B$ n8 y6 [- Z* l! e- I  s) Q
问题如题我不是小白
6 H/ M+ |, p7 a) O7 T" U! J8 P/ D用signal model assignment方法试过了,建立失败
- x2 M. W" U: n* l" P请用17.2试过成功的大神帮忙解决4 J& R* e  K3 a. [5 Z' B. K' I
版本17.2 S094' T: x8 v+ z) W% l$ e5 u" @
感谢rock_li29的帮助:可能是你的BRD文件数据有问题,提示电源和地网络有问题,重新开一个新的BRD file,把现在的器件,走线,铜皮贴到新的BRD文件可以设XNET.0 v9 W1 W* K/ |5 q
% ]- x# @2 Y- J" C

9 d2 h% l; _8 v* U0 }+ {已确认解决,但还是没找到为啥 原来的brd不能设置 继续求助
* x0 I- m2 k6 p! Y4 E# u6 O

最佳答案

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附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

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2#
发表于 2017-8-5 15:34 | 只看该作者
tiny丨Y 发表于 2017-8-7 09:44
  G; e3 A) y8 f& ]方便加个QQ2542796636 附件不好上传
% u+ g5 T. o0 B* Q
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。
7 b1 e7 x  R. M: y- M) ~

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附件  详情 回复 发表于 2017-8-8 14:45

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3#
发表于 2017-8-6 17:59 | 只看该作者
没有用过17的版本

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4#
发表于 2017-8-7 09:18 | 只看该作者
17.2的补丁已经到094了吗?

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057吧  详情 回复 发表于 2019-8-7 13:14

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5#
发表于 2017-8-7 09:33 | 只看该作者
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。
7 c1 X% ?4 s- b8 L! g" U, Z6 c2 Q

xnet.png (47.96 KB, 下载次数: 8)

xnet.png

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方便加个QQ2542796636 附件不好上传  详情 回复 发表于 2017-8-7 09:44

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6#
 楼主| 发表于 2017-8-7 09:44 | 只看该作者
rock_li29 发表于 2017-8-7 09:33
0 ?2 k8 V, J( \* N; Y( p跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。
! ^' a9 {0 K0 j! W- S# R. p7 q/ r
方便加个QQ2542796636 附件不好上传

点评

附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。  详情 回复 发表于 2017-8-8 10:14

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7#
 楼主| 发表于 2017-8-8 14:45 | 只看该作者
本帖最后由 tiny丨Y 于 2017-8-8 15:01 编辑 / l+ X' E* L; K
rock_li29 发表于 2017-8-8 10:14
$ J1 i9 S9 n* w0 b/ l# y' Y附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。
$ s3 I8 D" J# F. U( p: P
私信你了

pcb.zip

1.22 MB, 下载次数: 32, 下载积分: 威望 -5

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8#
发表于 2019-8-7 13:14 | 只看该作者
zuoanwind 发表于 2017-8-7 09:180 g: R2 \+ g, y4 c* g5 J
17.2的补丁已经到094了吗?

, o) S( e( v( d3 u. A. z& v057吧& P; m. ]  e8 d" r  G8 [

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9#
发表于 2019-8-8 05:59 | 只看该作者
17.2的问题。

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10#
发表于 2019-8-8 06:07 | 只看该作者
不方便截图,这是新找到的,是17.2的问题* U' j7 Z) B9 R4 V5 S
. T4 X! P7 w7 R0 z& h( d! G
1.Close the design if it is open in Allegro PCB Editor.
1 z7 H  R! d2 u  ~2.Add the CDS_XNET_STATE_UI variable​ with a value of 1 to the User variables section in the Environment Variables form.
1 ~5 R2 q$ z: T: I3.Open the design in Allegro PCB Editor.
- }7 S5 f+ d3 U9 e/ A4.Go to File > Import > Logic and, if not already set, set the Import Logic Type to Design Entry HDL.
4 N$ H1 l0 N& u( u4 |8 d" P5.Open Constraint Manager.
& S) a7 ^3 y- E6.Select Tools > Options.# u& X3 K7 L4 i% K! l
7.Select the Create XNets and Differential Pairs using DML Models (same as SPB 16.6) option.
  • TA的每日心情
    开心
    2022-11-28 15:00
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    [LV.1]初来乍到

    11#
    发表于 2019-10-28 11:40 | 只看该作者
    今天我也是遇到了,17.2不能创建XNET。。。
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    12#
    发表于 2019-10-28 11:45 | 只看该作者
    版本17.2 S094  能分享下S094的补丁?

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    13#
    发表于 2019-10-28 19:55 | 只看该作者
    試試.謝謝!
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    14#
    发表于 2020-3-13 11:44 | 只看该作者
    THANK YOU.
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    15#
    发表于 2020-3-17 13:41 | 只看该作者
    谢谢分享
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