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EDA365电子论坛网»电子社区 › 研发供应链讨论 › QA检查（免费服务） › 2017年11月5日QA检查报告节选
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2017年11月5日QA检查报告节选

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EDA365QA

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1#
发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.匹配电阻应该靠近连接器放置$ ?6 L* n3 d- A+ S" W
' n! c" \. v& b$ j+ M

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发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:16
" R  k5 W  o! T, l5 Y+ A% j6.高速线不哟啊在挖空的隔离焊盘下方走线

/ ]( s" V8 m& [) f9 N* i% ~' H你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
) [3 o; G9 f+ o4 V- r6 f

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ccccindy
我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
剑铮奇迹
不是器件，是差分过孔反盘，穿反盘导致那块参考不连续，这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
EDA365QA
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
Jamie_he2015
应该是，不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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ccccindy

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:44: K" ?; b) h& v7 c- i8 w4 Y) S6 l
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

" {4 [% L  m# l" E+ ?% D+ Y我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上& O/ k8 L, \# n

2.jpg (69.57 KB, 下载次数: 4)

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1023598725
谢谢  详情 回复 发表于 2017-12-4 08:28

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fengyu6117
  • TA的每日心情
    怒
    2020-4-16 15:19

    • 签到天数: 5 天

    [LV.2]偶尔看看I
    推荐
    发表于 2017-11-8 09:56 | 只看该作者
    EDA365QA 发表于 2017-11-6 10:15
    $ ^% z9 s& P6 t( [; h4.CAN没有按照差分走线

    3 T4 H" i7 G  u# L- QCAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。
    " |9 l6 Q7 s9 C

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    EDA365QA

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    2#
     楼主| 发表于 2017-11-6 10:14 | 只看该作者
    2.电源没有来源0 x! v5 A- p1 q2 n% E" @

    # E* v* a& I1 S4 e1 h4 u/ U

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    EDA365QA

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    3#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    3.网格部分应该是表层禁布# P3 h; J3 i4 v0 v2 n. |" @5 [% @2 m( J
    9 k" V& V3 t( [' a$ e; c6 @0 q

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    jiangriver
    为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

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    EDA365QA

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    4#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    4.CAN没有按照差分走线
    . s9 U$ h( M& a& E5 Z" J$ }
    - ^. E+ N& q( x( V

    点评

    fengyu6117
    CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
    LiuTao166462139
    can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

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    EDA365QA

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    5#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    5.串口电容加粗处理
    6 e, d* p; C4 N$ @2 U3 m9 G1 ]* [ ' y. [5 {. l" C  I4 z7 H" O

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    EDA365QA

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    6#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑 ' E3 R6 K/ v! X' Y- ^/ |

    ; `# h+ ?" b/ A! X& ]5 n6 o6.高速线不能在挖空的隔离焊盘下方走线/ ~% ?1 ]8 R( o9 {1 G

    2 k7 ~5 b* g5 @/ L8 P+ |. F  s

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    剑铮奇迹
    也不能说不能走线，完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9，满足背钻要求，也可以穿的啊  发表于 2017-11-7 15:54
    1023598725
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

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    EDA365QA

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    7#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    7.此电源不需铺平面
    , _) h- c$ h+ ]( H. {4 _4 x
    0 E5 @4 p. Y) u2 n

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    8#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    8.开路
    + f  N! _% [' ]' V
    + g3 S+ {& m$ {% A# K8 P: _

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    9#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    9.相邻走线层的走线重叠较多1 X/ O: L7 c. Q( l4 W' ~+ h8 _
    . K& q2 y" ~6 }6 K. C

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    10#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    10.485没有走差分& @$ d0 |. T5 `+ _8 q
    - B% N8 J" w0 k  S

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    Jamie_he2015
  • TA的每日心情
    郁闷
    2024-11-1 15:35

    • 签到天数: 2 天

    [LV.1]初来乍到
    12#
    发表于 2017-11-6 18:54 | 只看该作者
    1023598725 发表于 2017-11-6 17:44
    0 P- E/ ?  {) B1 Z. d' F你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

    $ x5 {/ Y; ?- P" r, i应该是，不要在两个过孔之间的挖空区走线

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    1023598725
    谢谢。  详情 回复 发表于 2017-11-7 11:10

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    EDA365QA + 1 热心人！

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    15#
     楼主| 发表于 2017-11-7 09:03 | 只看该作者
    1023598725 发表于 2017-11-6 17:44' m8 P9 Z) T' h
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
    8 T: t' z, \# X' s5 D# z( w4 r3 X* f* g
    高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。
    5 _6 Y* }% l) l  e( f9 E- E/ y0 J$ Z

    点评

    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:10
    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:09

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