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2017年11月18日QA检查报告节选

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发表于 2017-11-20 10:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.跨分割了
9 e( ]6 v2 e% v; r- M
. p+ _3 L) u  Q2 `' V  t6 k  }( @

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2#
 楼主| 发表于 2017-11-20 10:19 | 只看该作者
2.高压电源地做隔离
" g4 ~# l$ D' W
3 m8 Q# [, T; f# v

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3#
 楼主| 发表于 2017-11-20 10:19 | 只看该作者
3.SDRAM没等长
% n9 d0 \+ n2 }6 X - `, i, o5 q' A8 X1 R

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4#
 楼主| 发表于 2017-11-20 10:20 | 只看该作者
4.差分走线未按要求走线( K$ F: v( `7 o$ q

" R# V8 ~2 `6 b9 v6 V

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5#
 楼主| 发表于 2017-11-20 10:20 | 只看该作者
5.USB的ESD器件离接口太远了,布线先过ESD。9 ]2 {. ~) K$ Y& ^: m

2 Y4 _: t% f4 `, @1 Y; E8 R

该用户从未签到

6#
 楼主| 发表于 2017-11-20 10:20 | 只看该作者
6.有线在RF挖空区过了,参考层不完整
) ^- F$ w0 h" g  F 8 O/ K+ j# i9 d6 o7 a$ p

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7#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
7.400V?没有按照安规做间距隔离
* y. @8 c- A& B# q0 R
2 U+ v( i* q( r; M

点评

安规应该做多大隔离呢?  详情 回复 发表于 2017-11-20 21:28

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8#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
8.封装库记性与原理图不一致
7 f' g# t9 b7 X 2 o/ A0 [8 i! a- z4 V2 I

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9#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
9.VIA的隔离盘太大,导致内层多处出现隔断,而且隔断区有走线
1 A( m( t$ Y: v$ q8 @ 4 u' Q, ?' P+ ^# K  @5 w. N

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10#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
10.等长处理
- x1 H5 E( Y) e+ G5 a, c2 N 7 I& C. g0 }& C, B/ I3 o, S

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11#
 楼主| 发表于 2017-11-20 10:22 | 只看该作者
10-1.等长处理- i7 c  r# R' v% Y9 T

1 b7 c9 r5 ]: B/ e
  • TA的每日心情
    开心
    2025-5-14 15:34
  • 签到天数: 21 天

    [LV.4]偶尔看看III

    12#
    发表于 2017-11-20 21:28 | 只看该作者
    EDA365QA 发表于 2017-11-20 10:215 @! K" K: \% V! B7 ^! a- Y
    7.400V?没有按照安规做间距隔离
    1 X3 F7 E4 N/ F) L& t& d
    安规应该做多大隔离呢?7 m% P5 K, x% u6 P8 D4 y

    * b6 b" U; ^/ ]# G; \+ f& T, f

    点评

    谢谢解答  发表于 2017-11-22 16:20
    可以参考:https://www.eda365.com/thread-146811-1-1.html  详情 回复 发表于 2017-11-21 09:06

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    13#
     楼主| 发表于 2017-11-21 09:06 | 只看该作者
    edapcbsyc 发表于 2017-11-20 21:28+ V( Y% f/ J: W: b  s# T, [
    安规应该做多大隔离呢?

    9 D) m. {6 l! T4 i7 Y/ L/ X可以参考:https://www.eda365.com/thread-146811-1-1.html
    9 R9 F$ B1 U) U( |% v6 o, [
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