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楼主: EDA365QA
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2017年11月23日QA检查报告节选

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该用户从未签到

16#
发表于 2017-11-27 09:53 | 只看该作者
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

点评

光耦最好能够所有层挖空,完全隔离。  详情 回复 发表于 2017-11-28 09:22

该用户从未签到

18#
 楼主| 发表于 2017-11-28 09:22 | 只看该作者
dhhtmqh 发表于 2017-11-27 09:53/ `. E7 w8 V1 q
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?
6 y  n$ y' v% q& i
光耦最好能够所有层挖空,完全隔离。% M- Q/ ~- Y; @
  • TA的每日心情
    开心
    2022-12-16 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    19#
    发表于 2017-11-28 16:34 | 只看该作者
    EDA365QA 发表于 2017-11-24 09:028 n8 r$ h: C; l0 X" Z4 [+ o
    6.RGB没等长

    3 _+ k4 y6 u" \+ LRGB是灯的那个么,有要求等长么?
    - Z, x7 ?- \) l: o2 W7 p% r
    * @0 v6 e  H0 F7 }& v; `0 {9 F

    点评

    不是灯信号,0-7位数据线最好等长。  详情 回复 发表于 2017-11-29 09:40

    该用户从未签到

    20#
     楼主| 发表于 2017-11-29 09:40 | 只看该作者
    橡皮擦先生 发表于 2017-11-28 16:34- e, [4 Q( o  n! B
    RGB是灯的那个么,有要求等长么?

    9 {5 z7 w; @/ T2 A不是灯信号,0-7位数据线最好等长。
    # L( ]* O3 V$ ]# s: M1 ~4 z
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