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楼主: EDA365QA
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2017年11月23日QA检查报告节选

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该用户从未签到

16#
发表于 2017-11-27 09:53 | 只看该作者
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?

点评

光耦最好能够所有层挖空,完全隔离。  详情 回复 发表于 2017-11-28 09:22

该用户从未签到

18#
 楼主| 发表于 2017-11-28 09:22 | 只看该作者
dhhtmqh 发表于 2017-11-27 09:539 l+ H: P  o% C# Q
这个挖空是指表层放一个禁止铺铜区,还是所有的层都要挖空?
; W6 H- N! N: B9 O( ~7 v& I! c) b" ]
光耦最好能够所有层挖空,完全隔离。
% K3 V; s* j; r7 c: B
  • TA的每日心情
    开心
    2022-12-16 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    19#
    发表于 2017-11-28 16:34 | 只看该作者
    EDA365QA 发表于 2017-11-24 09:02
    + |6 W) C/ O% O+ c2 F) ?) W6.RGB没等长
    3 Q* E- E% W+ j9 K
    RGB是灯的那个么,有要求等长么?
    1 t. @$ \1 N* n" h1 I' p8 L
    * i& i+ P6 ^1 h; |3 ]- ^

    点评

    不是灯信号,0-7位数据线最好等长。  详情 回复 发表于 2017-11-29 09:40

    该用户从未签到

    20#
     楼主| 发表于 2017-11-29 09:40 | 只看该作者
    橡皮擦先生 发表于 2017-11-28 16:34' b& G) K* j4 @% y( h& S+ o
    RGB是灯的那个么,有要求等长么?

    ( S( b% c8 ^& \3 V: y不是灯信号,0-7位数据线最好等长。
    : \* |2 }3 O% {; m& ~
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