求助！ALLEGRO如何避免导入网表后元件布局更改

llk0539 · 发表于 2018-10-2 08:21

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原理图中修改了元件的位号，重新生成网表后导入PCB，发现元件没了，需要重新再放置，之前的布局白费了，有什么办法能避免这种情况？

jordanli22 · 发表于 2018-10-19 17:02

deado 发表于 2018-10-19 14:00. Z: H0 V9 y( z+ d3 y) Y: t
有更详细得资料吗？

去看我发的帖子

longzhiming99 · 发表于 2018-10-8 16:06

jordanli22 发表于 2018-10-8 09:43
* C4 g/ [1 Q2 f/ U导入元件都是会ingore fix的，不然与网表不对应

跟忽不忽略没关系的，反正有时乱有时不乱，很是奇怪，后来找到了问题点，就是板上有fix的东西，只要有，你忽略也一样乱飞，当然可能还有其它问题会引起飞，反正后来我是没遇到过会器件乱掉的情况，我还专试验了去原理图那里改的

這侽孓譙悴丶 · 发表于 2018-10-2 21:08

没有办法，如果原理图位号重编了，更新网表布局肯定就乱了。除非你有skill可以还原布局，否则就得重新布局。如果你有位号重编前和位号重编后的这两个原理图，以及未更新网表得PCB，我可以帮你导入，布局不会乱得，和网表更新前保持一样得布局！

lc1234 · 发表于 2018-10-3 14:36

這侽孓譙悴丶发表于 2018-10-2 21:08
! g& t- E- j( l没有办法，如果原理图位号重编了，更新网表布局肯定就乱了。除非你有skill可以还原布局，否则就得重新布局 ...

版主，能否讲出方法，多谢多谢！

這侽孓譙悴丶 · 发表于 2018-10-5 21:44

lc1234 发表于 2018-10-3 14:36
3 k9 j+ a4 S( n; t# l; c+ d版主，能否讲出方法，多谢多谢！

这个需要skill工具的，得有工具才行！

hshy · 发表于 2018-10-6 23:19

果然大佬多哇，这种情况都有解决的办法，佩服佩服～

jordanli22 · 发表于 2018-10-8 08:46

本帖最后由 jordanli22 于 2018-10-8 08:47 编辑

我也写过一个excel来解决这个问题，也是需要前后对应的元件位号，
不过最近一年都没用过了。不会写skill的可以参考我这个写excel,相对简单一点。

longzhiming99 · 发表于 2018-10-8 09:28

PCB里不要有任何FIX的属性就不会乱，不会飞

jordanli22 · 发表于 2018-10-8 09:43

longzhiming99 发表于 2018-10-8 09:28
! t2 f1 ^- _( c" M$ lPCB里不要有任何FIX的属性就不会乱，不会飞

导入元件都是会ingore fix的，不然与网表不对应

jordanli22 · 发表于 2018-10-8 16:47

longzhiming99 发表于 2018-10-8 16:06
8 F+ S- |: b* y: j& D跟忽不忽略没关系的，反正有时乱有时不乱，很是奇怪，后来找到了问题点，就是板上有fix的东西，只要有， ...

你的回复与楼主主题不符

longzhiming99 · 发表于 2018-10-9 09:32

jordanli22 发表于 2018-10-8 16:472 {) A& j7 A# \8 X
你的回复与楼主主题不符

啊，原来你不是楼主啊，呵呵，我说的就是楼主的那个问题，重导网表后，原摆好的好多器件又变成没摆的了，要重新摆。

appleyang · 发表于 2018-10-10 10:26

可以做一次rename，反吃到原来的线路里。

venus_3321 · 发表于 2018-10-10 15:46

反标，中

deado · 发表于 2018-10-19 14:00

jordanli22 发表于 2018-10-8 08:46. G5 W1 Z$ I7 {/ Q
我也写过一个excel来解决这个问题，也是需要前后对应的元件位号，
; s1 m+ L; K( M" ^& W) G* |, c不过最近一年都没用过了。不会写skill的 ...

有更详细得资料吗？

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