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DRC时出现以下错误

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1#
发表于 2008-3-2 11:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
Checking for Invalid References2 I0 {# j, A" I* v
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK1 AND BANK2  (4.00, 2.10)
" z$ a& Q6 N7 E2 BERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK1 AND BANK2  (9.70, 2.00) 7 M* [; O# }7 t  h7 B  E" A
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK3 AND BANK4  (9.80, 2.10)
# \/ X$ |6 }" AERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK3 AND BANK4  (4.40, 2.10) 0 p* u/ n4 o. {
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK5 AND BANK6  (2.60, 2.30)
8 @1 z: I$ M6 F+ R" d+ N9 MERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 BANK5 AND BANK6  (8.00, 2.30) ( y3 b# z6 C, ^
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 POWER AND CONFIG  (2.30, 1.40) # C- e, Y0 {  r/ \0 p6 h& J; j
ERROR [DRC0026]   This reference has already been assigned to a different package type. U2:  SCHEMATIC1, EP2C20 POWER AND CONFIG  (4.40, 6.40) . g% E5 @* j7 l) x7 f6 P3 ~9 `+ N! B
我调用元件的时候操作方法一样,但只有BANK7 AND BANK8 没有报错,其余几个都报错了.
8 Q, ]3 W: f8 s/ \- X4 {9 d还有就是我在多页原理图中使用分层端口符号,结果报错:
9 h& P8 Z' l: g; I9 @! d9 u6 U% [& mERROR [DRC0003]   Port has a type which is inconsistent with other ports on the net DRAM_CKE:  SCHEMATIC1, EP2C20 BANK1 AND BANK2  (2.70, 4.80) 8 n+ ^2 [) W) z- o2 \% O
我是在一个电路图上设置端口为output,另一个图上则为input,结果就产生上面的错误,改成一致的就没问题了,但我不明白的是,从原理上说不是一个input,一个output才连接正常吗?为什么都是input或output才可以?我看网上下载的原理图也是一个input,一个output?* K6 F9 D. A/ ?, [$ ]! c
不知道怎么办了7 T3 f' G, }. N0 y) j" u4 u
请教大家怎么修改啊.谢谢了' I/ d& Q: s# a( D/ F& @! w' A2 d

7 g/ h2 m. o/ K3 e6 y% ]/ v[ 本帖最后由 elmma 于 2008-3-2 13:36 编辑 ]

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2#
发表于 2008-3-2 15:18 | 只看该作者
上传个原理图看一下!

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3#
 楼主| 发表于 2008-3-2 15:50 | 只看该作者
上传的原理图,.我现在把端口都改成一样的

DE2.rar

607.29 KB, 下载次数: 67, 下载积分: 威望 -5

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4#
 楼主| 发表于 2008-3-3 10:37 | 只看该作者
知道的麻烦给点意见,折腾好久了,一点头绪都没.2 j) n' i6 I7 X; \6 Z0 }: k2 R  B
谢谢啦

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5#
发表于 2008-3-3 13:00 | 只看该作者
原理图问题比较多,这里只回答有关DRC错误的原因2 O+ `6 J5 M: w0 X
你自己把所有U2的part都看一下, 原理图中U2各个部分调用的source package不一样,有的是"EP2C20_31"有的是"EP2C20_29"等等,也就是说根本就不是同一个元件。再画一遍吧
0 n! X% S# t  e1 t) P% g3 W, b% b
5 Z, A( k  x$ M/ S+ x3 R另一个问题是关于Port, 请牢记:- W0 V" O$ C0 c6 y+ m$ q8 h
port只针对层次式原理图才有意义,在平坦式原理图中出现port虽然不影响电气连接(事实上也没有错),但是DRC肯定有问题。像你说的两端口都改成input才能避免DRC标记,但是理论上又说不过去。- {$ b2 ~) C! o6 K& S0 j
建议平坦式电路图都使用offpage connector作不同页面之间连接,这样才不会DRC出错,input/ouput类型也能匹配
8 _8 F7 x; _" B. {最后一句,尽管你图上port有问题,但是不影响电气连接,也就是不影响网表,不影响layout。所以,就睁一支眼、闭一只眼就当没看到吧9 {) q8 x& `+ F( D
' I1 U* x/ u+ T1 f7 o4 @
[ 本帖最后由 numbdemon 于 2008-3-3 13:43 编辑 ]

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6#
 楼主| 发表于 2008-3-3 15:28 | 只看该作者
我之前也是一样调用的,奇怪啊.现在我重新画了一遍后就好了.% i2 g3 H" ?; [6 r# k
谢谢版主,原来看那个就知道是不是用的同一个元件.晕.我都不知道.
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    开心
    2019-12-3 15:20
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    [LV.2]偶尔看看I

    7#
    发表于 2008-3-3 15:30 | 只看该作者
    还是numbdemon版主经验多啊。

    该用户从未签到

    8#
    发表于 2008-9-1 17:31 | 只看该作者

    numbdemon版主请不吝赐教。

    我用capture cis 画的层次式原理图,结果也出现了上面的问题,可是我没有把元件分成多个部分,不存在调用的问题呀。请您帮我看看到底是怎么回事呀?这个图的DRC这么我好几天了。
      x  c: p( {& d  R, G) P% h/ b您有邮箱吗?我把设计发给您。多谢了。
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