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楼主: sheen
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导入网络表问题

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16#
 楼主| 发表于 2008-3-18 15:01 | 只看该作者
原帖由 kxx27 于 2008-3-18 14:42 发表
+ g' R7 Y  v- @) F可能是你的原理图或BRD档有问题根本就没办法导,先检查一下吧。记得这个问题在本论坛里有讨论过,请楼主仔细找找相关贴子也许有收获。

- `9 s6 b8 A" c
! M( ], h, {% g' Y! n现在可以了,刚才是我的路径没设置好,但是现在通过你刚才说的那种方法打开的PCB里面却什么东东也没有,是不是我的
8 Q) m( i; h! a6 b1 D) \' YPCB封装库没有加载进去?

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17#
发表于 2008-3-18 15:07 | 只看该作者
封装要自己再拖进来的,你看下file-viewlog
5 s& o7 n- F' \5 ~8 ^! k4 l/ H若没有错误,就说明已经导入了
% g$ a& C  K! Z% H! }0 gplace-manually里可以手工摆放元件

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18#
 楼主| 发表于 2008-3-18 15:15 | 只看该作者
哎,是不是用习惯了PADS再学这个感觉很难啊,感觉和以前的思路大不一样,有没有初学者有同样的感受啊

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19#
发表于 2008-3-18 15:18 | 只看该作者
我一上来学的就是这个,感觉也头大.
  `4 x. ]  @' s, y/ v* k才学了一个月,就让 我画六层板.差不多要崩溃了

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20#
发表于 2008-3-19 20:35 | 只看该作者
记得大约在10年前在生成网表的选项上是选取telisis格式就可以生成tel文件了。
  • TA的每日心情
    开心
    2019-12-3 15:20
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    21#
    发表于 2008-3-19 22:29 | 只看该作者
    tel是allegro最简单的一种网表格式,包含的信息量最少,优点就是简单易用,缺点就是很难和第三方软件接口,而用那三个文件的格式就很容易跟其它软件包括cadence自家的软件交互。

    该用户从未签到

    22#
    发表于 2008-11-13 19:53 | 只看该作者

    tel????

    需要设置什么才可以生成tel文件?

    该用户从未签到

    23#
    发表于 2008-11-13 19:54 | 只看该作者
    我看到的是txt文件!

    该用户从未签到

    24#
    发表于 2008-11-14 08:04 | 只看该作者
    3楼的说的对,就是那样倒,倒进去是看不到零件的,再点Place-Quickplace,摆放零件就看见了

    该用户从未签到

    25#
    发表于 2008-11-14 08:06 | 只看该作者
    Cadence导出的文件就是有那三个,分别对应了零件的封装形式等

    该用户从未签到

    26#
    发表于 2009-6-23 18:15 | 只看该作者
    我也没搞明白呀,烦

    该用户从未签到

    27#
    发表于 2009-7-9 12:40 | 只看该作者
    26# zwp98 ( X! B! B4 L% |9 l5 T0 v' Z) x5 U
    导进去什么都没有,用viewlog查看提示以下错误,是怎么回事啊?# R" K% x0 _: K. n/ y, ^
    ) t+ Z4 |7 \7 d: ]- E
    Cadence Design Systems, Inc. netrev 15.5 Thu Jul 09 11:25:57 2009
    9 m+ _( M* |) F+ K2 J(C) Copyright 2002 Cadence Design Systems, Inc.3 F6 Y, j; V9 `. N  w
    ------ Directives ------
    $ v5 v+ [0 y9 ^1 L& Q% G7 wRIPUP_ETCH FALSE;8 q% E' m, E( U5 Q$ K) W# l; U
    RIPUP_SYMBOLS ALWAYS;
    8 Z3 d# g$ o$ ?MISSING SYMBOL AS ERROR FALSE;) j* }) z+ [7 z, k3 ~
    SCHEMATIC_DIRECTORY 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project';
    * g4 s: y0 E. Q; CBOARD_DIRECTORY '';
    : W9 o' c% Q' p6 n7 z4 ]$ Y: A( @1 BOLD_BOARD_NAME 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/mt9d111.brd';" T; v1 U. M0 [
    NEW_BOARD_NAME 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/mt9d111.brd';
      s# n6 O3 }5 D( pCmdLine: netrev -$ -5 -i C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project -y 1 C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/#Taaaaaa03240.tmp
    , w$ D7 p( L; a8 [/ J4 p------ Preparing to read pst files ------) ~. Y9 K- \8 c% K( e, L+ T. r, S- k3 H
    * e) [0 m" `0 d9 l# F" s6 J
    #1   ERROR(24) File not found( m, I8 O( H: m: ?) G! E: P% T
         Packager files not found( k. I; Q$ ~' D+ q# H  {
    #2   ERROR(102) Run stopped because errors were detected
    , e0 x- l. i0 j( B1 n; x, |" z4 H7 fnetrev run on Jul 9 11:25:57 2009; O* O! H# J; x, W3 t
       COMPILE 'logic'
    . y8 x: ^' ?6 I0 U  S' Y, ?5 r: m   CHECK_PIN_NAMES OFF. x2 V+ S. X' B) k" b1 i
       CROSS_REFERENCE OFF
    2 W1 S8 S" b# k0 R/ [* i   FEEDBACK OFF7 B* a3 c1 @: }  y' Y! }* @
       INCREMENTAL OFF; ^. J+ N& a2 F- s; s- G' x
       INTERFACE_TYPE PHYSICAL" \2 Y+ I3 m+ a7 \) |9 P
       MAX_ERRORS 500
    , {* `9 S+ c( Q! [+ r; i   MERGE_MINIMUM 5* Y) {2 `. Y% Y- s+ D) Y0 C
       NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|'
    * \. B$ M7 f6 H& k+ f, g: v   NET_NAME_LENGTH 248 e. Z2 n  n9 L' m7 V$ K$ Y. ]/ y) E
       OVERSIGHTS ON/ g  x" e% E" p
       REPLACE_CHECK OFF
    & U: t/ k# p8 W: }2 a# V; b   SINGLE_NODE_NETS ON
    0 |. u9 `4 P4 r- {   SPLIT_MINIMUM 0
    # M+ S% i# J+ n7 H   SUPPRESS   208 d4 \7 U$ j; _- Y8 ]% B
       WARNINGS ON
    * H  C$ z- y! [3 |( N  2 errors detected) F6 E( H1 H: b. Q
    No oversight detected. v; N3 N( t8 V# G9 ?
    No warning detected
    1 C' n- G0 H( e4 N' I2 t1 k' _cpu time      0:00:04  z  }: r4 D( o: ], u% o7 e
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