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Rename allegro—>orcad

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1#
发表于 2008-4-6 19:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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allegro中的元件rename之后,
$ x8 Y, m$ ?7 P7 ^1 r% b% C如何将Rename信息反馈到orcad,% Q- L: K. S8 m
以便原理图与PCB同步?
- _9 L: D+ _4 |  G  `' L请高手指点,谢谢了!!!

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kxx27 + 3 加油

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该用户从未签到

2#
发表于 2008-4-7 10:32 | 只看该作者
我没有做过,但在书上看到.回注就可以了.你不妨试试. o, a/ y) l* k) V' `8 X' Z
1.选择file-export-logic.弹出"export logic"对话框,在"logic type"中选择"design entry cis",表示要传回的软件为capture.在"export drectory"中选择要导出的路径.$ r& S. c7 F) I8 q: B; t% ~
2.单击"other"页面,在:comparision design"栏显示要导出的电路板文件.' X! ]" }4 [9 \
3.切换到"candece"页面单击"export cadence"按钮.弹出进度窗口.* X  M! i! P: N& S0 w# i" Z
4.单击"close",关闭对话框.: K9 T0 v& V" h& \" Y
5.打开design entry cis,打开dsn文件,选择tools-back annotate,在"allegro pcb editor"栏保存好的allegro电路板的路径.
0 P  K2 b3 U! P: q& R  k" v' Z4 s在netlist栏选择"capture"直接转allegro的netlist路径;  }! D5 y9 m+ ~8 a6 W
在"output"栏选择要输出的rename的文件路径.# t2 o- O5 H$ c. Z/ t0 I% g8 j
bank annotation 两个选项都选上.  h0 j' e  F' i
6.单击确定执行back annotate.

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kxx27 + 5 谢谢!

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kxx27 该用户已被删除
3#
发表于 2008-4-7 11:16 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

该用户从未签到

4#
发表于 2008-4-7 14:42 | 只看该作者
上面的方法我看过,不过没试过。
7 o6 t6 t! d& `" O9 Q# ]我是这样做的,同时打开orcad和allegro,想改那个命名了,高亮这个器件,然后看orcad里哪个被高亮了,然后在orcad里改,改好更新下网表就好了。个人感觉这样似乎要稍微好点

该用户从未签到

5#
 楼主| 发表于 2008-4-8 22:42 | 只看该作者
谢谢高手指点!

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6#
发表于 2009-8-28 16:40 | 只看该作者
终于找到了,要赶紧试试

该用户从未签到

7#
发表于 2010-12-25 15:43 | 只看该作者
回复 tnttnp 的帖子
  M$ F" z8 t. O% B+ i9 K
6 A7 S# e' m4 s) P4 d& {7 ^/ D* X你这种方法也是可行的,不过如何器件都布局连线好了,重新导入下网表,原来的器件就会删除,需要重新布线的!* x+ [9 i8 {; z% S, I" L5 G+ P
不知道我这样理解对吧?1 Y, Z. K; o( _2 v# V
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