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allegro PAD制作时警告

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1#
发表于 2010-12-27 14:13 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro 16.3 在制作好PAD后保存会报警告如下:: S, w' u; h7 m  Z9 c$ E" x$ X
- I, d/ \! H0 x9 Y, e+ \. d9 u

+ a: j" |9 }& u3 tpadsTACK WARNINGS:# b4 m1 ?; m) L' L
: _5 `4 D+ h, d+ G4 z) ~
INTERNAL LAYERS: are defined for this padstack.0 Z  k6 x& [5 l! b
When loading this padstack into a design, only the internal
$ l5 K; l1 j& U, M. rlayers with names matching those defined in the design will' Q4 r0 L  D& p! q9 C
be used.
" z( I' r. j- x& ^6 {# y9 J) Y
& U8 y7 M! x3 o9 q1 @7 i/ O帮我看看是什么原因造成的,对封装的制作有影响吗?" O" d1 F  E5 i

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2#
 楼主| 发表于 2010-12-27 14:23 | 只看该作者
自己找到原因了,是在制作焊盘时我定义了DEFAULT INTERNAC层,然后又定义了GND层与VCC层,警告提示是只有DEFAULT INTERNAC的定义有用。

该用户从未签到

3#
发表于 2011-1-1 12:42 | 只看该作者
如果是通孔类的焊盘,别管你要做的PCB板是几层的,只要定义一个internal layer就可以了
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