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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 【多片DDR仿真问题】
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[Cadence Sigrity] 【多片DDR仿真问题】

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MarsonJ
  • TA的每日心情
    开心
    2020-12-22 15:09

    • 签到天数: 24 天

    [LV.4]偶尔看看III
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    1#
    发表于 2020-11-3 14:20 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    大佬们，请教一个问题，如果一个CPU挂载多片DDR4，CPU与各片DDR4之间，所有走线都是Pin to Pin的，仿真的时候一片一片提取互联模型+仿真这样操作，和CPU+所有DDR提取整板的互联参数仿真，这两种仿真结果会有差异么?
    + L3 ]) n3 \. D% c  U. L
    & |, ]6 S, ]4 H% @3 N6 k1 zPS：整板CPU+所有DDR不管是提取模型还是设置仿真都太麻烦，所以想知道能否一片一片来，结果是否会有不同。, F* D; ?. _( G) O" e4 Z  ~

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    推荐
    发表于 2020-11-4 09:17 | 只看该作者
    前面麻烦后面方便，前面方便了后面就会麻烦了

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    回复 支持 1 反对 0

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    Blah
  • TA的每日心情
    开心
    2023-6-2 15:15

    • 签到天数: 1 天

    [LV.1]初来乍到
    2#
    发表于 2020-11-3 15:43 | 只看该作者
    看看                          

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    hyxs714154

    该用户从未签到
    3#
    发表于 2020-11-3 22:40 | 只看该作者
    你说的是地址还是DQ

    点评

    MarsonJ
    DQ，地址控制都是单独点到点的  详情 回复 发表于 2020-11-4 09:57

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    MarsonJ
  • TA的每日心情
    开心
    2020-12-22 15:09

    • 签到天数: 24 天

    [LV.4]偶尔看看III
    5#
     楼主| 发表于 2020-11-4 09:57 | 只看该作者
    hyxs714154 发表于 2020-11-3 22:40
    , Z+ U5 }. ]9 |: _/ @你说的是地址还是DQ

    # W  M5 J9 ~2 C# p, i7 g+ dDQ，地址控制都是单独点到点的
    7 D; P/ S, S$ Z" C0 c$ j

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    daiyan870316

    该用户从未签到
    6#
    发表于 2020-11-4 17:12 | 只看该作者
    只要分清网络  一块提取方便些

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    MarsonJ
  • TA的每日心情
    开心
    2020-12-22 15:09

    • 签到天数: 24 天

    [LV.4]偶尔看看III
    7#
     楼主| 发表于 2020-11-6 19:43 | 只看该作者
    我整版DDR提了S参数，结果加载每一组曲线都要20分钟……

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    MarsonJ
  • TA的每日心情
    开心
    2020-12-22 15:09

    • 签到天数: 24 天

    [LV.4]偶尔看看III
    8#
     楼主| 发表于 2020-11-10 18:12 | 只看该作者
    算了，整版所有DDR信号一起提的话，端口有八百多个，两个s参数模型文件加起来73G，直接卡死……
      f, d0 h! g8 l' s还是决定一片一片提模型，一片一片仿真了……

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    无中生有

    该用户从未签到
    9#
    发表于 2020-11-19 16:31 | 只看该作者
    看看

    “来自电巢APP”

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    guorui328

    该用户从未签到
    10#
    发表于 2021-8-20 17:50 | 只看该作者
    看看学习一下

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