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PCB设计之叠层结构改善案例

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发表于 2021-3-18 14:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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# j2 K! J$ p3 e/ u, M  N8 F问题点. r0 R* A8 U# B
7 I1 B! }. \- a  I, X9 W' [- Y
    产品有8组网口与光口,测试时发现第八组光口与芯片间的信号调试不通,导致光口8调试不通,无法工作,其他7组光口通信正常。
: f, U# s* m' V! ]) J- O/ ^3 \! i2 p4 Q& k
1、问题点确认: 7 T! a# p1 _# |9 |( @& {2 P5 j
, ?3 S7 ]! k% w5 |
   根据客户端提供的信息,确认为L6层光口8与芯片8之间的两条差分阻抗线调试不通;  \: [- J6 N! D

; J  G* D6 N) |. I1 ]5 `
7 |& O2 \5 |+ m( B# r; S' J, S+ l0 e0 |8 ]6 ^

5 S: s% p; F% b7 v( I2、客户提供的叠构与设计要求* w- w0 f, Y4 f3 Y. r: i

. a" A8 V8 T) H- v/ b
- [) N- N* V" S% B' s
$ ]8 Y: E7 @3 M0 K, U8 P: F3 q& e( |3 N* ?& g0 @6 @
改善措施
8 o( c$ b" r& Z' A* F' E1 t+ ], e2 \& |9 J1 `6 k
    影响阻抗信号因素分析:
( e* ^# U: m+ ?+ P2 ]8 M$ X: y- f& l5 n4 f" U+ N6 P
    线路图分析:客户L56层阻抗设计较为特殊,L6层阻抗参考L5/L7层,L5层阻抗参考L4/L6层,其中L5/L6层互为参考层,中间未做地层屏蔽,光口8与芯片8之间线路较长,L6层与L5层间存在较长的平行信号线(约30%长度)容易造成相互干扰,从而影响了阻抗的精准度,阻抗线的设计屏蔽层不完整,也造成阻抗的不连续性,其他7组部分也有相似问题,但相对较轻微。* }% T5 E3 E0 j9 b2 n
    L56层存在特殊设计(均为信号层,存在差分阻抗平行设计、相邻阻抗层间未设计参考地层),客户端未充分考虑相邻层走线存在的干扰,导致调试不通问题。 ! a9 N9 a* @. v

0 {2 h- k: u$ b% h; @/ P& D  V / C; d& B3 [6 o& v% j$ G0 E. v3 z$ {
* ]( S3 F  K/ d. t

' l6 }) o) i. e; L# }- D! s3 h4 {' u' ]

  [. _) I6 A3 E$ w) A+ r5 Z
* o9 i  Q$ R8 _+ ?5 z% q1 Z& G. r& a' ?$ s  H9 d

( Y. z$ D# R" I7 i/ e0 `    与客户沟通对叠层进行优化,将L45、L56、L67层结构进行了调整,介质层厚度分别由20.87mil、6mil、13mil 调整为5.12mil、22.44mil、5.12mil,将而L4、L7间的参考地层间的距离拉近,L56层互为参考且屏蔽不足的线路层距离拉远,减少干扰。0 M) _( ^+ o( z
优化后的叠层结构:
3 @3 E0 x9 [3 f% z7 [" f- b7 c0 Y' O% z) _- H

+ F6 Z% K5 S/ q1 q
) {( v- o: S* q
5 K* [+ C  |0 b7 h9 |优化后的阻抗匹配:
+ M. C& r# j6 o8 D" x& N
2 @9 O2 L; S; ?0 B+ P( o2 V % i3 |0 w* L  z& _

- V9 e  N7 a/ E  e9 c& A
4 W8 }# V/ j% e; i1 |4 `/ E% }改善效果4 R. Q0 h# L% I/ c! b4 {

) h: T. l' a6 ^( k; T    通过调整叠层结构,拉大L56层相邻信号层之间的距离,串扰造成的系统故障问题得到解决。
' y; m( J& l9 ^4 N. Q. _5 C, r4 K
# S+ F, R5 b# _! k* i2 B6 ^

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发表于 2021-3-18 15:19 | 只看该作者
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