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PCB布线设计(五)

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发表于 2021-4-14 15:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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. v8 `  G: y  Q6 a2 t: L
要解决信号完整性问题,最好有多个工具分析系统性能。如果在信号路径中有一个A/D转换器,那么当评估电路性能时,很容易发现三个基本问题:所有这三种方法都评估转换过程,以及转换过程与布线及电路其它部分的交互作用。三个关注的方面涉及到频域分析、时域分析和直流分析技术的使用。本文将探讨如何使用这些工具来确定与电路布线有关问题的根源。我们将研究如何决定找什么;到哪里找;如何通过测试检验问题;以及如何解决发现的问题等。 & C5 d7 d% w# A0 n# c$ s

. m% Y" h: P$ m3 o0 g7 ~  ) r0 x5 L+ b: B  G% }
图1 SCX015压力传感器输出端的电压由仪表放大器(A1和A2)放大。在仪表放大器之后,添加了一个低通滤波器 (A3),以消除来自12位A/D转换器转换的混叠噪声。
2 z, i3 |* i, {4 t/ M$ o2 \& b/ C' _6 R4 t' R3 g" V# e8 z5 g
  ; X5 r& |% t) n: [

, Q! o" _; w- \4 C2 Z* l图2 来自于12位A/D转换器MCP3201的数据的时域表示,产生了有趣的周期信号。此信号源可追溯到电源。
6 b. Y% e/ t6 ~' Y* u7 ^, e4 B: S1 `; ]# r7 H
  7 d! ~# ?6 F1 N0 }

+ h% K5 e) s7 N( |6 t7 v图3 电源噪声充分降低后,MCP3201的输出码一直是一个码,2108。 ! [3 {) u3 c1 S3 i% o

9 P/ ]/ }$ B" O9 x( N6 K6 q/ [ 8 v; ?  P; U2 i: E1 K# s
1 J- e5 `  j1 N( ], I5 ]
  本文要论述的电路如图1所示。3 O* Y+ J* ]3 N  r
   # i5 S, c# t: t  _! T! ?% e; X
电源噪声 8 O7 W! X1 v3 @- ?8 _
0 U0 t, Q* R7 B$ z6 t) ?
  电路应用中的常见干扰源来自电源,这种干扰信号通常通过有源器件的电源引脚引入。例如,图1中A/D转换器输出的时序图如图2所示。在此图中,A/D转换器的采样速度是40ksps,进行了4096次采样。
' E  B9 l% W1 i% Y* [  ~) `/ o9 }: q6 u2 x
  在此例中,仪表放大器、参考电压源和A/D转换器上没有加旁路电容。另外,电路的输入都是以一个低噪声、2.5V的直流电压源作为基准。$ }2 k/ G! \2 r
8 f& N. H. O- w) a$ T/ h0 A6 b
  对电路的深入研究表明,时序图上看到的噪声源来自于开关电源。电路中添加了旁路电容和扼流环。电源上加了一个10mF的电容,并且在尽可能靠近有源元件的电源引脚旁放置了三个0.1mF的电容。在产生的新时序图上可以看到,产生了稳定的直流输出,图3所示的柱状图可验证这一点。数据显示,电路的这些更改消除了来自电路信号路径的噪声源。
  i' \; @$ J3 }: \# A7 Q. ^( }; P! s, r8 {* P+ ]3 _! ?( V7 \
  . }' n/ k' n( o( e3 s2 D5 o
造成干扰的外部时钟 ! |) `* Y; E2 B0 q0 |
 
/ j7 m- B! ~$ b  其它系统噪声源可能来自时钟源或电路中的数字开关。如果这种噪声与转换过程有关,它不会作为转换过程中的干扰出现。但是,如果这种噪声与转换过程无关,采用FFT(快速傅立叶变换)分析,可以很容易发现这种噪声。
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    $ @$ s' {. O$ B4 k. w7 b. T" ~
% n. F. x) z0 C6 z) d, S
图4 耦合到模拟走线的数字噪声有时被误解为宽带噪声。FFT图可以很容易识别这种所谓 “噪声”的频率,因此可识别出噪声源。 # S) J! @. z! O7 v, |  R

; Z7 a7 L/ T- l6 e0 k  O) W  e 
: e4 A; j; Q% Y( w9 m% X* L
# r  L& v7 V6 n3 E9 K图5 放大器轻微过激励,会使信号产生失真。通过这种转换的FFT图,可以很快发现信号的失真。 ; i. b. A4 n$ ]. N$ J
 # K' b+ r6 I9 u+ y& c2 M4 F

: [. l/ W) l7 |2 Z  时钟信号干扰的示例可参见图4所示的FFT图。此图使用了图1所示的电路,并添加了旁路电容。在图4所示的FFT图中看到的激励,由电路板上的19.84MHz时钟信号产生。在此例中,布线时几乎没有考虑走线之间的耦合作用,在FFT图中可以看到忽略此细节的结果。
# G7 O' q' J2 i6 |$ F% v* w1 h+ i6 z( M2 g1 n# O: a6 t# _
  这个问题可以通过修改布线来解决,将高阻抗模拟走线远离数字开关走线;或者在模拟信号路径中,在A/D转换器之前加抗混叠滤波器。走线之间的随机耦合在某种程度上更难以发现,在这种情况下,时域分析可能比较有效。
0 Q2 J" r0 c# }! q) c# b2 w  T" g2 ^' p) c# _
- `, M2 z% u: C- }
放大器使用不恰当
- m9 {' Y& O# B% i4 b$ Y/ i) @! d& f2 k# l' }
  回到图1所示的电路,在仪表放大器的正相输入端施加一个1kHz的交流信号。此信号不是压力传感的特性,但是可以采用这个示例来说明模拟信号路径中器件的影响。
/ S% x! n: ]( F' Q# Q  I
' _2 c2 S4 y5 z  图5所示的FFT图显示了施加上述条件后的电路性能。注意基波看起来有失真,许多谐波也有同样的失真。失真是由于使放大器轻微过激励引起的。解决此问题的方法是降低放大器增益。6 D  p  e5 E+ a, U* B, C

/ Q1 y/ ~) g7 S
7 `# m" S9 Y) o# z结语 $ d. x+ ~/ R0 h
1 I% M1 W' \+ g! X
  解决信号完整性问题可能会花费很多时间,尤其是当工程师没有工具来解决棘手的问题时。在“窍门箱”中有三种最佳的分析工具:频域分析工具(FFT)、时域分析工具(示波器照片)和直流分析工具(柱状图)。工程师可以用这些工具来识别电源噪声、外部时钟源和过激励放大器失真。
' J+ ~. k: a; W: [! o4 ^) g1 x+ |0 B; a/ R# b4 _7 R4 o
3 D& X1 K7 _3 e  O' W& e- {

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发表于 2021-4-14 16:29 | 只看该作者
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