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pspice中新建空白文件后怎么设置仿真时间

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1#
发表于 2021-8-23 09:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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Pspice中新建空白文件后怎么设置仿真时间0 F, Z" G; S4 Z( n) [; c

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2#
发表于 2021-8-23 10:41 | 只看该作者
应该是在上面工具条里,有个类似于Edit simulation功能的按键,点击那个进去,就可以设置仿真时间了。不过也一定要有线路图,才能run simulation
! b, I- E4 c, ?/ Z  |  f& S0 [- `

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3#
发表于 2021-8-23 11:05 | 只看该作者
protel有自带仿真功能,不过有点麻烦,将原理图中的电子元件全部替换成sim信号库中元件,再进行电气规则检查,如果没错,就能仿真。软件还自带3d试图功能,能将你设计好的电路板用立体图表现出来,你可以根据显示的图进行判断是不是你所想要的
7 S4 }+ Y3 a% c( C, P6 q+ @* U

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4#
发表于 2021-8-23 13:10 | 只看该作者
看看别人怎么说的" h1 U) S! `' V# Y
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