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楼主: matice
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前几天看了一个ddr的pcb布线,感觉很不规范,不过居然是厂家推荐的

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16#
发表于 2008-9-23 17:26 | 只看该作者
登场桑主要市委了 信号完整性考虑  产品关键要看在恶劣工况的工作情况比如高温60  湿度90%  这样的环境你的产品还能常识见闻顶工作吗

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17#
发表于 2008-10-30 09:33 | 只看该作者
我认为最好安装规范来做。

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18#
发表于 2008-11-2 11:09 | 只看该作者
还是要看实际效果的!!

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19#
发表于 2008-11-9 13:50 | 只看该作者
规范在那里?
& A) G* C2 l; ?% o呵呵!

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20#
发表于 2009-1-15 09:30 | 只看该作者
我是来学习的

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21#
发表于 2009-2-24 10:16 | 只看该作者
成本和等长有什么关系?为了省几个匹配电阻的钱?也可用等长把匹配电阻做掉,但不意味着不做等长阿。
; v( x$ ^, D' o7 Wcmos 发表于 2008-6-13 10:28
) `& `" {0 J1 Y* n0 ~# J* ?
做了阻抗控制,PCB制板成本就上去了。

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22#
发表于 2009-2-25 11:46 | 只看该作者
规范不是一成不变的,技术的更新规范也会随之更新

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23#
发表于 2009-3-4 15:36 | 只看该作者
作了阻抗匹配成本就上去了,请问如果只用等长线,而不考虑阻抗匹配,对120MHz的DDR会有多大的影响?

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24#
发表于 2009-3-4 15:37 | 只看该作者
21# routon
. r" D% F' T" w- \
* y$ ?( x6 y8 Y$ R作了阻抗匹配成本就上去了,请问如果只用等长线,而不考虑阻抗匹配,对120MHz的DDR会有多大的影响?

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25#
发表于 2009-4-10 13:13 | 只看该作者
要不楼主可以看看freescale提供的资料

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26#
发表于 2009-8-6 10:16 | 只看该作者
5# cmos + F6 L$ F8 b- h; {
说的在理也!!!!!

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27#
发表于 2009-8-11 13:47 | 只看该作者
进来学习的,呵呵

该用户从未签到

28#
发表于 2009-8-21 23:28 | 只看该作者
1 没有匹配
4 ]9 v0 j+ m/ m+ @# B1 B: @# Y2 没有严格差分
& @( T2 X8 Z8 o& w3 没有严格等长,没有蛇形线。; C& O- P; ^, m% K9 b0 ?" I! g8 B
4 菊花链拓扑
3 N9 v' Q6 G/ [5 [/ o0 }! w
0 o9 Y6 g5 u# R还是处理器的厂家给的参考布线,大家讨论一下,这也行吗?
5 r. z+ e* w  S. M6 G( zmatice 发表于 2008-6-4 10:22
3 k# ?7 r2 y2 V
1. ddr有on die termination,如果芯片可以容忍阻抗不匹配造成的反射,没必要在板上做匹配
# E. x2 ~9 \3 b: {; O- {2.松耦合没问题
; E- u( d6 X; o2 O) }3.完全没必要等长1 U- _* A; k) g9 Z9 Y
4.完全可以用

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29#
发表于 2011-8-17 09:56 | 只看该作者
我现在也做这样的案子,各种芯片的要求不一样吧9 U. S4 j8 r3 d/ ~; d* r

: R& X1 e) D/ @! D: H9 X8 I

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30#
发表于 2011-8-17 09:56 | 只看该作者
我现在也做这样的案子,各种芯片的要求不一样吧
8 D4 G9 q' V4 m" I) u6 j3 q( P5 B! ^' {! Z" x" }
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