找回密码
 注册
关于网站域名变更的通知
楼主: liuyian2011
打印 上一主题 下一主题

关于多层板50欧姆及100欧姆阻抗结构设计!

    [复制链接]

该用户从未签到

496#
发表于 2012-7-4 11:14 | 只看该作者
问一下有没有6层板,3层信号的设计呢?S-G-S-P-G-S: E4 J! s  k- ?
板厚是1.6mm的

该用户从未签到

497#
 楼主| 发表于 2012-7-4 18:07 | 只看该作者
zhoumohao 发表于 2012-7-4 11:14 * _0 H; U; K, s1 J
问一下有没有6层板,3层信号的设计呢?S-G-S-P-G-S
3 W/ J$ o( Z# B( U6 D8 N+ G8 l+ x0 F板厚是1.6mm的

: i- B( W4 _$ G- J; Z/ x此3层信号的阻抗设计可等同于4层信号的阻抗模型结构,S-G-S-S-G-S.

该用户从未签到

498#
发表于 2012-7-4 21:21 | 只看该作者
谢谢分享

该用户从未签到

499#
发表于 2012-7-4 22:06 | 只看该作者
楼主,我看了部份叠层,好像忽略了相邻层面的阻抗参考问题,可能会对部份高速信号(我们公司有5-10G信号),产生一定的影响。如下图:你们是怎么解决这个邻层相互参考的影响的??) L0 n4 o! y* w9 |$ O7 e
而且还有一个疑问,4、5两个层面分别参考6、7,是不是可以理解为如果4层走线了,5层就需要留空???/ Z' L: Q: ]" W; r) B0 z
提一下自己的疑问,,问的不对的地方,请批评!!

3.JPG (29.53 KB, 下载次数: 3)

3.JPG

4.JPG (8.62 KB, 下载次数: 4)

4.JPG

50欧姆,100欧姆板厚1.0MM8层板阻抗设计-2.zip

169.46 KB, 下载次数: 43, 下载积分: 威望 -5

该用户从未签到

500#
发表于 2012-7-5 09:26 | 只看该作者
liuyian2011 发表于 2012-7-4 18:07 + e1 _5 j4 ~" H( @9 o1 F
此3层信号的阻抗设计可等同于4层信号的阻抗模型结构,S-G-S-S-G-S.

! `9 Z" y6 D% s你好,4层信号设计时L3、L4的参考层是L2、L5;而3层信号设计时L3的参考层应该是L2、L4,其阻抗计算应该不同吧?

该用户从未签到

501#
发表于 2012-7-5 10:31 | 只看该作者
才看到这么好的帖子!

该用户从未签到

502#
 楼主| 发表于 2012-7-5 13:41 | 只看该作者
ghfghyb 发表于 2012-7-4 22:06
7 J" G; h7 T' D3 _/ K% e5 U+ Y8 b- i楼主,我看了部份叠层,好像忽略了相邻层面的阻抗参考问题,可能会对部份高速信号(我们公司有5-10G信号), ...

; B" d; I- a9 N1 @; f  W* y- w你好!L4,5层的阻抗线不是参考L6,7层,而是参考L3,6层. L4,5层相邻层固然会产生互相影响,但相对来说非常小,可以忽略.例如4层的阻抗线参考L3,6层控制阻抗,起主要作用的是L3,4层之间的介质厚度.& S; h; V3 G/ F* C- F: i" ?
另外频率对阻抗也会产生影响,但也非常小,可以忽略的。且频率越大,其阻抗变化越趋于稳定!

该用户从未签到

503#
 楼主| 发表于 2012-7-5 13:47 | 只看该作者
zhoumohao 发表于 2012-7-5 09:26
* I3 C" t0 e! T4 i( i9 n你好,4层信号设计时L3、L4的参考层是L2、L5;而3层信号设计时L3的参考层应该是L2、L4,其阻抗计算应该不 ...
0 o, u$ B( @6 u; T( |1 ^
是有所不同,但是大家用Polar si9000软件计算一下,会发现两者相差非常小,通常相差不到1欧姆。这是因为L3层的阻抗值主要取决于L2和L3层间的介质厚度的原因.

该用户从未签到

504#
发表于 2012-7-5 14:31 | 只看该作者
楼主,我请教了我们的EMC工程师,他的建议是,叠层间距需要调整!+ ?; f, m3 q% K' y6 M* c
如下图:相邻之间的层是会就近参考,也就是说在图中:3 t# I9 [. V( I) S" y0 B
L1的参考层是L2,L3的参考层是L2
9 `9 k+ z% K( N1 L8 g4 GL4的参考层是L5,和你文件中的说法完成是不一样的!!$ ]. U- P- ^  K. U9 @; g
如图中,L4层信号,参考L3/L5和参考L3/L6他们的区别有10欧,这个量还是很大的~

1.jpg (212.88 KB, 下载次数: 2)

1.jpg

4.jpg (165.05 KB, 下载次数: 2)

4.jpg

5.jpg (218.56 KB, 下载次数: 2)

5.jpg

6.jpg (195.18 KB, 下载次数: 2)

6.jpg

点评

阻抗信号线主要参考较近的屏蔽面呢!  详情 回复 发表于 2023-12-14 22:44
  • TA的每日心情
    开心
    2024-5-31 15:50
  • 签到天数: 19 天

    [LV.4]偶尔看看III

    505#
    发表于 2012-7-5 14:35 | 只看该作者
    实际计算的结果很不理想!

    该用户从未签到

    506#
     楼主| 发表于 2012-7-5 15:04 | 只看该作者
    ghfghyb 发表于 2012-7-5 14:31 + {4 A! ~6 }. E! G$ Y
    楼主,我请教了我们的EMC工程师,他的建议是,叠层间距需要调整!
    5 {$ K6 B/ I. h" u" C. ~如下图:相邻之间的层是会就近参考,也就 ...
    , u: l* a& T1 U) d  @
    此8层板要求板厚仅1.0MM,各层间的厚度分配很有限,不能太大呢!

    该用户从未签到

    507#
    发表于 2012-7-5 15:09 | 只看该作者
    我知道,板厚小,但是一般情况下会考虑信号的安全,可以增加板厚的!
    - l! @- s! P& g只是有这些疑问,想确认一下!!每个人说法不一样,最终都不清楚哪个是正确的!!
    3 Y/ e2 m  T1 E& P- L4 D- N  p有说不对的地方请包含!!

    该用户从未签到

    508#
     楼主| 发表于 2012-7-5 15:23 | 只看该作者
    ghfghyb 发表于 2012-7-5 15:09
    7 P2 q5 N' x1 c+ A* f4 a我知道,板厚小,但是一般情况下会考虑信号的安全,可以增加板厚的!
    " ~7 K4 r# E0 C6 {; W1 s只是有这些疑问,想确认一下!!每个 ...
    - s3 l- U& h/ N& K" S
    所以大家在设计时应注意:1.尽量减少两邻近信号层平行走线. 2,尽量增大两邻近信号层间的介质厚度. 均是为了减少两邻近信号层之间的互相串扰.

    该用户从未签到

    509#
    发表于 2012-7-12 15:01 | 只看该作者
    zlq0416 发表于 2011-8-15 15:05
    ( z1 \& c9 b8 ~- v: @回复 liuyian2011 的帖子1 ?; R" k4 l' o
    " N% c+ R2 @8 n9 {5 g
    大家注意6层板中第3种结构采用的是常规6层板,此种结构优点在于按正常6层板收取工 ...

    3 B1 s0 x+ T8 k" n* m楼主之前的帖子已经回答了,不知道第几次,你再找找看。

    该用户从未签到

    510#
    发表于 2012-7-12 15:08 | 只看该作者
    zhouhua_8 发表于 2011-12-23 22:05 8 a7 h; x9 X2 P8 k6 m6 _
    两层板子也我用si90000做个100欧姆控制,那个时候使用的是PCIE-X1的控制走线

    ; z( b* m6 f! a! P我算出来的结果很下人,线宽10mil,间距4mil,线宽是间距的2.5倍,我不知道这样的走线在信号跑100M的时候会怎样?没仿真也没测试。实际应用在10M一下,没出问题。
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-9-7 09:01 , Processed in 0.156250 second(s), 25 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表