两个PCB合并，器件和布线各用一半，怎么操作？

cccccc32

大家好！
. G5 q3 X$ ]5 m- d
* y6 I3 @3 E& d3 R0 y      如题，两个PCB中的器件和连线有都各有一半与新的PCB一致，想合并到一起。目前是新建一个PCB，把两个都放进新的PCB中可以，但是把其中一个放进另一个pcb中就导致直接allegro关闭，没有提示错误。请问该怎么解决？ 谢谢！！！
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art_li

这个MS要先把原理图整合好 ~~  （需要的那部分net和元件的ref都要一直）之后导入网络表，在执行sub-drawing （元件和走线一起过去，注意勾选保持元件refdes选项。GOOD LUCK!
& l: t' c3 y) `

cccccc32

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ok 我试试，非常感谢高人的指点！

cccccc32

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( E  e, u- T7 z
' c2 v- F: a/ p% h  g9 o/ D* n请问是新建一个PCB之后导入新的网表，还是把网标导入合并其中之一的PCB呢？ 谢谢!

art_li

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$ x6 q- Q8 ^+ @# _0 X& ]都一样 后者貌似可以少导出个sub-drawing  ，线路图一定要整合好别多了少了，导致功能问题 ，小心~

cccccc32

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% z8 Q- S; s& V% n0 Z
/ K- S3 ~( p' s/ z4 y好的，我再试试，谢谢！

陈丽

( [0 Q2 Q" i! `3 `3 K( Y
" |5 k0 d) X- H0 N' p% l+ D随便用一个PCB当主板，删除另一半的器件后，再用 Reues 功能将器件和线贴过去就可以了。

cccccc32

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% {% z1 N# N) {, K你好！
     谢谢指点，我用的是15.5版本的，没用过您说的reues，请问这个功能15.5有吗？如果有在哪，谢谢！

cccccc32

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1 P, O2 a! A+ G! V/ [/ _你好！

     在打扰一下，我试着把第一个PCB用subdrawing导入第二个PCB中，第二个PCB在导入第一个PCB的subdrawing前我先导入了新的网表，这样的方式都会出错，allegro直接就关闭了。这个方法没成功，不知道怎么回事？请再指点一下，谢谢！

cccccc32

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! ?1 V! W3 G( R  l: T, Q
4 x% P* S9 Q+ {; V$ c7 l我在一个PCB中导入新的net，然后再把另一个PCB放进来，但还是同样提示是allegro运行错误，直接就给关了。悲哀！！！
% z, ?) [; {4 o7 Q9 Z7 S
$ _7 W* }+ V* V5 [! o: [

art_li

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不会吧~这个不好说~  1.原理图的网络表能正常导入吗？2.你的零件库里有这个板子的零件封装吗~？3.呵呵应该有outline吧。。。你的情况挺复杂  ，不会如此啊~！！
6 {1 g- V* Z  T- G  U& e# t
3 @; P" U- `+ k

art_li

路径上没有中文吧~? 有错误报表吗·····

cccccc32

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谢谢您的分析，我再试试。 谢谢！
- ^% O- w" e3 \- E. Q9 w

cccccc32

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% ~# L0 c8 x+ G4 Q# m' P, [# w
- b) M9 c  M* k  U# f( B你好！
$ S. T' b3 @6 y. v1 y# a     路径上没中文，没错误报表，而且网表也没问题。器件的封装都有。
) E0 ^/ c! _: i5 c+ o. n7 w: H

art_li

那我投降~ 怎么会这个样子~