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Cadence 层叠设计中阻抗计算疑问。

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发表于 2022-4-17 14:56 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.板子层叠 ,四层板 TOP GND PWR BOT 此时 GND PWR设置为Plane 计算的TOP单端阻抗为74欧姆,较小?
' e6 Q* y' A% A; D/ ]" G' ~2.板子层叠 ,四层板 TOP GND PWR BOT 此时 GND PWR设置为Conductor 计算的TOP单端阻抗为201欧姆,较大?4 k5 Z. D& b! r& X1 L$ z* b
3. GND PWR设置为Plane时制作PCB采用的负片工艺? 设置为Conductor制作PCB采用的正片工艺?这样理解正确吗?
6 o$ s- `5 \4 _; x" E希望路过的大佬,耽误一点时间解答一下,非常感谢各位大佬的解答,提前谢谢大家。
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设置电源层为Conductor.jpg (49.07 KB, 下载次数: 0)

设置电源层为Conductor.jpg

设置电源层为Plane.jpg (36.56 KB, 下载次数: 0)

设置电源层为Plane.jpg

点评

Plane和Conductor只是影響CAD軟體作業方式, 而Conductor 是拉線不保證是GND,所以會跳過參考.........再來Plane可以是正片或負片,看你設定.  发表于 2022-4-17 18:26

该用户从未签到

推荐
发表于 2022-4-17 15:44 | 只看该作者
首先Cadence自身的阻抗计算误差较大,真要算叠层时不建议用cadence来计算,polar才是专业的。其次,GND和PWR设置成plane还是conducter不决定采用的是正片还是负片设计,正负片设置就在右侧的那个negetive  artwork设置即可,plane层也可以是正片。

点评

关键要懂得怎么设置allegro那个层叠参数,设置正确了误差和Polar比还是有偏差但是偏差并不大,而且熟练后偏差是可以预估的。好处是allegro计算阻抗很方便,叠层参数设置好了就能应用时延计算。据我所知AMD的团队一直在结合skill开发应用allegro算阻抗,   详情 回复 发表于 2022-5-1 07:10
非常感谢您的回答,谢谢。  详情 回复 发表于 2022-4-18 17:26

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 楼主| 发表于 2022-4-18 17:26 | 只看该作者
bainum 发表于 2022-4-17 15:44
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非常感谢您的回答,谢谢。

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发表于 2022-5-1 07:10 | 只看该作者
bainum 发表于 2022-04-17 15:44:41
) F& G; n! p% N首先Cadence自身的阻抗计算误差较大,真要算叠层时不建议用cadence来计算,polar才是专业的。其次,GND和PWR设置成plane还是conducter不决定采用的是正片还是负片设计,正负片设置就在右侧的那个negetive  artwork设置即可,plane层也可以是正片。
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) [; U* o! R' w+ Z* E- b# G关键要懂得怎么设置allegro那个层叠参数,设置正确了误差和Polar比还是有偏差但是偏差并不大,而且熟练后偏差是可以预估的。好处是allegro计算阻抗很方便,叠层参数设置好了就能应用时延计算。据我所知AMD的团队一直在结合skill开发应用allegro算阻抗,9 a: D' o  ?" ]# |
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“来自电巢APP”

点评

AMD的团队用MENTOR XPE比较多吧,XPE算阻抗和POLAR差不多  详情 回复 发表于 2022-5-1 11:22

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发表于 2022-5-1 11:22 | 只看该作者
zgtsang 发表于 2022-5-1 07:104 p5 O! a  J( |3 {) z) |5 d: Q" w* O
关键要懂得怎么设置allegro那个层叠参数,设置正确了误差和Polar比还是有偏差但是偏差并不大,而且熟练 ...

& N6 L6 Y8 a& f5 s6 ~% }AMD的团队用MENTOR XPE比较多吧,XPE算阻抗和POLAR差不多
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