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怎么修改导线的属性?

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1#
发表于 2011-10-1 15:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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allegro中,我把地分成了模拟地和电源地。因为设计原理图时候忘了把他们相连,所以在orcad中修改,把它们相连了;后来导入到allegro中,所有地网络变成了电源地,那么原来两种不同颜色的导线成了一种颜色,我觉得不太方便,那就又在原理图里面把电源地与模拟地分开了,之后导入allegro中,后来发现出现了很多DRC。而原本的模拟地的导线显示成电源地的导线。我想把drc消灭,怎么办?求救。

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2#
发表于 2011-10-1 17:25 | 只看该作者
即然连了,就是同一个网络啊.肯定分不出颜色吧? 又把它分开了,你意思是,布好线再把它们相连?

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3#
发表于 2011-10-1 17:29 | 只看该作者
本帖最后由 longzhiming 于 2011-10-1 17:32 编辑 1 o2 g! [. V! ^

3 _# q# s% B/ }7 l5 n; t4 c5 I好像软件还没那么智能,要有,那就好了,因实际应用中确实不同的地通常连在一起的. 而这样在PCB中颜色不能分开来显示啊,除非用个元器件隔起来. 要不怎么办? 请楼下高手给答案.

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4#
 楼主| 发表于 2011-10-1 18:25 | 只看该作者
本帖最后由 catking5252 于 2011-10-1 18:28 编辑 * G: n" [( ?3 P2 z
longzhiming 发表于 2011-10-1 17:29
+ E2 U2 X. q' f  Y# z# H! J好像软件还没那么智能,要有,那就好了,因实际应用中确实不同的地通常连在一起的. 而这样在PCB中颜色不能分开 ...
% h5 o% A4 E0 c" J

5 w5 c$ [2 Z' ]" ^7 q: i+ N不好意思,我讲得不清楚。不是把颜色分开,而是,我在orcad中把模拟地和电源地连在一起后,加载到allegro中,然后又在orcad中把模拟地和电源地断开连接。再加载到allegro中,之后就有DRC错误。我在allegro中把模拟地和电源地的连线断开,依然有drc错误。想请教怎么消灭这些drc错误?

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5#
发表于 2011-10-1 19:20 | 只看该作者
catking5252 发表于 2011-10-1 18:25
/ r# e: f* p- Q0 `不好意思,我讲得不清楚。不是把颜色分开,而是,我在orcad中把模拟地和电源地连在一起后,加载到alleg ...

( \+ }. _& ?. i/ P在tools菜单里有啊

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6#
发表于 2011-10-1 19:21 | 只看该作者
Update DRC

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7#
发表于 2011-10-1 21:42 | 只看该作者
在原理图中并不知道FG或GND放在哪,你这样不断的改,当然会出现应当FG的地方变为GND,如果你想修正,建议从PCB中直接修改shape为FG就可以了。

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8#
发表于 2011-10-1 21:44 | 只看该作者
你可以详细看一下DRC的说明再对症下药

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9#
 楼主| 发表于 2011-10-1 22:53 | 只看该作者
dbit 发表于 2011-10-1 21:44 * T" g- H) U# C
你可以详细看一下DRC的说明再对症下药
: J. z" f" N. e) |+ J
呀,终于有大侠明白我意思了。但是还是不懂怎么改。
9 k2 w; t% G" N2 t; O- b错误如下。( M7 |% S7 m9 e0 F5 N
  < DRC ERROR >           + w5 Y; `/ c. [1 [: \9 @0 ~
) a0 P0 C% {. |0 ]
  Class:           DRC ERROR CLASS. l8 N+ ?! W  \; W' \5 g
  Subclass:        BOTTOM9 Z7 R% S4 r, s
  Origin xy:       (-833.54 -2264.18)
6 G, r: }1 u/ i: C- f5 ^  Constraint:      Line to Thru Pin Spacing/ f; }! |5 W& {  d6 [+ U) `
  Constraint Set:  DEFAULT
' D! }2 t2 u1 [, ?# L" o: x$ X4 \( L  Constraint Type: NET SPACING CONSTRAINTS$ x# u$ t0 F# [
' ]4 s- t  S2 O  {
  Constraint value: 11 MIL
3 P  j+ X, }, p  Actual value:     0 MIL
! c. C3 W' O1 t) O, E" n. A' t: \. O% U& G
  - - - - - - - - - - - - - - - - - - - -
4 N! f* t/ D. ~/ D" p  Element type:    SYMBOL PIN- K+ c. t6 K  I5 b6 {) z
  Class:           PIN
5 n; h, P1 a# T7 c" c' P; s2 n' a7 _2 m. _7 U$ g( {; L5 F) \
  PIN:          R26.2
( U/ p+ p1 Z5 B* K$ L  pinuse:       UNSPEC$ ~  {* X6 H2 Q% T; S
  location-xy:  (-856.52 -2287.16)
. |! i$ H/ Y6 H7 l. m% W  part of net name:  GND_SMALL_SIGNAL. a7 `. }7 U- E
  - - - - - - - - - - - - - - - - - - - -, t+ Y# e( O# p, n. M
  Element type:    ODD-ANGLE LINE SEGMENT# E' r* d* \) C, T* K
  Class:           ETCH7 i% t9 n3 ^# x8 N* ^
  Subclass:        BOTTOM
6 g; u. }* ?4 F0 J  `" Q6 p8 U1 A3 [4 d3 p+ j- z
  part of a connect line! G" \% _- W0 P4 i1 _7 k6 }2 m
  Not on a Net
  R. u% r1 n6 q5 b. U: a
: v  n. |7 _* q7 I1 S& z
4 q( A* ~6 W( H7 u! @我发觉错误的地方都是NOt on a Net。但我怎么修改导线的属性,令到它是我要的网络呢?例如我本来是模拟地,相连后,变了电源地,再改,模拟地就出错了,但电源地就无问题。求大侠指教

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10#
 楼主| 发表于 2011-10-1 22:54 | 只看该作者
dbit 发表于 2011-10-1 21:42 # q. K' |* {& g: c/ E
在原理图中并不知道FG或GND放在哪,你这样不断的改,当然会出现应当FG的地方变为GND,如果你想修正,建议从P ...

- V  y1 S2 }3 N$ U, C" Z小弟新手自学。地不是shape,是导线来的。怎么改导线FG为GND呢。

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11#
发表于 2011-10-3 11:52 | 只看该作者
DRC 描述是pin 和线 gap太小,是0,在16.3下,2 y; K7 U$ O1 `& M
1.allegro的linsence功换到SI模式(在file下的change editor),
$ y- a4 G8 S, {0 a4 u4 r2.在logic菜单下有edit nets,点你想修改的网络就可以

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12#
 楼主| 发表于 2011-10-6 22:16 | 只看该作者
dbit 发表于 2011-10-3 11:52 * s8 A" s' Z) W3 V8 R
DRC 描述是pin 和线 gap太小,是0,在16.3下,
/ @5 ~% A" [: X: w. ], E1.allegro的linsence功换到SI模式(在file下的change editor ...

, G) z6 e1 d9 A) K非常感谢您!
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