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FPGA的DDR怎么控等长，八组DQ每组各自控等长还是组间也要控？

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冰睡着的水
  • TA的每日心情
    开心
    2024-9-24 15:34

    • 签到天数: 53 天

    [LV.5]常住居民I
    跳转到指定楼层
    1#
    发表于 2022-5-23 15:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    FPGA的DDR怎么控等长，八组DQ每组各自控等长还是组间也要控？控的话组内、组间一般是多少um?
    % B( d; n" _( l4 D, M$ K

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    EDA365微信号及QQ群号！
    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    推荐
    发表于 2022-5-23 18:37 | 只看该作者
    一般是各自控等长、组间也要控，可参考芯片设计指南4 g) u9 V3 Q7 a3 ~
    / w) G! Y; R1 h' z7 r% V

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    回复 支持 1 反对 0

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    dz1514

    该用户从未签到
    2#
    发表于 2022-5-23 15:46 | 只看该作者
    这，不是应该看芯片的规格书要求？

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    asdf193

    该用户从未签到
    3#
    发表于 2022-5-23 17:55 | 只看该作者
    八组DQ每组各自控等长

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