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Cadence仿真手册

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1#
发表于 2022-7-29 09:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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      随着通信系统中逻辑及系统时钟频率的迅速提高和信号边沿不断变陡,PCB 的走线和板层特性对系统电气性能的影响也越发显著。对于低频设计,走线和板层的影响要求不高甚至可以完全忽略不计。当频率超过 50MHz 时,PCB走线则必须以传输线考虑,而在评定系统性能时也必须考虑 PCB 板材的电参数影响。当系统时钟频率达到 120MHz及更高时,就只能使用高速电路设计方法,否则基于传统方法设计的 PCB 将无法工作。因此,高速电路设计技术已经成为电子系统设计师必须采取的设计手段,只有通过使用高速电路设计师的设计技术,才能实现设计过程的可控性。高速系统的设计必须面对互连延迟引起的时序问题以及串扰、传输线效应等信号完整性问题。6 {- z$ M* r3 B9 V' Z

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该用户从未签到

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发表于 2023-6-6 23:43 | 只看该作者
版本有点老,15.2的,不过内容挺好的,学习了

该用户从未签到

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发表于 2023-6-6 23:37 | 只看该作者
学习一下,努力提升自己,加油

该用户从未签到

推荐
发表于 2023-4-23 10:38 | 只看该作者
看看帖子里藏了啥好东西~~~
  • TA的每日心情
    开心
    2023-1-3 15:10
  • 签到天数: 2 天

    [LV.1]初来乍到

    3#
    发表于 2022-7-29 10:39 | 只看该作者
    刚好在自学

    该用户从未签到

    4#
    发表于 2022-7-29 11:03 | 只看该作者
    学习学习,学习学习
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    该用户从未签到

    5#
    发表于 2022-7-29 11:50 | 只看该作者

    该用户从未签到

    6#
    发表于 2022-8-1 18:46 | 只看该作者
    看看帖子里藏了啥好东西~~~
  • TA的每日心情
    奋斗
    2021-9-3 15:59
  • 签到天数: 1 天

    [LV.1]初来乍到

    7#
    发表于 2022-8-2 14:39 | 只看该作者
    学习学习,学习学习
  • TA的每日心情
    慵懒
    2023-12-7 15:49
  • 签到天数: 4 天

    [LV.2]偶尔看看I

    8#
    发表于 2022-8-5 14:54 | 只看该作者

    / ?. V) R4 {. O# W# o看看帖子里藏了啥好东西~~~
  • TA的每日心情
    开心
    2025-2-12 15:08
  • 签到天数: 77 天

    [LV.6]常住居民II

    10#
    发表于 2022-8-8 10:59 | 只看该作者

    + R% P9 N! ?, L+ O学习学习,学习学习
  • TA的每日心情
    慵懒
    2022-8-8 15:03
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
    发表于 2022-8-8 15:08 | 只看该作者
    学习学习,学习学习

    该用户从未签到

    13#
    发表于 2022-8-8 19:16 | 只看该作者
    看看学习一下.
  • TA的每日心情
    开心
    2025-2-26 15:01
  • 签到天数: 2 天

    [LV.1]初来乍到

    14#
    发表于 2022-8-9 09:27 | 只看该作者
    學習新知識~~謝謝

    该用户从未签到

    15#
    发表于 2022-8-11 21:56 | 只看该作者
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