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Wafer RDL 单线和差分阻抗怎么计算

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 楼主| 发表于 2024-2-20 10:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请教一下大神。
4 `# x& f# y, E( Z9 _4 m$ g: z/ S8 J
Wafer 来料有1层PI 大约5um,   需要在表面在设计RDL 走线, 厚度是电镀铜5um+电镀镍 3um, 线宽8~10um,   走线后再涂1层PI 5um 保护线路。9 V+ b. k+ o* t
' t3 \6 R5 M$ M) n0 Z+ s! o+ h$ A8 h
这种情况下怎么计算单线和差分阻抗? 差分阻抗线距怎么计算?   要不要参考平面?  
  g1 R7 b5 k7 G0 z7 z& I* p. m
! |* i# C7 N! B2 ySI9000好像不支持这种Wafer RDL的计算。$ H7 v% e6 a( t9 b! Y, ~6 N  e' R; G
  • TA的每日心情

    2019-11-20 15:16
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
    发表于 2024-2-20 11:37 | 只看该作者
    而差分阻抗则是描述了两个信号线之间的相对阻抗,即差分对之间的阻抗。
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