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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › sigxplorer No dielectric layer in layer stack报错
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sigxplorer No dielectric layer in layer stack报错

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cplanxy

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 楼主| 发表于 2024-2-28 15:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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用cadence 16.6 打开PCB，然后probe用sigxplorer打开其中一个网络时报错，网上找了好久，没有找到问题怎么解决的。请问有碰到同样问题的朋友么
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