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FC+WB的设计,导入原理图后,芯片层怎么放

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  • TA的每日心情
    开心
    2024-9-24 15:34
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    [LV.5]常住居民I

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    1#
     楼主| 发表于 2024-3-6 14:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    FC+WB的设计,导入原理图后,芯片层怎么放?
    2 d6 t% B" `* }$ z! h: q# I提前建好FC WB芯片的库文件  导入原理图后,怎么放置芯片。WB芯片层怎么放才能引出手指?1 t) [* A* C" c2 O0 R( n" J$ F# F
  • TA的每日心情
    开心
    2025-2-12 15:43
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    [LV.6]常住居民II

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    发表于 2024-5-13 17:13 | 只看该作者
    1. 导入网表2. 将所用器件放置在Layout中,此时默认是Flip Chip
    , q8 k( L6 [" B4 Z( O9 b# S, h# v) b7 o3. 点击左上角Edit - Die Stack,弹出对话框+ m* T& _/ I5 \2 v+ O( I
    4. 从“Die stack name”下拉列表选择想修改的器件,左下角的“RefDes”栏会显示器件的位号如“U1”
    % c7 b  O8 l4 s  C  H; J" k. E! c/ S9 Q1 _: X/ ^" C; D$ }9 n
    5. 分别从“Attachment”和“Orientation”下拉列表选择“WIRE BOND”和“CHIP UP”,点击“Apply”8 J( X$ j2 s8 n4 S
    6. 此时修改后的器件从FC变为WB,焊盘所在层也变成DIE层而不是Top层4 u3 Z1 c2 W' _, ?7 u& Z7 x
    (如果修改不了可能是当前叠层结构缺失了Die stack层或者器件含有Fixed属性)# k* X$ ~' Z2 Y
    3 n, I& O# y' Y( A+ s

    stack.png (106.45 KB, 下载次数: 0)

    stack.png

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    发表于 2024-3-15 11:50 | 只看该作者
    冰睡着的水 发表于 2024-3-15 10:40
    7 Q; I# c; ?4 l. X! ?6 F4 T, s. J麻烦看下这样对吗?我拿的模板上都没有DEF Design这一行,这是我按照你说的加的,导进去芯片还是会自动跑 ...

    . l! T, V% M; T3 R最简单的做法:  这几个名称都改成 U5 应该就可以。& C5 H0 X  d& {: Q1 Q+ N6 q- g2 B

    , U" e3 H- T; Z. C1 Y3 D- t" P. p1 U) {/ V/ a& X7 }! x" e0 t
    >PCB Footprint = Name   = U5
    " S% u9 R$ Z4 e7 r% T>Reference = RefDes = U5
    4 Z* T5 f: Z; _DEF Design:  好像没限制, 也用U5最省事。   
    9 ^" _( ]3 P2 [$ N8 b* @; o/ ?1 ?+ N# p

    $ x" @4 Z9 p1 I. |% e% N, y    5 M! C" E0 ]1 ~. O; ~4 _
    : M& k. h8 g- G4 n1 e
    * T- t: D- |5 X6 T
    3 _, p) H" C9 |# _3 X' o4 ]! d
    , r1 n7 u9 j, P) w

    3 x& S- w4 P: |, |" E8 f2 o
    % N7 R/ S4 b6 K5 x8 h
    8 Z5 f: M. J, L+ l, x5 O- A$ e9 S

    该用户从未签到

    4#
    发表于 2024-3-7 10:58 | 只看该作者
    有截图吗?把有问题的地方截图

    该用户从未签到

    5#
    发表于 2024-3-7 11:14 | 只看该作者
    WB 芯片单独用 txt 格式导入, 再导入原理图就行。
    / V5 b$ c& l1 ]" j0 f5 ?9 O; g) D3 N

    点评

    WB用TXT导入后 为什么一导入原理图,之前导入的芯片就不见了?  详情 回复 发表于 2024-3-13 17:21
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    开心
    2024-9-24 15:34
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    [LV.5]常住居民I

    6#
     楼主| 发表于 2024-3-13 17:21 | 只看该作者
    tencome 发表于 2024-3-7 11:142 A1 l, S! L0 o  i% M; f  m! |
    WB 芯片单独用 txt 格式导入, 再导入原理图就行。
    9 \9 k1 z& y: H  ?
    WB用TXT导入后  为什么一导入原理图,之前导入的芯片就不见了?
    ( [) x2 @+ I0 z) B- y

    点评

    txt 里面的命名与原理图命名有差异。 txt 里面的 Name: xxx DEF Design: xxx RefDes: xxx 这几个命名 要与 原理图里面的 名称、footprint、 XXX (好久不用原理图,忘记了) 一 一对应才可  详情 回复 发表于 2024-3-14 15:40

    该用户从未签到

    7#
    发表于 2024-3-14 15:40 | 只看该作者
    冰睡着的水 发表于 2024-3-13 17:21/ e- P! f4 p" q: Q' E* N' [
    WB用TXT导入后  为什么一导入原理图,之前导入的芯片就不见了?
    # F) ]8 E1 m  Y" c, H
    txt 里面的命名与原理图命名有差异。
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    # y; D: N* R  B* I: V: _txt 里面的& P: h8 ?9 q. z. W: b
    Name:   xxx
    8 S0 Z6 T, I2 O8 d# ~1 qDEF Design:  xxx                                        * h* e: A7 }+ w* y  O
    RefDes: xxx
    % [7 o9 J9 C: Z, a+ e" b& \' i6 C, q6 A' d0 I
    ( R: c: G0 d0 \- `' I3 [* K
    这几个命名 要与 原理图里面的  名称、footprint、 XXX (好久不用原理图,忘记了)      一 一对应才可以。
    ! z* C9 H; R9 A* E/ w6 U& e$ g1 k' A2 {3 G

    点评

    麻烦看下这样对吗?我拿的模板上都没有DEF Design这一行,这是我按照你说的加的,导进去芯片还是会自动跑到L1层,不在die层  详情 回复 发表于 2024-3-15 10:40
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    开心
    2024-9-24 15:34
  • 签到天数: 53 天

    [LV.5]常住居民I

    8#
     楼主| 发表于 2024-3-15 10:40 | 只看该作者
    本帖最后由 冰睡着的水 于 2024-3-15 10:46 编辑 + t. N( D2 i2 ^" h
    tencome 发表于 2024-3-14 15:404 v1 k/ _9 r0 V5 ?
    txt 里面的命名与原理图命名有差异。 8 b5 I+ x4 Q$ L' ?% {7 o# P

    / J: j# C0 ?2 k9 i# _) ]' Jtxt 里面的
      T3 m5 T2 e& _$ m2 z, j
    麻烦看下这样对吗?我拿的模板上都没有DEF Design这一行,这是我按照你说的加的,导进去芯片还是会自动跑到L1层,不在die层
    ; t* b7 d6 D5 d% Y. ~

    d14c97fb-0190-4255-874a-3073c2d52fb2.png (16.48 KB, 下载次数: 0)

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    e2f5121b-78ca-4e71-8025-907239203c5a.png (24.21 KB, 下载次数: 0)

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    点评

    最简单的做法: 这几个名称都改成 U5 应该就可以。 >PCB Footprint = Name = U5 >Reference = RefDes = U5 DEF Design: 好像没限制, 也用U5最省事。 [attachimg]386608[/attachimg]  详情 回复 发表于 2024-3-15 11:50
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