DDR区域规则设置问题

穿行Bermuda · 发表于 2024-7-9 11:35

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DDR区域规则设置的时候，由于BGA区域出线的限制，设置区域规则的时候，线宽线距的依据是什么？ neck 模式中能保证达到阻抗的要求吗？

wen11902 · 发表于 2024-7-9 13:40

本人做法依据是：在板厂加工能力允许范围，尽可能减小阻抗误差（一般阻抗加工误差是±10%）；
neck模式，一般不能达到阻抗要求，但可以简单计算或者仿真最大允许neck长度，在范围内都是可以接受的；

aarom · 发表于 2024-7-9 14:29

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穿行Bermuda · 发表于 2024-7-15 17:25

aarom 发表于 2024-07-09 14:29:356 W! ~5 A) [7 A8 W# ?% |
不專業的.; ]2 A# `  y: o2 h- L' c! U
1.BGA出線設 neck模式或限制區域. $ U- G- P& ~; D' }
無法達到阻抗要求, 以能出線為主.% u# y( u# X, n5 \- P: h  j

* K+ w( z1 L) @! ?* D* J2.出線至正常區域,線寬線距回到正常./ K' r' X$ e9 h  F  \
5 u4 a2 o6 n5 z) k( b1 @  b
專業的.! B6 h4 w" Z2 d( z4 K
1.BGA出線設 neck模式或限制區域. 再以 tabbed routing 補償.+ G; O& y! K0 y; Z
, C( G+ `0 q7 ~2 F+ ^( I& u. d
2.出線至正常區域,線寬線距回到正常.

每一段还有不同的阻抗要求，不过通过补偿，就不用分的那么清楚了，感谢大神解答。

穿行Bermuda · 发表于 2024-7-15 17:27

wen11902 发表于 2024-07-09 13:40:21
6 B, X: y/ h% X6 [0 i& h4 Y本人做法依据是：在板厂加工能力允许范围，尽可能减小阻抗误差（一般阻抗加工误差是±10%）；7 q+ X ]% P. S3 h" E& V; a
neck模式，一般不能达到阻抗要求，但可以简单计算或者仿真最大允许neck长度，在范围内都是可以接受的；

还需要提前仿真吗，这部分操作确实没有仿真过。就是看了资料说，可以分段管控阻抗，不过还是要以出线为主。

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