Cadence PCB绘制中，测试点如何设置?

Harley123

Harley123 发表于 2024-10-24 17:35
. _3 A- w: i: i8 N谢谢您的回复！这样添加之后，Soldermark_Top层可以显示测试点了。
2 q( y. C2 n( r6 _. x+ y5 ]另外，您说的防止其它Via的防焊层设 ...

@aarom
谢谢您的回复！
/ c7 F- M% H4 u/ m7 T哈哈，相对于我来说，您已经很厉害了，您一直在帮我解答疑惑，谢谢！
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Harley123

Shieh 发表于 2024-10-24 17:40
: K/ w, k) D8 v' o0 K$ @出光绘的这些层是根据你自己的需求和封装增减的，别照搬别人的

是的，您这个建议是对的，主要前期自己不太懂，所以，都是按照别人的模板一点一点摸索，摸索也是会出现一些问题。谢谢！