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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro使用slide 都是GND网络，线推挤会避让孔？
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allegro使用slide 都是GND网络，线推挤会避让孔？

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jinputou

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1#
 楼主| 发表于 2024-11-22 16:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro使用slide。都是GND网络，线推挤会避让孔。怎么设置线推挤不避让同网络的孔？( J' h, K3 ?+ o$ P# S& f

. b% Y9 @  \; f- N2 {3 z* g! A% j) A

, ~2 @9 `% [0 t: K5 B7 l9 R
9 @5 s% |3 J, h/ P  x2 _
* s. ~, h" F* S4 h8 H

点评

aarom
想推在一齊連接?? 小弟弟教你, 拉線via和線先連接, 再推, 就會連一齊了.  发表于 2024-11-23 06:28

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Sleep_xz

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2#
发表于 2024-11-22 17:47 | 只看该作者
画完线，再放地孔

点评

aarom
不用, 再拉線接VIA, 就可以了.  发表于 2024-11-23 06:33

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aarom
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  • TA的每日心情
    开心
    2025-1-23 15:05

    • 签到天数: 17 天

    [LV.4]偶尔看看III
    3#
    发表于 2024-11-22 18:11 | 只看该作者
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    jinputou

    该用户从未签到
    4#
     楼主| 发表于 2024-11-27 16:03 | 只看该作者
    aarom 发表于 2024-11-22 18:11
    0 g# [2 e$ B7 K4 }" S+ W5 Y9 Z+ Q請問 constraints 的 Same Net Spacing Modes 是在設什麼作用的呢??
    3 }9 u: x) q0 ]6 i* l9 [0 t' J- z代表你沒一開始就拉線連接, 同線路就 ...
    2 z# H9 K' q  j
    明白了，规则是这样的，那就没办法了。谢谢答复！0 T) G2 X7 E% B: s6 G/ R3 k

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    金志峰

    该用户从未签到
    5#
    发表于 2024-12-16 22:48 | 只看该作者
    本帖最后由 金志峰 于 2024-12-16 22:50 编辑 * B( a8 @* [' y- s) R

    5 H/ Q8 `/ p8 {# S8 Q修线的时候，这个相同网络推挤线会避让孔确实比较烦人

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