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cadence CIS库元器件的调用

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1#
 楼主| 发表于 2025-1-20 10:06 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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大佬们,这个有的封装不能预览有的可以是什么原因啊,ini路径都一样的,配置应该没问题,是软件版本问题吗还是库有问题
9 Q# j& d. A$ n& w

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778225eeef678f5fa1cbb774a6dc232.png

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  • TA的每日心情
    开心
    2022-10-4 15:11
  • 签到天数: 68 天

    [LV.6]常住居民II

    推荐
    发表于 2025-1-22 15:24 | 只看该作者
    打开.dra库文件后生成下device文件试试
  • TA的每日心情

    2021-1-21 15:57
  • 签到天数: 121 天

    [LV.7]常住居民III

    3#
    发表于 2025-1-20 13:42 | 只看该作者
    没有C1206封装,看下库里有没有c1206.psm
  • TA的每日心情
    慵懒
    2022-8-2 15:24
  • 签到天数: 49 天

    [LV.5]常住居民I

    4#
    发表于 2025-1-21 16:28 | 只看该作者
    蹲一下,遇到了相同的问题,确定库文件夹里有psm文件,有的能预览到有的不行

    该用户从未签到

    5#
    发表于 2025-2-18 09:34 | 只看该作者
    做的PCB 的封装有多余的层。好像是这个原因。
    . R, S1 H3 F" {( J打开封装 把其他的层删掉

    点评

    具体是哪个层?可以说一下吗  详情 回复 发表于 2025-2-19 15:31
  • TA的每日心情
    擦汗
    2025-2-19 15:19
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
    发表于 2025-2-19 15:31 | 只看该作者
    myiccdream 发表于 2025-2-18 09:34
    - x, n9 i9 s' \: V做的PCB 的封装有多余的层。好像是这个原因。4 I7 n$ V. _1 w
    打开封装 把其他的层删掉
    7 p( C: r; [- D) s7 _
    具体是哪个层?可以说一下吗
    ) g0 T5 r% E- i$ N7 q% M2 _

    点评

    你打开你做的元器件封装。 一般我们建立的新器件封装只有TOP /Bottom 从pcb导出来的器件 就会有很多层叠。 你试试就行,这个论坛也有这个问题说明 其实,这个问题也不影响CIS使用,没必要一定改  详情 回复 发表于 2025-2-19 17:50

    该用户从未签到

    7#
    发表于 2025-2-19 15:40 | 只看该作者
    这个库是自己管理的吗?看上去很完善啊

    该用户从未签到

    8#
    发表于 2025-2-19 17:50 | 只看该作者
    hsy123456 发表于 2025-2-19 15:31
    . `' L0 q! u, }& [具体是哪个层?可以说一下吗
    8 @# e8 ~  \% J1 C" ?
    你打开你做的元器件封装。
    , B1 t1 j: N' i) h4 p/ b一般我们建立的新器件封装只有TOP /Bottom
    8 x# c0 t8 h  E& u% E+ }) ]+ s5 Q; @从pcb导出来的器件 就会有很多层叠。 8 ~! c" N3 u# N( e4 F2 g# E& t
    你试试就行,这个论坛也有这个问题说明
    ) e: R' W, B) w$ [/ O" F其实,这个问题也不影响CIS使用,没必要一定改
    / z5 g, D6 P+ V$ {1 n. T: K$ l
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