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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 发现一个17.4的BUG....
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发现一个17.4的BUG....

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NIWO99

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1#
 楼主| 发表于 2025-7-13 18:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我发现allegro17.4打印不能居中了。也就是打印机设置里的 fit to page 失效了。选与不选都一样。但16.6选上就会自动把图纸居中。不知大家有没有发现这个问题？
" ]" R/ {  b% Q  ?

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NIWO99

该用户从未签到
2#
 楼主| 发表于 2025-7-13 18:49 | 只看该作者
发现原因了，有一个选项我没选 、晕。。。

点评

陛下万年
哪里没选，告诉大家呀，预防万一出错  详情 回复 发表于 2025-7-14 14:32

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陛下万年
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    3#
    发表于 2025-7-14 14:32 | 只看该作者
    NIWO99 发表于 2025-7-13 18:49
    ; B# q) l, B; R* A7 V发现原因了，有一个选项我没选 、晕。。。
    / J* U, y7 F6 r- _; G
    哪里没选，告诉大家呀，预防万一出错
    + C+ Y5 k1 L, N

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