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designator是什么	n042208 2009-8-18 23:46	0 709	n042208 2009-8-18 23:46
capture cis转网表问题	n042208 2009-8-18 22:04	2 2884	n042208 2009-8-18 22:47
一个很现实的问题：如果我们40岁了，还会干工程师么？	buick9323 2009-8-13 15:37	12 1393	John-L 2009-8-18 22:23
懂的主板的高手看看这个什么原因	yuzengshu 2009-8-6 08:45	3 1442	mike 2009-8-18 18:13
请教:在Via上加一个字母"B"或"E"是它们代表什么意思? 1人参与	chenshiqi906 2009-8-17 22:16	5 1313	sjh835170 2009-8-18 17:12
一直困扰我的问题 1人参与	dabing715 2009-8-14 17:40	9 1275	mike 2009-8-18 15:42
铺shape有什么优缺点	yh521py 2009-8-17 10:21	6 1148	scott 2009-8-18 13:15
allegro中如何实现按页放置器件	lpch8 2009-8-17 20:43	3 1552	John-L 2009-8-18 10:34
如何自动添加自由过孔啊？ 1人参与	hpy013 2009-6-23 10:50	9 1853	deargds 2009-8-18 09:36
ALLEGRO画封装时，绘制禁止铺铜区问题	whb3103536 2009-8-16 18:38	9 2966	deargds 2009-8-18 09:32
专业英语解读 1人参与	lwh123468 2009-8-17 15:35	4 1009	deargds 2009-8-18 09:27
请问高手这个怎么解决	jick 2009-8-16 10:28	1 1217	aguang963_0 2009-8-17 10:36
等长线的问题	wxc287939659 2009-8-13 15:42	4 1157	hehehe 2009-8-17 10:34
Reference跟Part Reference都不一样！！！	derek26 2009-8-17 10:05	1 826	derek26 2009-8-17 10:14
CROSS SECTION SYMBOL 怎么做的？	hdjun 2009-8-8 16:40	1 861	liulinjievvv 2009-8-15 20:09
design entry cis打不开	avery 2009-8-13 14:26	2 1422	killerljj 2009-8-15 19:08
请教各位，在走线比较多的情况下，你们怎么布线	wxc287939659 2009-8-11 13:55	1 857	yh521py 2009-8-15 14:53
关于封装库的建法的一点疑问?[已解决]	jasonlu 2009-4-13 00:25	8 1437	aaaqaz2004 2009-8-14 20:55
电源分割	lwh123468 2009-8-11 22:10	4 1064	浪子 2009-8-14 00:50
铜铺在route keepin外面了	liulinjievvv 2009-8-13 21:22	1 1449	袁荣盛 2009-8-13 22:18
请大家帮忙鉴别一下主芯片厂家	憨仔 2009-8-13 21:36	0 835	憨仔 2009-8-13 21:36
表层如何和内层的电源层连接	n042208 2009-8-13 09:47	2 755	n042208 2009-8-13 20:37
新手发问，关于电源层的分割	laoniao 2009-3-26 20:41	3 990	flysky 2009-8-13 19:25
Allegor 15.7中Design Entry CIS的问题	zxg1113 2007-11-23 16:23	5 2505	avery 2009-8-13 14:30
16.2的capture CIS 老实异常退出	pengb07 2009-6-29 00:22	8 2047	whb3103536 2009-8-13 09:07