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电源模块的处理方式 3人参与	七彩雨 2021-1-18 14:21	3 589	weltan 2021-2-3 17:49
allegro在保存时出现的问题[已解决] 2人参与	wenxiaohua 2009-3-9 11:36	12 2853	多宝258 2021-2-3 17:35
allegro 导入网表之后为什么Status没有显示 5人参与	wangbao97 2021-2-3 09:31	5 668	381962743 2021-2-3 16:55
求大神解决在PCB中一个器件怎么移动它的PIN，非常感谢 6人参与	小伟0221 2015-3-24 17:18	6 1406	hi大江东去 2021-2-3 14:18
allegro 多人布线切partiton方法，供大家参考，收集资料。 40人参与	frankdhc 2012-3-11 23:39	11 1545	beryl 2021-2-3 09:41
导入pin delay 长度问题 5人参与	火星撞地球1205 2021-2-1 17:22	6 612	Vegeta 2021-2-2 18:11
cadence allegro负片层怎么用全连接过孔？ 4人参与	zxcvbnmM123 2021-1-30 17:56	5 942	GHOST 2021-2-2 17:27
关于表面铜厚问题？ 5人参与	彦彦 2021-2-1 09:06	5 612	381962743 2021-2-2 14:25
allegro里3D模型不显示 2人参与	夏目0125 2019-11-14 17:24	2 1851	ebaozi 2021-2-2 13:01
基于Cadence的信号完整性仿真步骤 19人参与 ...2	wangmn 2018-11-15 16:18	20 1414	chloeyee 2021-2-2 09:14
ALLEGRO17.2转166出线问题 2人参与	wowoqqp 2021-2-1 16:26	2 742	這侽孓譙悴丶 2021-2-1 16:31
allegro模块复用后器件位置交叉 6人参与	Leporidae 2021-1-22 21:48	9 920	beryl 2021-2-1 11:18
内层设置时这两项起什么作用？ 2人参与	zhanggenyou 2021-1-30 21:51	3 551	kang?kang 2021-1-31 17:01
取圆的中心 5人参与	tyoliver 2021-1-28 09:57	7 855	love476065095 2021-1-30 17:50
16.6经常卡死 10人参与 ...2	trocipek 2020-8-27 19:18	24 5612	trocipek 2021-1-29 16:54
高速走线表层和内层的速率不一样 5人参与	zhangyi@ 2021-1-28 15:24	5 517	1285065592 2021-1-29 16:38
未知版本的.pcb文件，求转换成.brd，版本尽量16 3人参与	leilei4908 2021-1-28 09:50	7 1157	leilei4908 2021-1-29 14:27
《GJB-3243-1998-电子元器件表面安装要求》有需要的吗？ 9人参与	jiaxiuxin 2016-5-25 11:19	7 1475	dijiaoutman 2021-1-29 12:08
阻抗线的问题 6人参与	tyoliver 2021-1-12 16:17	12 1068	tyoliver 2021-1-29 11:50
pcie gen3硬件设计要点 2人参与	pcbdesigner 2020-12-21 16:42	2 800	lingyun1 2021-1-29 10:44
allegro 16.6自动布线 8人参与	yangl201105 2021-1-20 10:39	12 883	thien 2021-1-29 00:20
allegro16.6版本route菜单下少tmingvision功能，怎么解决 3人参与	严小Y 2021-1-2 17:40	3 563	56的账号 2021-1-28 23:56
网表导入问题	L123321 2021-1-28 23:36	1 505	L123321 2021-1-28 23:51
请教cadence 绘制PCB时如何使走线走在无网络的NC焊盘上不报错 6人参与	niliuchudao 2020-12-25 18:50	7 707	promissingwh 2021-1-28 16:21
SDI 座子layout注意的地方？ 9人参与	Aubrey 2013-6-8 22:34	5 3023	promissingwh 2021-1-28 14:28