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Cadence Allegro论坛今日: 2 |主题: 34054|排名: 2

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Parts 放不进去问题 6人参与	绿萝来袭 2013-7-12 09:48	13 657	绿萝来袭 2013-7-13 09:18
工艺边的问题 5人参与	七彩雨 2013-7-9 22:56	14 1140	七彩雨 2013-7-13 00:10
制作封装时，怎么删除多余的焊盘 1人参与	影轩老豆 2013-7-12 18:13	1 706	wwddss_1976 2013-7-12 20:19
奇怪现象，gerber出不出outline 4人参与 - [已解决]	fraiy 2013-7-12 12:27	4 1886	hcf830716 2013-7-12 14:04
请教下等长约束如何确定的 2人参与	pury 2013-7-11 23:09	2 641	pury 2013-7-12 14:01
求教allegro覆铜和焊盘连接 2人参与	zezq7sxa 2013-7-12 10:46	2 2870	zezq7sxa 2013-7-12 13:01
allegro export libraries error 2人参与	careyhung 2013-7-11 15:12	2 2167	careyhung 2013-7-12 10:47
關於VIA 3人参与	penny190 2013-7-12 09:24	3 1407	penny190 2013-7-12 10:09
allegro中能否只显示特定网络的走线，其他走线都不显示 2人参与	ll5152003 2013-7-11 16:52	3 1680	香雪海 2013-7-11 17:42
紧急求助 3人参与	jhdxpp 2013-7-11 14:03	6 566	香雪海 2013-7-11 17:25
请教大家一个问题，我的FPGA封装是在官网下载的，做的封装直接fanout了的 5人参与	twffwt 2013-7-3 21:37	7 1255	风刃 2013-7-11 11:36
请教一下各位大神什么是漏槽	初学滨 2013-7-11 10:32	0 496	初学滨 2013-7-11 10:32
大家一起帮忙讨论个问题，， 2人参与	twffwt 2013-7-11 09:43	2 532	twffwt 2013-7-11 10:31
关于cadence 16.3 hotfix	luhailei 2013-7-11 09:34	0 830	luhailei 2013-7-11 09:34
Netlist不能包含''#'' 的问题 11人参与	milliman 2013-5-23 17:46	12 1448	zn383462925 2013-7-10 21:30
求助显示问题，同一屏幕分割为两个部分 3人参与	rockymohuan 2013-6-25 09:46	3 692	123123 2013-7-10 10:36
allegro中可否直接对过孔赋与网络，，谢谢 9人参与	twffwt 2013-7-5 11:30	7 1620	mako88 2013-7-10 09:58
请教Enable On-line DRC在那设置，右下角显示红色应该是关闭DRC了 1人参与	ahong007 2011-6-30 23:47	1 1281	Cedar_zxs 2013-7-10 08:57
求救：有关WIFI天线的处理 29人参与	xiaomujie 2011-11-1 09:03	7 1451	chensi007 2013-7-10 08:22
anti pad 间距 2人参与	eversong 2013-7-5 16:20	2 806	wdc 2013-7-10 08:13
有木有有人在win8里面和谐成功16.6的？ 12人参与	amadeus 2012-10-28 21:55	12 4106	金志峰 2013-7-10 03:22
Thermal relief和anti pad 11人参与	lcgoneone 2012-11-2 19:46	9 2256	rx_78gp02a 2013-7-9 22:14
请问valor如何比对两个BRD的差异？ 2人参与	网上邻居 2013-7-9 08:25	2 1704	网上邻居 2013-7-9 20:47
PROTEL布局转换为Allegro问题！ 3人参与	blyxz 2013-6-20 17:55	3 953	kathy1976 2013-7-9 20:15
创建外框以及place_bound问题，求回复 7人参与	wanghairui168 2013-7-4 20:22	5 709	wanghairui168 2013-7-9 19:40