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楼主: eda-chen

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[HyperLynx] hyperlynx仿DDRx模块问题

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发表于 2013-11-29 14:43 | 只看该作者

LZ，请问DDR3读仿真的数据是怎样的呢？我刚自己摸索弄了一个DDR3 800的仿真结果，读的时序的建立保持时间和写的基本是一样的，这是怎么回事，显示的是PASS，可是不明白究竟是不是对的？按理读的TDQSQ应该小于200ps, Tqh应该大于950ps，可是仿真结果读写在一个数据表格里，反应的是Tds/Tdh，而且数量都是580到620ps,这个怎么理解呢，仿真结果自动将读操作DQS的相位作了1/2的BIT位偏移？

点评

读写的时候数据与DQS对齐方式不一样，朝这个方向找找资料呢详情回复发表于 2016-1-5 16:41

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发表于 2013-11-29 14:46 | 只看该作者

加QQ：64442092，求指导

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发表于 2013-11-30 11:24 | 只看该作者

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发表于 2015-3-26 20:10 | 只看该作者

有没有人已经掌握了啊？

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楼主| 发表于 2016-1-5 16:41 | 只看该作者

jerryzhang0220 发表于 2013-11-29 14:43
* V) Y4 \: N/ ?# t3 ~0 d0 i" kLZ，请问DDR3读仿真的数据是怎样的呢？我刚自己摸索弄了一个DDR3 800的仿真结果，读的时序的建立保持时间和 ...

读写的时候数据与DQS对齐方式不一样，朝这个方向找找资料呢

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楼主| 发表于 2016-1-5 16:43 | 只看该作者

hhit2009 发表于 2013-10-11 14:061 a$ H4 F# P, d" |# d5 s, g6 f8 ?
谢谢！模型里没有给出VIL和VIH，它默认为VIH=2V了，所以出问题了，添加上就可以了，我仿真后Clock和Addre ...

没有内容一般是最后检查有错，把错误全部解决就可以了

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发表于 2019-4-9 15:34 | 只看该作者

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发表于 2019-4-9 15:41 | 只看该作者

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