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[Cadence Sigrity] SigXplorer中Rel Prop Delay问题

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1#
发表于 2015-3-27 15:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro中,CPU到DDR的线,设置了XNET和T点,走线完成后,在显示等长数值的地方看 没有数值,黄色。0 @; j, _$ {' g+ T8 @  o( w
有几根线的在SigXplorer中看,没有设置模板,要这么解决,坐等回复. V4 R8 y5 g' K, W

9 r# A' }4 o6 O2 u  A+ R% L- V( ?5 X点Cmgr图标等长处显示:
% s) T6 [/ U( M8 \4 ]/ i; _7 @; H4 h
在SigXplorer查看,正确的地方为:! G; l, K! v1 ~1 s4 ~) ]( l

, @; J5 L! ?3 ]0 o' K; V4 J7 d  B' P0 r7 a8 p+ ^
异常的网络为:$ ]& c$ [9 A5 q) s( t

  @0 _/ t& Q. J# X
2 y; ?7 g5 j. R8 \/ Q! C& N7 R

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2#
 楼主| 发表于 2015-3-27 15:31 | 只看该作者
就是同一组等长,设置模板没有到其中的2个网络。要怎么解决

该用户从未签到

3#
 楼主| 发表于 2015-3-30 16:54 | 只看该作者
最后用最原始的方法,删除T点和XNET再重新设置了
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