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有个阻抗的问题,一直搞不明白

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1#
发表于 2015-9-6 17:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有个最抗的问题,一直搞不明白,  书上说在走高频微带线的时候,对地最抗要求50欧姆, 通过调整线与地线参考层的距离来调整阻抗;7 ~( l0 }, I5 v, V6 k
我可以这样理解吗 ,这个阻抗是高频最抗,对地阻抗是对某一个频率而言的,如果频率变了,这个阻抗也会变;. c1 p6 g- T# N# ?
* W. o$ M; ^" _( B
那么在很多资料中的 微带线50欧姆最抗,是对哪一个频率来说的呢?  10M?  100M?  1G? , 谢谢大家指导。3 C  g0 u) E/ s$ @9 a

该用户从未签到

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发表于 2015-9-6 18:01 | 只看该作者
你的问题比较有意思。阻抗确实是与频率有关系的,一般情况来讲,很多在介绍阻抗的时候都是不加频率的。如果是PCB设计,很多都是按1M的参数来确定其阻抗。你可以通过调整参考层的距离或者是线宽来改变阻抗。如果是差分的话可以调整间距。当然如果可以改材料,也能改变其阻抗。

点评

哦,非常感谢啊, 画高频的 500M的板子,也是按照1M算阻抗的吗?求解,谢谢  详情 回复 发表于 2015-9-6 18:24

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 楼主| 发表于 2015-9-7 13:15 | 只看该作者
菩提老树 发表于 2015-9-7 11:17
  u& N% ~& |( D5 W* u连续性是很重要,但是要整个链路都连续。当然,如果是500M的信号(除了时钟信号),一般都不会有太大的问 ...
) u6 f0 O7 x+ I* P. s7 l! U: a/ x
“阻抗的连续性” 不是很了解,端接电阻是不是就是为了做这个的啊?,/ G( K, x1 G' f. h$ q+ }$ y
再请教一下啊,比如说这种情况   一个CPU高速数据信号到 SDRAM缓存的输入结构, CPU输出端口是有一定阻抗的, SDRAM的端口是有一定阻抗的, 假设中间型号线已经做了50ohm的对地阻抗匹配了,那么怎么做对两个端口的 最抗匹配呢,求高手解啊,谢谢啊;8 e6 ?( i' b; d5 r( \- p
' B. v2 V* U' A7 l+ _2 V$ U+ p

点评

阻抗连续性就是整个链路的阻抗都一致。 关于你说的SDRAM的阻抗匹配也是一样的。  详情 回复 发表于 2015-9-7 14:49

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4#
 楼主| 发表于 2015-9-6 18:24 | 只看该作者
菩提老树 发表于 2015-9-6 18:01
7 j; Y$ i, a" p! f$ N* _你的问题比较有意思。阻抗确实是与频率有关系的,一般情况来讲,很多在介绍阻抗的时候都是不加频率的。如果 ...
+ C# ~/ Q( V9 ]# ]- Q, B
哦,非常感谢啊,  画高频的 500M的板子,也是按照1M算阻抗的吗?求解,谢谢

点评

恩,没有问题,就这样计算就可以啦  详情 回复 发表于 2015-9-7 11:16

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5#
发表于 2015-9-6 18:55 | 只看该作者
高频的时候,阻 抗是要考虑的,阻 抗最怕是不连续, 100M、500M 时阻 抗变化不大。不要天天对阻抗的大小太较真。

点评

谢谢,前辈啊, 信号的连续性, 比如手两个芯片的高速数据通讯, 引脚输出,与引脚输入,加微带线, 怎么做到三个都阻抗连续呢,谢谢,求解啊  详情 回复 发表于 2015-9-7 13:18

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6#
发表于 2015-9-6 21:45 | 只看该作者
信号完整性上面是这么描述的。6 N$ O4 w/ R; v& `

0 J: G1 j; E, T1 l; y假设传输线均匀,信号在任何地方感受到的阻抗相同,这个阻抗值表示整个传输线的特性阻抗。(如50欧姆)8 \. f- A+ x$ j: g+ s& C* U
5 k- A, d( [5 X6 }) a- @- w
无损模型:Z=L/C^1/2。
& Y6 H7 p7 M- r$ i& f! p
9 W( x. {" }; ~) ~9 X* q* {影响单位电容与电感就影响了特性阻抗。

点评

数年后,才发现,这一条是正确答案,TKS  详情 回复 发表于 2023-6-10 00:35
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    7#
    发表于 2015-9-7 08:46 | 只看该作者
    阻抗的连续性比阻抗的具体数值更重要。

    该用户从未签到

    8#
    发表于 2015-9-7 10:31 | 只看该作者
    学习了,连续比数值重要

    点评

    连续性是很重要,但是要整个链路都连续。当然,如果是500M的信号(除了时钟信号),一般都不会有太大的问题。  详情 回复 发表于 2015-9-7 11:17

    该用户从未签到

    9#
    发表于 2015-9-7 11:16 | 只看该作者
    leeping2d 发表于 2015-9-6 18:245 l- V4 S( c) |7 f
    哦,非常感谢啊,  画高频的 500M的板子,也是按照1M算阻抗的吗?求解,谢谢
    $ I; `( o& U% \6 A, C0 x
    恩,没有问题,就这样计算就可以啦

    该用户从未签到

    10#
    发表于 2015-9-7 11:17 | 只看该作者
    kerwinash 发表于 2015-9-7 10:31: T4 r( x/ g# X! `. s. u
    学习了,连续比数值重要
    * s/ f( s; O1 c% W; P
    连续性是很重要,但是要整个链路都连续。当然,如果是500M的信号(除了时钟信号),一般都不会有太大的问题。) x8 f+ B9 I0 @! O

    点评

    “阻抗的连续性” 不是很了解,端接电阻是不是就是为了做这个的啊?, 再请教一下啊,比如说这种情况 一个CPU高速数据信号到 SDRAM缓存的输入结构, CPU输出端口是有一定阻抗的, SDRAM的端口是有一定阻抗的, 假  详情 回复 发表于 2015-9-7 13:15

    该用户从未签到

    11#
     楼主| 发表于 2015-9-7 13:18 | 只看该作者
    True 发表于 2015-9-6 18:55" N! F. x; F3 F7 w3 C
    高频的时候,阻 抗是要考虑的,阻 抗最怕是不连续, 100M、500M 时阻 抗变化不大。不要天天对阻抗的大小太 ...
      U$ I( u' E) e/ Z2 O
    谢谢,前辈啊, “阻抗的连续性”, 比如手两个芯片的高速数据通讯, 引脚输出,与引脚输入,加微带线, 怎么做到三个都阻抗连续呢,谢谢,求解啊
    7 M  D2 S$ q0 p9 p+ w& M; o

    点评

    呵呵,后面讨论的都对啊。  详情 回复 发表于 2015-9-7 15:13

    该用户从未签到

    12#
    发表于 2015-9-7 14:49 | 只看该作者
    leeping2d 发表于 2015-9-7 13:150 ^/ t9 @. G/ B3 ?  J3 n0 F0 P) h
    “阻抗的连续性” 不是很了解,端接电阻是不是就是为了做这个的啊?,
    , D5 f4 T6 g/ _& Q1 y再请教一下啊,比如说这种情况    ...
    6 v0 R, F( r+ r9 F  d/ e  J
    阻抗连续性就是整个链路的阻抗都一致。6 u& q5 g# l& d
    关于你说的SDRAM的阻抗匹配也是一样的。* f- h6 E' d4 u3 C3 z, h5 j4 x

    该用户从未签到

    13#
    发表于 2015-9-7 15:13 | 只看该作者
    leeping2d 发表于 2015-9-7 13:18
    4 A  V0 N& z# g8 a; F1 l谢谢,前辈啊, “阻抗的连续性”, 比如手两个芯片的高速数据通讯, 引脚输出,与引脚输入,加微带线,  ...
    : t8 e* l2 I' U. F4 ^/ z* h' E
    呵呵,后面讨论的都对啊。   
    + p- y5 y7 L5 n, h/ v7 `' v8 V$ m

    该用户从未签到

    14#
    发表于 2015-9-8 08:51 | 只看该作者
    多多学习中 高频要理论的支持

    点评

    好的,有没有什么书推荐啊?  详情 回复 发表于 2015-9-8 16:50

    该用户从未签到

    15#
     楼主| 发表于 2015-9-8 16:50 | 只看该作者
    q270350800 发表于 2015-9-8 08:51
    - v) [% G2 {2 [3 B2 b' z- }8 O多多学习中 高频要理论的支持
    5 @( L" i4 g+ U  m9 c5 a
    好的,有没有什么书推荐啊?% @' _  O, j" v5 v- ?; W7 L; y
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