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设计好的PCB如何检查等长的问题

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发表于 2015-9-25 14:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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一个主IC挂两片DDR,主IC到DDR使用T型结构分出,要求是主IC分别到DDR的网络等长,设计的时候使用的是虚拟过孔,设计完成后如何检查符合要求。还有DDR3做等长200mil以内可以吗?
* I- _1 ?8 m& B  a: ]

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2#
发表于 2015-9-25 15:28 | 只看该作者
设计完成后输出等长表格后,检查等长数据。1 R4 {4 [4 c( k$ E) W/ g

( g" i: c! s- P; G0 M$ {地址线等长200mil没有问题。

点评

请问jimmy 输出等长表格是这个吗?  详情 回复 发表于 2015-9-25 23:13

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3#
 楼主| 发表于 2015-9-25 23:13 | 只看该作者
jimmy 发表于 2015-9-25 15:28
1 K7 u/ m! X- C; d& \) w* Y5 ?设计完成后输出等长表格后,检查等长数据。+ ]( F; ]" X: L! a- M6 P- S
, G0 d/ p6 ], x/ J7 U
地址线等长200mil没有问题。
8 L: w& W2 C3 e/ \. h
请问jimmy 输出等长表格是这个吗?
' @6 X, V, G! k) M

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4#
发表于 2015-9-28 09:47 | 只看该作者
对,是的
% e6 H% Y4 C5 J) d
& g' K! |$ c/ y/ H# }详情可参阅《PADS9.5实战攻略与高速PCB》一书。9 H# U: X3 L4 t9 \! V
8 ?2 S3 j3 K! S# V8 I! s( K6 V
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