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磁珠放置位置问题

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1#
发表于 2016-1-7 21:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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图中IC的3.3V电源为模拟电源,对噪声十分敏感,LDO产生的3.3V只为IC这个模拟电源供电,且LDO和IC的距离也比较近,请问磁珠放在A点合理还是B点合理?   A, h2 `# {/ ]4 {9 Z) J* {$ ^

QQ图片20160107214801.jpg (137.57 KB, 下载次数: 9)

QQ图片20160107214801.jpg

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发表于 2016-1-13 09:58 | 只看该作者
我说下放B点的害处:  一,增大了电源阻抗。后级IC如有突发电流时,IC的供电波动比较大,不够好。   放LDO输入是恨好的方案

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 楼主| 发表于 2016-1-8 17:23 来自手机 | 只看该作者
MStrong 发表于 2016-1-8 17:00
9 R" V0 F6 \( U  T) l5 Q必须是B点

0 c+ }  F, _' n; |理由呢?

点评

同意 负载是 SoC,FPGA 等,建议在B点  详情 回复 发表于 2016-1-18 16:01
噪聲要儘早在源頭就做阻擋,後面再擋的話,有時後會擴散到其它地方去。 B 點後的 IC 如果 CPU 、FPGA…… 這類高速器件,有時候 B 點也需要再多一顆磁珠。 因為這些器件,本身就很容成為干擾源。 :lovelin  详情 回复 发表于 2016-1-9 12:58

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发表于 2016-1-9 12:58 | 只看该作者
本帖最后由 超級狗 于 2016-1-12 18:59 编辑 6 X: R$ ~' B# M. ~. q
xiaoyu19890210 发表于 2016-1-8 17:23
* x4 g" ?  @( y0 S, W# J理由呢?
; Z! p" w, F( h
噪聲要儘早在源頭就做阻擋,後面再擋的話,有時候會擴散到其它地方去。
( k9 ]! A) u5 b  I4 e2 M# ]2 G
+ r# r8 o  B9 {% n2 iB 點後的 IC 如果  CPU 、FPGA…… 這類高速器件,有時候 B 點也需要再多一顆磁珠。% F! L9 p5 L0 ?- ~' r& w

9 [. m8 m0 }2 v0 Y因為這些器件,本身就很容成為干擾源。' ~2 v" {5 x) E5 U9 a  L: Z

7 q) ?4 r9 R$ u6 z  h0 d% Q) V- \1 F$ c# q) K1 W

; F7 f9 O( l2 E" b, `

点评

支持!: 5.0
支持!: 5
学习了,讲得很好  发表于 2016-1-12 18:03

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4#
 楼主| 发表于 2016-1-8 11:48 来自手机 | 只看该作者
12345liyunyun 发表于 2016-1-8 11:12
7 m! n0 E: M# d) ?B点

0 }7 w- h3 Y* ?. C" s' H: _能说说理由吗?. ?: J1 E  i6 S4 H& j% M# z

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6#
发表于 2016-1-8 13:34 | 只看该作者
不A,难道你要B?

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7#
发表于 2016-1-8 15:44 | 只看该作者
A点滤出进口端高频杂波信号 LDO电源为线性输出

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8#
 楼主| 发表于 2016-1-8 16:31 来自手机 | 只看该作者
fallen 发表于 2016-1-8 12:52
8 S; x  w  y0 r# P4 u1 R9 i4 h2 \显然是A点
: n* J$ ?$ R3 l
我也觉得应该放A点,不敢肯定,能说放A点的好处以及放B点的害处吗?

点评

优先在前端滤掉,然后LDO稳压,即使有问题也可以有多种选择。  详情 回复 发表于 2016-1-9 23:56

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11#
发表于 2016-1-9 12:49 | 只看该作者
A 點優先,噪聲砍得不夠多的話,B 點再放一顆。& e0 F& Z( v' i5 |$ J

4 j1 C1 I7 x% V. a  i

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13#
发表于 2016-1-9 17:13 来自手机 | 只看该作者
真的不错哦

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14#
发表于 2016-1-9 23:56 | 只看该作者
xiaoyu19890210 发表于 2016-1-8 16:31* P* u* A; E" Y- @9 {
我也觉得应该放A点,不敢肯定,能说放A点的好处以及放B点的害处吗?

, j  [* u. ?3 k7 @2 }  Y优先在前端滤掉,然后LDO稳压,即使有问题也可以有多种选择。
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