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allegro 16.6 如何设定不同Net 短路时又不会出现DRC

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1#
发表于 2017-5-4 12:26 来自手机 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请问大虾allegro 16.6 如何设定不同Net 短路时又不会出现DRC?

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3#
发表于 2017-5-4 13:37 | 只看该作者
短路肯定有DRC的,没有DRC才是有问题的。
& q# W  \3 Q6 u建议最好留着DRC,你可以不用理会它,防止后面忘记了,有个DRC可以知道的% v$ w* k6 ?: w4 ^: k! E

4 D. d2 @' e( A: G4 a5 d5 }不同网络如果需要短接,你如果不想出现DRC,可以另起一层(非走线层)画个线短接,
) l, E% U$ e) k& y8 F2 o) P  f4 M' D但是你设置光绘时候记得把这个线设进去,否则走线层没有这个线生产出来是开路的

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4#
发表于 2017-5-4 13:50 | 只看该作者
短接点建议可以建个封装,(记住不要开窗,这个不需要焊接的),前后网络可以不一样,中间画个线(非走线层)端接即可,光绘设置时记得把那个非走线层的线设置加进去,否则就不链接了。, C# E! A: G5 ~6 t$ V

点评

请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber  详情 回复 发表于 2017-5-4 13:58

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5#
 楼主| 发表于 2017-5-4 13:58 | 只看该作者
superlish 发表于 2017-5-4 13:50
& Q1 R. P5 a0 r# R  C短接点建议可以建个封装,(记住不要开窗,这个不需要焊接的),前后网络可以不一样,中间画个线(非走线层 ...
! `* V/ {+ G2 W; f( D& o" o. o
请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber6 K& r' x7 [- ?
' k4 K2 M1 W, i( n

/ U) a& ?+ ^* T& a2 B, T% X; B' H" D! S( x  r0 Z

QQ图片20170504135729.png (33.4 KB, 下载次数: 16)

QQ图片20170504135729.png

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请问下你这个有在原理图上有标示出来的吗? 最好原理图也标一下,要不下次改版或者换别人做就不清楚这里强连是什么意思了,别人估计会当做短路处理了。  详情 回复 发表于 2017-5-4 15:08

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6#
发表于 2017-5-4 14:57 | 只看该作者
强连也可以出GERBER的  |7 ~2 L* j  |
最好自己定义单独一层,防止和其他信息冲突) |- G" c9 h( E# j) A% X- p
/ W4 C! c+ j  E- M7 E$ j

, k# L' S" q( _, O' D

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7#
发表于 2017-5-4 15:08 | 只看该作者
finezhang 发表于 2017-5-4 13:58' n: T) q& ]* K- s8 M" i4 x
请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber

2 y3 q2 o! N4 b8 ~, |. O( Y请问下你这个有在原理图上有标示出来的吗? 最好原理图也标一下,要不下次改版或者换别人做就不清楚这里强连是什么意思了,别人估计会当做短路处理了。# k/ V) ~$ T" a: \
2 c* C1 x; p% j9 V4 H* Z6 H

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8#
发表于 2017-5-4 15:22 | 只看该作者
还有一种短接的,铜靠近点,弄最小间距不报错就OK,然后开钢网,一刷锡膏就连上了 . m& V/ }$ u% z. K- o- L, j

, `% x' X# @0 Z
+ U( @2 x# e9 t( E3 Y/ v6 q, U

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9#
 楼主| 发表于 2017-5-4 15:39 | 只看该作者
没有明白怎样在封装里面:添加2个中间画个线(非走线层)
( N& f; {" H$ n7 |5 R333层怎样添加的

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[attachimg]126702[/attachimg]  详情 回复 发表于 2017-5-4 16:14

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10#
发表于 2017-5-4 16:14 | 只看该作者
finezhang 发表于 2017-5-4 15:39. m" c/ h  _, ^8 @& H9 G! x/ f
没有明白怎样在封装里面:添加2个中间画个线(非走线层)3 Q! i2 w. A/ f" g* p( }$ I$ [5 @9 H- x
333层怎样添加的

; c8 r, [% ?' A/ U6 ^2 I2 Q# ? 4 f% K6 V5 j0 s7 g. g

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元件如果放到底层,top和bottom层怎样区分?  详情 回复 发表于 2017-5-4 17:35

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11#
发表于 2017-5-4 16:57 | 只看该作者
不出现DRC自己都不知道短路了

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12#
 楼主| 发表于 2017-5-4 17:35 | 只看该作者

# `. s+ S7 |9 l0 M元件如果放到底层,top和bottom层怎样区分?
6 J# g9 X9 B0 k/ i, g

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不明白你要说什么?? 放哪层就是哪层啊  详情 回复 发表于 2017-5-5 19:56

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13#
发表于 2017-5-5 17:27 | 只看该作者
一般一个板子允许短路的地方不会很多,允许短路的地方自己做的板子自己心里很清楚,把允许短路的drc隐藏即可,搞得那么麻烦!

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14#
发表于 2017-5-5 19:56 | 只看该作者
finezhang 发表于 2017-5-4 17:358 V2 _; r3 n* U( _7 X. J  i2 |* _
元件如果放到底层,top和bottom层怎样区分?
( ?8 ^' g" v4 z+ p$ \
不明白你要说什么?? 放哪层就是哪层啊+ n, F' a: O; f: a- e  S0 }

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已搞定,谢谢大侠耐心讲解!  详情 回复 发表于 2017-5-5 18:11

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15#
 楼主| 发表于 2017-5-5 18:11 | 只看该作者
superlish 发表于 2017-5-5 19:56$ e. w4 M: k( s  A% ~! k! D
不明白你要说什么?? 放哪层就是哪层啊

( b" {% Z: O6 e+ j1 [& ^: R7 }已搞定,谢谢大侠耐心讲解!& X: q, x9 O# @, H

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